[发明专利]数字数据处理系统高速缓冲存储器内容的失效标记无效
| 申请号: | 90107094.7 | 申请日: | 1987-09-17 |
| 公开(公告)号: | CN1019236B | 公开(公告)日: | 1992-11-25 |
| 发明(设计)人: | 保罗·鲁宾菲尔德 | 申请(专利权)人: | 数字设备公司 |
| 主分类号: | G06F12/08 | 分类号: | G06F12/08;G06F13/36 |
| 代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 马铁良,程天正 |
| 地址: | 美国马*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 数字 数据处理系统 高速 缓冲存储器 内容 失效 标记 | ||
1、一数字数据处理系统,该系统包括一部件和至少另外一个与总线互相连接的设备,本发明其特征在于该部件包括高速缓冲存贮器装置,该高速存储缓冲器包括有多个项目,每个项目包括一个块,该块包括有一标识符存储器和一失效指示器,该失效指示器含有有效状态和失效状态,该部件进一步包括总线接口电路装置,用于连接到总线,以便接受在总线的相应线上的地址信号,地址控制信号和高速缓冲器控制信号,上述总线接口电路进一步连接到高速缓冲存储器,并包括:
A.地址接收电路,连接至上述总线,响应上述地址控制信号来接收上述地址信号;
B.标识符比较器,连接至上述地址接收电路和全部标识符存储器,响应于一第一个高速缓冲存储器控制信号,以确定上述地址信号和上述标识符存储器的内容是否一致;以及响应于第二个高速缓冲存储器控制信号,以确定递增的地址信号和上述标识符存储器的内容是否一致;
C.失效指示器控制电路,连接到上述标识符比较器和总线,响应于上述高速缓器控制信号和一个完全的符合一致,以控制具有与失效状态一致的项目的失效指示器。
2、根据权利要求1的系统,所述比较器包括一地址递增器,用于根据接到第二个高速缓冲存储器控制信号来产生一增量地址值,所述标识符比较器确定上述递增地值和所述标识符存储器的内容是否一致,和所述失效指示器控制电路对上述比较是一致的情况作出响应,以将具有上述一致的项目的失效指示器调节到失效状态。
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