[实用新型]一种基于A40I的核心板有效
| 申请号： | 202220933129.8 | 申请日： | 2022-04-21 |
| 公开（公告）号： | CN217157185U | 公开（公告）日： | 2022-08-09 |
| 发明（设计）人： | 李希岗;郭翠珍 | 申请（专利权）人： | 深圳市盈安信科技有限公司 |
| 主分类号： | G06F1/16 | 分类号： | G06F1/16 |
| 代理公司： | 深圳市博锐专利事务所 44275 | 代理人： | 张鹏 |
| 地址： | 518000 广东省深圳市龙华区民治街*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 一种 基于 a40i 核心 | ||
1.一种基于A40I的核心板，其特征在于，包括线路板；
所述线路板上设有核心处理器、电源管理芯片、内存芯片、低压差线性稳压器和存储芯片；所述核心处理器的型号为A40I；
所述线路板的接口为160脚邮票孔接口；
所述内存芯片的型号为LPDDR3；
所述核心处理器分别与所述电源管理芯片、内存芯片、低压差线性稳压器、存储芯片连接和邮票孔接口连接；
所述电源管理芯片与所述邮票孔接口连接。
2.根据权利要求1所述的一种基于A40I的核心板，其特征在于，所述核心处理器包括地址信号线、第一时钟信号线以及第一控制信号线；
所述内存芯片包括地址信号输入线、时钟信号输入线和控制信号输入线；
所述地址信号线、时钟信号线以及控制信号线分别与所述地址信号输入线、时钟信号输入线和控制信号输入线对应连接。
3.根据权利要求1所述的一种基于A40I的核心板，其特征在于，所述核心处理器包括数据信号线、第二时钟信号线以及第二控制信号线；
所述存储芯片包括数据信号传输线、第二时钟信号接收线以及第二控制信号接收线；
所述数据信号线、第二时钟信号线以及第二控制信号线分别与所述数据信号传输线、第二时钟信号接收线以及第二控制信号接收线对应连接。
4.根据权利要求1所述的一种基于A40I的核心板，其特征在于，所述核心处理器包括第一电源输入端和第二电源输入端；
所述电源管理芯片的电源输出端分别与第一电源输入端及所述存储芯片的电源输入端连接；
所述第二电源输入端与所述低压差线性稳压器的电源输出端连接。
5.根据权利要求1所述的一种基于A40I的核心板，其特征在于，所述邮票孔接口包括电源控制引脚；
所述电源管理芯片包括电源控制输入引脚；
所述电源控制引脚与所述电源控制输入引脚连接。
6.根据权利要求1所述的一种基于A40I的核心板，其特征在于，还包括加密芯片；
所述加密芯片与所述核心处理器连接。
7.根据权利要求1所述的一种基于A40I的核心板，其特征在于，所述线路板设置有屏蔽盖和屏蔽夹；
所述屏蔽盖和屏蔽夹覆盖所述线路板的表面。
8.根据权利要求1所述的一种基于A40I的核心板，其特征在于，所述线路板上设置有四组接地焊盘；
四组所述接地焊盘分别分布在所述线路板的顶角位置。
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