[实用新型]一种交叉耦合电荷泵电路有效

专利信息
申请号: 202220889062.2 申请日: 2022-04-18
公开(公告)号: CN217469766U 公开(公告)日: 2022-09-20
发明(设计)人: 钱栋良;牛森彪;黄伟;曹华;顾美庆 申请(专利权)人: 无锡中科微电子工业技术研究院有限责任公司
主分类号: H02M3/07 分类号: H02M3/07;H02M1/34
代理公司: 无锡市大为专利商标事务所(普通合伙) 32104 代理人: 殷红梅
地址: 214111 江苏省无锡市*** 国省代码: 江苏;32
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摘要:
搜索关键词: 一种 交叉 耦合 电荷 电路
【权利要求书】:

1.一种交叉耦合电荷泵电路,其特征在于,包括升压电路(1)、输出电路(2)和时钟电路(4),所述升压电路(1)的输入端连接电源电压,用于对电源电压进行升压;

所述升压电路(1)的输出端与输出电路(2)的输入端连接,用于输出升压后的电压;

所述时钟电路(4)与所述升压电路(1)连接,用于提供第一时钟信号(CLK1)、第二时钟信号(CLK2)、第三时钟信号(CLK3)和第四时钟信号(CLK4),所述第一时钟信号(CLK1)和第二时钟信号(CLK2)的低电平不交叠,所述第三时钟信号(CLK3)和第四时钟信号(CLK4)的低电平不交叠,所述第三时钟信号(CLK3)的相位超前于所述第一时钟信号(CLK1),所述第四时钟信号(CLK4)的相位超前于第二时钟信号(CLK2);

所述升压电路(1)包括第一传输模块(MN1)、第二传输模块(MN2)、第一延迟模块(11)、第二延迟模块(12)、第一预放电模块(MN3)和第二预放电模块(MN4);

所述第一传输模块(MN1)的输入端分别连接第一预放电模块(MN3)的输出端与第一延迟模块(11)的输出端,输出端连接第一时钟信号(CLK1);

所述第二传输模块(MN2)的输入端连接第二预放电模块(MN4)的输出端与第二延迟模块(12)的输出端,输出端连接第二时钟信号(CLK2);

所述第一预放电模块(MN3)的输入端连接抬高电平后的第三时钟信号(C)并能够在升压开始前关断第一传输模块(MN1);

所述第二预放电模块(MN4)的输入端连接抬高电平后的第四时钟信号(D)并能够在升压开始前关断第二传输模块(MN2);

所述第一延迟模块(11)能够在升压结束后延迟开启第一传输模块(MN1);

所述第二延迟模块(12)能够在升压结束后延迟开启第二传输模块(MN2)。

2.如权利要求1所述的交叉耦合电荷泵电路,其特征在于,所述第一延迟模块(11)包括第一电阻(R1)和第一电容(C1),所述第一电阻(R1)的一端连接第二传输模块(MN2)的输出端,另一端连接第一传输模块(MN1)的输入端,所述第一电容(C1)的一端连接第一传输模块(MN1)的输入端,另一端连接电源电压;

所述第二延迟模块(12)包括第二电阻(R2)和第二电容(C2),所述第二电阻(R2)的一端连接第一传输模块(MN1)的输出端,另一端连接第二传输模块(MN2)的输入端,所述第二电容(C2)的一端连接第二传输模块(MN2)的输入端,另一端连接电源电压。

3.如权利要求1所述的交叉耦合电荷泵电路,其特征在于,所述输出电路(2)包括第一PMOS管(MP1)和第二PMOS管(MP2);

所述第一PMOS管(MP1)的栅极连接第二时钟信号(CLK2),漏级连接第一时钟信号(CLK1);

所述第二PMOS管(MP2)的栅极连接第一时钟信号(CLK1),漏级连接第二时钟信号(CLK2);

所述第一PMOS管(MP1)的源极与所述第二PMOS管(MP2)的源极连接,作为输出电路(2)的输出端。

4.如权利要求3所述的交叉耦合电荷泵电路,其特征在于,所述输出电路(2)还包括二极管(D1)、负载电容(CL)和负载电流(IL),所述二极管(D1)的正极与负载电容(CL)的一端均连接电源电压,所述二极管(D1)的负极与负载电容(CL)的另一端连接所述第一PMOS管(MP1)的源极,所述负载电流(IL)的流入端连接所述第一PMOS管(MP1)的源极,流出端连接信号地。

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