[发明专利]多通道的延迟修正方法、装置、计算机设备有效
申请号: | 202211134433.7 | 申请日: | 2022-09-19 |
公开(公告)号: | CN115225775B | 公开(公告)日: | 2022-12-09 |
发明(设计)人: | 魏巍;金凯 | 申请(专利权)人: | 苏州华兴源创科技股份有限公司 |
主分类号: | H04N5/04 | 分类号: | H04N5/04;H04N5/262;H04N5/765;H04N17/00 |
代理公司: | 华进联合专利商标代理有限公司 44224 | 代理人: | 黄丽霞 |
地址: | 215000 江苏*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 通道 延迟 修正 方法 装置 计算机 设备 | ||
本公开涉及一种多通道的延迟修正方法、装置、计算机设备。应用于视频源,所述方法包括:针对传输通道中各传输节点,确定视频源或延迟传输节点为无延迟的起点;所述延迟传输节点包括:与视频源之间的延迟大于预设延迟阈值的传输节点;根据无延迟的起点以及与各传输节点之间的延迟,确定测试序列,所述测试序列用于确定传输节点的延迟情况;发送所述测试序列和视频数据至各传输节点,所述测试序列用于指示各传输节点进行延迟修正,所述延迟修正包括:利用测试序列中标记的位置信息和所述无延迟的起点,确定接收的视频数据中无效数据,并利用所述无效数据和视频数据确定有效视频数据并显示。采用本方法能够在纠正时延时减少额外信令消耗。
技术领域
本公开涉及数据传输技术领域,特别是涉及一种多通道的延迟修正方法、装置、计算机设备。
背景技术
目前,视频图像系统,尤其涉及带有VESA(Video Electronics StandardsAssociation,视频电子标准协会)的DisplayPort(DP,数字式视频接口标准)、MIPI(MobileIndustry Processor Interface,移动产业处理器接口标准)、HDMI(High DefinitionMultimedia Interface,高清多媒体接口标准)的视频图像处理系统,以驱动并显示液晶(LCD,Liquid Crystal Display)、有机发光二极管(OLED,Organic Light-EmittingDiode)等显示平板及终端,由于多通道中的数据传输机制的不同,会导致在不同的链路拓扑中产生大量的传输时延。
在传输视频之前会进行特殊的编码信令的同步,由于存在大量的传输时延,会给同步以及视频数据显示带来困难。当按照层级对所有节点和/或视频终端纠正传输时延时,需要对每一层级通过信令的方式来纠正时延。视频源对于一个节点和/或视频终端完成时延纠正至少需要一个信令的发送和接收,而对于大量的节点和/或视频终端,存在传输时延,因此在纠正时会增加额外的信令以及信令传输时的往返时延,进一步加大了纠正传输时延的难度。
发明内容
基于此,有必要针对上述技术问题,提供一种同步或者纠正时延时减少额外信令消耗,并且可以纠正传输时延的多通道的延迟修正方法、装置、计算机设备。
第一方面,本公开提供了一种多通道的延迟修正方法。应用于视频源。所述方法包括:
针对传输通道中各传输节点,确定视频源或延迟传输节点为无延迟的起点;所述延迟传输节点包括:与所述视频源之间的延迟大于预设延迟阈值的传输节点;
根据所述无延迟的起点以及与各传输节点之间的延迟,确定测试序列,所述测试序列用于确定传输节点的延迟情况;
发送所述测试序列和视频数据至各传输节点,所述测试序列用于指示各传输节点进行延迟修正,所述延迟修正包括:利用测试序列中标记的位置信息和所述无延迟的起点,确定接收的视频数据中无效数据,并利用所述无效数据和视频数据确定有效视频数据并显示。
在其中一个实施例中,所述测试序列包括:累积测试序列和重用测试序列,所述根据所述无延迟的起点以及与各传输节点之间的延迟,确定测试序列,包括:
测量与各传输节点之间的延迟;
根据所述延迟和所述无延迟的起点之间的关系,在所述无延迟的起点前后增加与所述延迟对应的延迟单位,得到累积测试序列;
和/或,根据预先确定的最大延迟确定所述重用测试序列的传输长度;
在所述传输长度范围内,在所述无延迟的起点前后均增加至少一个延迟单位,得到待处理测试序列;
在所述待处理测试序列中标记与所述延迟对应的延迟单位,得到所述重用测试序列。
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