[发明专利]一种多路视频高并发编解码系统在审

专利信息
申请号: 202211114011.3 申请日: 2022-09-14
公开(公告)号: CN115499665A 公开(公告)日: 2022-12-20
发明(设计)人: 李瑞;马龙飞;刘鹏博;罗鑫 申请(专利权)人: 北京睿芯高通量科技有限公司
主分类号: H04N19/42 分类号: H04N19/42;H04N21/236;H04N19/436
代理公司: 北京科龙寰宇知识产权代理有限责任公司 11139 代理人: 侯奇慧
地址: 102600 北京市大兴区北京经济技*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 视频 并发 解码 系统
【权利要求书】:

1.一种多路视频高并发编解码系统,其特征在于,包括:主机端和板卡端,主机端包括视频处理应用、板卡管理工具、视频处理接口、视频处理驱动以及主机端PCIe接口,板卡端包括视频处理单元、固件以及板卡端PCIe接口,

视频处理应用:启动时分析启动运行参数,当启动执行本地任务时,打开本地视频数据文件,当启动执行网络服务任务时,获取视频数据并通过视频处理接口调用视频处理驱动,视频数据通过主机端PCIe接口传输至板卡端,由固件调用视频处理单元,对视频数据进行加速处理;

板卡管理工具:用于系统状态查看、板卡固件升级、板卡维护和管理,板卡管理工具启动后,通过视频处理接口调用视频处理驱动,通过主机端PCIe接口与固件通信;

视频处理接口:为视频处理应用提供接口,用于实现多路视频负载均衡和防止板卡单点失效算法,调用视频处理驱动处理视频数据;

视频处理驱动:系统启动时,向视频处理单元发送初始化命令,为视频处理接口提供调用接口,将上层业务逻辑转化视频处理指令并通过主机端PCIe接口传输至板卡端,由固件执行系统指令或调用视频处理单元执行编解码指令;

主机端PCIe接口:通过PCIe总线协议与板卡端进行通信,传输控制指令以及进行数据信息交换;

视频处理单元:接收视频编解码指令并执行;

固件:启动时,对视频处理单元进行初始化,完成初始化后,接收、处理主机端的消息指令以及将板卡端的消息指令发送至主机端;

板卡端PCIe接口:通过PCIe总线协议与主机端进行通信,传输控制指令以及进行数据信息交换,

主机端与板卡端之间传输数据或信息时,接收方产生中断处理函数,将数据或信息生成消息指令并依据消息指令的级别将其放入消息指令队列,之后退出中断处理函数,

主机端将编码任务、解码任务和转码任务分别分解成编码消息指令处理流程、解码消息处理流程和转码消息处理流程,以分别进行处理,

板卡端实行消息指令驱动机制,为每一消息指令均设定优先级,消息指令的处理线程为循环机制,当消息指令队列为非空时,处理线程从消息指令队列中获取消息指令,处理线程采用非堵塞、非等待模式处理消息指令,板卡端将编解码任务切割为多个离散的消息指令并分别将其放入多路任务中,处理线程在多路任务中进行切换直至编解码任务执行完成。

2.根据权利要求1所述的多路视频高并发编解码系统,其特征在于,板卡端为多个。

3.根据权利要求1所述的多路视频高并发编解码系统,其特征在于,视频处理单元为视频编解码芯片。

4.根据权利要求1所述的多路视频高并发编解码系统,其特征在于,系统启动流程如下:

开始;

主机端系统启动;

板卡端PCIe接口、主机端PCIe接口上电;

固件下载;

固件启动;

视频处理单元初始化,启动消息处理循环;

主机端状态查询;

主机端更新板卡端状态;

结束。

5.根据权利要求1所述的多路视频高并发编解码系统,其特征在于,系统关闭流程如下:

开始;

主机端调用关闭系统指令;

通过板卡端PCIe接口、主机端PCIe接口传输关闭系统指令;

处理线程接收并处理关闭系统指令;

执行关闭系统指令;

主机端接收返回的指令执行结果;

主机端更新板卡端状态;

结束。

6.根据权利要求1所述的多路视频高并发编解码系统,其特征在于,编解码任务处理流程如下:

开始;

视频处理应用启动;

调用视频处理接口;

获取、分析、检验启动运行参数,如启动运行参数正确,则执行下一步,如启动运行参数不正确,则结束;

采用负载均衡、单点失效策略获取板卡,若找到则执行下一步,若未找到则结束;

转化消息指令流程消息;

调用视频处理驱动,通过主机端PCIe接口传输消息至板卡端;

固件对消息进行处理;

板卡端向主机端返回消息处理结果;

主机端分析处理结果,依据状态执行指令;

判断业务是否处理完毕,若完毕,则结束,若未完毕,则返回转化消息指令流程消息步骤继续处理。

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