[发明专利]信号处理装置及电子设备在审

专利信息
申请号: 202211048568.1 申请日: 2022-08-30
公开(公告)号: CN115396609A 公开(公告)日: 2022-11-25
发明(设计)人: 罗轶 申请(专利权)人: 维沃移动通信有限公司
主分类号: H04N5/353 分类号: H04N5/353;H04N5/3745;H04N5/378
代理公司: 北京国昊天诚知识产权代理有限公司 11315 代理人: 王思超
地址: 523863 *** 国省代码: 广东;44
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摘要:
搜索关键词: 信号 处理 装置 电子设备
【说明书】:

本申请公开一种信号处理装置及电子设备,属于图像处理技术领域。该信号处理装置连接于图像传感器,所述图像传感器包括呈阵列分布的多个像素,所述像素包括卷帘快门模块和全局快门模块中的至少一者;所述信号处理装置包括:数据选择模块、模数转换模块和数字信号处理模块;所述数据选择模块与所述像素连接,用于根据所述像素内的模块类型确定导通的通路,所述模块类型包括所述卷帘快门模块和所述全局快门模块;所述模数转换模块与所述数据选择模块连接,用于将所述卷帘快门模块和所述全局快门模块中的至少一者的输出信号并行转换为数字信号;所述数字信号处理模块与所述模数转换模块连接,用于对所述数字信号进行信号处理。

技术领域

本申请属于图像处理技术领域,具体涉及一种信号处理装置及电子设备。

背景技术

在互补金属氧化半导体(Complemerntary metal-oxide semiconductor,COMS)图像传感器(CMOS image sensor,CIS)中,像素曝光方式有两种:卷帘快门与全局快门。全局快门像素分为电荷域全局快门和电压域全局快门。

在相关技术中,CIS广泛采用卷帘快门,其采用的信号处理架构为行并列架构,在信号的读取处理时是一列一列读取处理。全局快门CIS的工作模式为一帧时间内所有像素整体重置-整体曝光-整体读取。若是一个图像传感器中既包括卷帘快门又包括全局快门,若是采用一列一列读取处理,这将拉长全局快门读取时间段在一帧时间内的占比,使得全局快门的效率较低,若是采用一帧时间内所有像素整体重置-整体曝光-整体读取,卷帘快门的信号则无法读取。

发明内容

本申请实施例提供一种信号处理装置及电子设备,能够解决现有技术中对于同时输出卷帘快门模块的输出信号与全局快门模块的输出信号的CIS,现有的信号处理无法处理或效率较低的问题。

第一方面,本申请实施例提供了一种信号处理装置,连接于图像传感器,所述图像传感器包括呈阵列分布的多个像素,所述像素包括卷帘快门模块和全局快门模块中的至少一者;所述信号处理装置包括:数据选择模块、模数转换模块和数字信号处理模块;

所述数据选择模块与所述像素连接,用于根据所述像素内的模块类型确定导通的通路,所述模块类型包括所述卷帘快门模块和所述全局快门模块;

所述模数转换模块与所述数据选择模块连接,用于将所述卷帘快门模块和所述全局快门模块中的至少一者的输出信号并行转换为数字信号;

所述数字信号处理模块与所述模数转换模块连接,用于对所述数字信号进行信号处理。

第二方面,本申请实施例提供了一种电子设备,包括第一方面所述的信号处理装置。

在本申请实施例公开了一种信号处理装置,可以连接于图像传感器,信号处理装置包括数据选择模块、模数转换模块和数字信号处理模块,数据选择模块与图像传感器的像素连接,用于根据像素内的模块类型确定导通的通路,门模块类型包括卷帘快门模块和全局快门模块,模数转换模块与数据选择模块连接,用于将卷帘快门模块和全局快门模块中的至少一者的输出信号并行转换为数字信号,数字信号处理模块与模数转换模块连接,用于对数据信号进行信号处理。本申请实施例通过将每个像素输出的卷帘快门模块的输出信号与全局快门模块的输出信号分别由独立的并行链路进行信号处理,实现了卷帘快门模块的输出信号和全局快门模块的输出信号的独立、同时处理输出,且互不干扰,可以降低噪音串扰,提高处理效率。

附图说明

图1是本申请的一个实施例提供的信号处理装置的结构框图;

图2是本申请的一个实施例提供的信号处理装置的一种详细结构框图;

图3是本申请的一个实施例提供的信号处理装置的另一种详细结构框图;

图4是本申请的一个实施例提供的信号处理装置的一种电路示意图。

具体实施方式

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