[发明专利]像素电路、像素电路驱动方法及显示装置有效

专利信息
申请号: 202210694793.6 申请日: 2022-06-17
公开(公告)号: CN115050321B 公开(公告)日: 2023-06-09
发明(设计)人: 周仁杰;郑浩旋 申请(专利权)人: 绵阳惠科光电科技有限公司;惠科股份有限公司
主分类号: G09G3/3208 分类号: G09G3/3208
代理公司: 深圳市联鼎知识产权代理有限公司 44232 代理人: 金云嵋
地址: 621000 四川*** 国省代码: 四川;51
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摘要:
搜索关键词: 像素 电路 驱动 方法 显示装置
【权利要求书】:

1.一种像素电路,包括发光电路,其特征在于,所述像素电路还包括电压比较器、与门电路及第一开关元件,其中,

所述电压比较器的第一输入端连接用于提供参考信号的参考线,第二输入端连接用于提供总电源信号的总电源线,所述电压比较器的输出端与所述与门电路的第一输入端连接;

所述与门电路的第二输入端连接用于提供数据信号的数据线;

所述第一开关元件用于响应所述与门电路的输出端的输出信号,以将所述发光电路的发光路径导通。

2.根据权利要求1所述的像素电路,其特征在于,所述发光电路包括第二开关元件、驱动晶体管、电容结构及发光元件,其中,

所述第二开关元件用于响应由扫描信号线提供的扫描信号,以将所述数据线与所述驱动晶体管的控制端连接;

所述电容结构的第一端与所述驱动晶体管的控制端连接,所述电容结构的第二端与所述发光元件的第一端连接;

所述第一开关元件用于响应所述与门电路的输出端的输出信号,以将所述驱动晶体管的第二端和所述发光元件的第二端连接;

所述驱动晶体管的第一端连接第一电源信号端,所述发光元件的第一端连接第二电源信号端。

3.根据权利要求2所述的像素电路,其特征在于,所述像素电路还包括第三开关元件和第四开关元件,其中,

所述第三开关元件用于响应所述与门电路的输出端的输出信号,以将用于提供栅极高电平信号的栅极高电平线与所述第一开关元件的控制端连接;

所述第四开关元件用于响应所述电压比较器的输出端的输出信号,以将所述栅极高电平线与所述扫描信号线连接。

4.根据权利要求2或3所述的像素电路,其特征在于,所述像素电路还包括编码器,所述编码器的输入端连接所述数据线,所述编码器的输出端连接所述与门电路的第二输入端。

5.根据权利要求3所述的像素电路,其特征在于,所述第一开关元件至第四开关元件分别对应包括第一晶体管至第四晶体管,其中,

所述第一晶体管的第一端连接所述驱动晶体管的第二端,所述第一晶体管的第二端连接所述发光元件的第二端;

所述第二晶体管的控制端还连接提供所述扫描信号的扫描信号线,所述第二晶体管的第一端连接所述数据线,所述第二晶体管的第二端连接所述电容结构的第一端及所述驱动晶体管的控制端;

所述第三晶体管的控制端连接所述与门电路的输出端,所述第二晶体管的第一端连接所述栅极高电平线,所述第二晶体管的第二端连接下拉电阻的第一端及所述第一晶体管的控制端,所述下拉电阻的第二端连接所述第二电源信号端;

所述第四晶体管的控制端连接所述电压比较器的输出端,所述第四晶体管的第一端连接所述扫描信号线,所述第四晶体管的第二端连接所述栅极高电平线。

6.根据权利要求5所述的像素电路,其特征在于,所述驱动晶体管、第一晶体管、第二晶体管及第三晶体管均为N型薄膜晶体管,所述第四晶体管为P型薄膜晶体管;其中,

所述第一电源信号端提供的第一电源信号为直流高电平信号,且所述第一电源信号由所述总电源信号提供,所述第二电源信号端提供的第二电源信号为直流低电平信号。

7.根据权利要求5所述的像素电路,其特征在于,所述发光元件为有机发光二极管,所述有机发光二极管的阳极连接所述第一晶体管的第二端,所述有机发光二极管的阴极连接所述第二电源信号端。

8.一种像素电路驱动方法,用于驱动如权利要求1所述的像素电路,其特征在于,所述像素驱动方法包括:

在开机阶段,利用所述总电源信号使所述第一开关元件关闭;

在关机阶段,利用所述总电源信号使所述第一开关元件关闭。

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