[发明专利]处理方法及装置、处理器、电子设备及存储介质在审
申请号: | 202210307601.1 | 申请日: | 2021-05-08 |
公开(公告)号: | CN114661442A | 公开(公告)日: | 2022-06-24 |
发明(设计)人: | 马凌 | 申请(专利权)人: | 支付宝(杭州)信息技术有限公司 |
主分类号: | G06F9/48 | 分类号: | G06F9/48;G06F9/50 |
代理公司: | 北京博思佳知识产权代理有限公司 11415 | 代理人: | 魏文君 |
地址: | 310000 浙江省杭州市*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 处理 方法 装置 处理器 电子设备 存储 介质 | ||
本说明书一个或多个实施例提供一种处理方法,包括:在执行第一协程时,对执行过程中的待取对象确定是否存储在目标缓存中;若确定所述待取对象未存储在所述目标缓存中,对所述待取对象进行预取,并将当前执行的所述第一协程切换到第二协程。本说明书实施例提供的处理方法,可以提升CPU的吞吐能力。
本申请是申请日为2021年5月8日、申请号为202110497973.0、发明创造名称为“处理方法及装置、处理器、电子设备及存储介质”的分案申请。
技术领域
本说明书一个或多个实施例涉及计算机技术领域,尤其涉及一种处理方法及装置、处理器、电子设备及计算机可读存储介质。
背景技术
CPU的基本工作是执行存储的指令序列,即程序。程序的执行过程即CPU不断重复取指令、解码指令、执行指令的过程。CPU在获取指令或者获取需要的数据时,首先会访问缓存,若缓存中未存储有要获取的指令或数据,CPU则会访问内存,从内存获取需要的指令或数据。由于内存的读写速度远远低于缓存的读写速度,因此当缓存中未存储有CPU所需的指令或数据时,CPU需要花费大量的时间从内存中获取指令或数据,导致CPU的吞吐能力下降。
发明内容
有鉴于此,本说明书一个或多个实施例提供了一种处理方法及装置、处理器、电子设备及计算机可读存储介质,目的是为了提升处理器的吞吐能力。
为实现上述目的,本说明书一个或多个实施例提供技术方案如下:
根据本说明书一个或多个实施例的第一方面,提出了一种处理方法,包括:
在执行第一协程时,对执行过程中的待取对象确定是否存储在目标缓存中;
若确定所述待取对象未存储在所述目标缓存中,对所述待取对象进行预取,并将当前执行的所述第一协程切换到第二协程。
根据本说明书一个或多个实施例的第二方面,提出了一种处理装置,包括:
确定模块,用于在执行第一协程时,对执行过程中的待取对象确定是否存储在目标缓存中;
切换模块,用于若确定所述待取对象未存储在所述目标缓存中,对所述待取对象进行预取,并将当前执行的所述第一协程切换到第二协程。
根据本说明书一个或多个实施例的第三方面,提出了一种处理器,所述处理器在执行存储器存储的可执行指令时,实现本说明书实施例提供的任一种处理方法。
根据本说明书一个或多个实施例的第四方面,提出了一种电子设备,包括:
处理器;
用于存储处理器可执行指令的存储器;
其中,所述处理器通过运行所述可执行指令以实现本说明书实施例提供的任一种处理方法。
根据本说明书一个或多个实施例的第四方面,提出了一种计算机可读存储介质,其上存储有计算机指令,该指令被处理器执行时实现本说明书实施例提供的任一种处理方法。
本说明书实施例提供的处理方法,CPU可以在确定待取对象未存储在目标缓存时不作任何的等待,而是对待取对象进行预取,并立刻切换至第二协程,对第二协程的指令进行处理。由于待取对象的预取和CPU处理第二协程的指令是并行的,因此最大幅度的提升了CPU的吞吐能力。
附图说明
图1是本说明书实施例提供的处理方法的第一流程图。
图2是本说明书实施例提供的处理方法的第二流程图。
图3是本说明书实施例提供的处理方法的第三流程图。
图4是本说明书实施例提供的协程链的示意图。
图5是本说明书实施例提供的处理装置的结构示意图。
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