[发明专利]显示装置的数据处理方法、装置、设备、系统及介质在审

专利信息
申请号: 202111110667.3 申请日: 2021-09-18
公开(公告)号: CN115842940A 公开(公告)日: 2023-03-24
发明(设计)人: 马希通 申请(专利权)人: 京东方科技集团股份有限公司
主分类号: H04N21/44 分类号: H04N21/44;H04N21/4402
代理公司: 北京志霖恒远知识产权代理有限公司 11435 代理人: 郭栋梁
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 显示装置 数据处理 方法 装置 设备 系统 介质
【说明书】:

本申请公开了一种显示装置的数据处理方法、装置、设备、系统及介质,该方法包括:接收视频信号;以第一数据延迟模式处理所述视频信号;其中,所述以第一数据延迟模式处理视频信号,包括:根据所述视频信号的源端时序信号将所述视频信号写入内存;根据第一输出端时序信号,从所述内存中读取所述视频信号并发送至显示面板;对于同一帧视频信号,所述第一输出端时序信号相对于所述源端时序信号具有第一延迟时间,所述第一延迟时间小于一帧视频信号的时钟周期的时间。该方案能够将输出端时序信号相对于源端时序信号的第一延迟时间控制为小于一帧视频信号的时钟周期的时间,有效降低图像在FPGA端的书写延迟,进一步提高了用户体验。

技术领域

发明一般涉及信息处理技术领域,具体涉及一种显示装置的数据处理方法、装置、设备、系统及介质。

背景技术

随着互联网信息技术的不断发展,远程办公需求激增,对电子白板的需求也大量增加。电子白板是汇集了尖端电子技术、软件技术等多种高科技手段研发的高新技术产品,它通过应用电磁感应原理,结合计算机和投影机,可以实现无纸化办公及教学等多种功能。其中,在使用基于系统级芯片(System On Chip,SOC)和现场可编程门阵列(Field-Programmable Gate Array,FPGA)的电子白板的过程中会出现书写延迟,其书写延迟主要体现在图像在SOC端的延迟以及图像在FPGA端的延迟。

目前,相关技术中图像在FPGA端的处理方式是通过输入一帧图像至内存后才能从内存中读取以输出该帧图像,该方案使得输出端时序延迟输入一帧图像输出,即输入和输出不会在同一帧的地址空间进行操作,从而致使书写定位延迟大,导致用户体验差。

发明内容

鉴于现有技术中的上述缺陷或不足,期望提供一种显示装置的数据处理方法、装置、设备、系统及介质。

第一方面,本申请实施例提供了一种显示装置的数据处理方法,该方法包括:

接收视频信号;

以第一数据延迟模式处理所述视频信号;

其中,以第一数据延迟模式处理视频信号,包括:

根据视频信号的源端时序信号将视频信号写入内存;

根据第一输出端时序信号,从内存中读取视频信号并发送至显示面板;

其中,对于同一帧视频信号,第一输出端时序信号相对于源端时序信号具有第一延迟时间,第一延迟时间小于一帧视频信号的时钟周期的时间。

第二方面,本申请提供了一种显示装置的数据处理装置,该装置包括:

接收模块,用于接收视频信号;

处理模块,用于以第一数据延迟模式处理所述视频信号;

其中,处理模块,包括:

写入单元,用于根据视频信号的源端时序信号将视频信号写入内存;

读取单元,用于根据第一输出端时序信号,从内存中读取视频信号并发送至显示面板;

其中,对于同一帧视频数据,第一输出端时序信号相对于源端时序信号具有第一延迟时间,第一延迟时间小于一帧视频信号的时钟周期的时间。

第三方面,本申请实施例提供一种电子设备,包含处理器和存储器,该处理器用于执行如上述第一方面的显示装置的数据处理方法。

第四方面,本申请实施例提供一种显示装置的数据处理系统,该系统包括第一处理器、第二处理器和显示面板,第一处理器分别与第二处理器、显示面板连接;

第二处理器用于向第一处理器发送视频信号;

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