[发明专利]一种基于5G网络的配网自动毫秒级低时延设备有效
申请号: | 202110702522.6 | 申请日: | 2021-06-24 |
公开(公告)号: | CN113395083B | 公开(公告)日: | 2022-12-16 |
发明(设计)人: | 赵炜;聂盛阳;李英敏;樊会丛;季名扬;王旭蕊;崔俊彬;王敬;张志钦;穆春宇;赵津;刘辛彤;陈明;魏勇;成思远 | 申请(专利权)人: | 国网河北省电力公司信息通信分公司;国家电网有限公司 |
主分类号: | H04B1/40 | 分类号: | H04B1/40;H04W24/02 |
代理公司: | 北京华际知识产权代理有限公司 11676 | 代理人: | 陈健阳 |
地址: | 050000 河北*** | 国省代码: | 河北;13 |
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摘要: | |||
搜索关键词: | 一种 基于 网络 自动 毫秒 级低时延 设备 | ||
本发明属于技术领域,具体涉及一种基于5G网络的配网自动毫秒级低时延设备,通过“高频谱”通过“单载波频SC‑FDMA”获取“多址频谱”,同时通过“LTE”传输“调度单元TTI”,通过“LTE”采用“NodeB”单层结构可有效提高稳定性,并通过发射终端发射“SC‑FDMA”信号,并进行短时动态“调度单元TTI”分配,可有效引入小于等于“1ms”的“调度单元TTI”,并通过“URLLC”进行传输,通过设置设备外壳体的上侧前表面设置的正交频OFDM连接端口和核心网UTRAN连接端口进行数据的连接,通过调度分配进而缩减“调度单元TTI”降低“LTE”时延时间,进而有效实现低延迟的效果。
技术领域
本发明属于技术领域,具体涉及一种基于5G网络的配网自动毫秒级低时延设备。
背景技术
5G网络毫秒级研究还处于初期理论研究阶段,虽然引入更短传输时隙,为低时延高可靠业务的传输质量保障奠定了基础,但是在资源利用率多业务兼容可扩展性等方面存在一些不足。因此对电力业务特征及应用场景进行优化,保障关键业务的服务质量。
但是现有的5G网络在配网的过程中会出现延时,进而会影响在应用过程中设备的运作精度,这就需要一种5G网络的配网自动毫秒级低时延方法进行对时延进行优化。
发明内容
本发明的目的在于提供一种基于5G网络的配网自动毫秒级低时延设备,以解决上述背景技术中提出的问题。
为实现上述目的,本发明提供如下技术方案:一种基于5G网络的配网自动毫秒级低时延设备,包括5G网络的配网自动毫秒级低时延方法和5G网络的配网自动毫秒级低时延设备,在所述5G网络的配网自动毫秒级低时延方法中,(i)将“无线网络OFDMA”通过接线端口接入到“核心网UTRAN”进行演进构建高速率,并将高速率的网络信号通过“正交频OFDM”对抗无线传输环境中的频率选择性衰落,获得“高频谱”,(ii)将所述“高频谱”通过“单载波频SC-FDMA”获取“多址频谱”,同时通过“LTE”传输“调度单元TTI”,并定义为“1ms”,并进行短时动态“调度单元TTI”分配,引入小于等于“1ms”的“调度单元TTI”,并通过“URLLC”进行传输,通过调度分配进而缩减“调度单元TTI”降低“LTE”时延时间,(iii)将低时延的“LTE”分码接入到“CDMA多址接入端口”并通过“UMTS”进行发射器和接受器的反射,进而获取调频低周期的的“OFDMA”。
作为一种优选的实施方式,所述“LTE”采用“NodeB”单层结构,并通过发射终端发射“SC-FDMA”信号。
作为一种优选的实施方式,所述“OFDMA”通过多载波“(MC)-WCDMA”“MC-TD-SCDMA”进行正交频“(DFT-SOFDM)”扩展。
作为一种优选的实施方式,所述“(DFT-SOFDM)”通过“正交振幅调制QAM”,并在16QAM和64QAM中,子载波分别发送4和6位。
作为一种优选的实施方式,所述“OFDMA”调制后,信号向量DMA=F*K*T*N,SD,其中TN,S代表子载波的映射矩阵,元素是表达子载波的分布式,F*K是K点IFFT矩阵。
一种基于5G网络的配网差动毫秒级低时延设备,还包括所述5G网络的配网自动毫秒级低时延设备包括设备外壳体,所述设备外壳体的内表面设置有低时延电路板,所述低时延电路板上设置有低时延端口组件,所述低时延端口组件包括正交频OFDM连接端口、核心网UTRAN连接端口、URLLC数据输出端,所述设备外壳体的上侧前表面设置有所述正交频OFDM连接端口,所述设备外壳体的下侧前表面设置核心网UTRAN连接端口,所述所述设备外壳体的后表面设置URLLC数据输出端,所述低时延电路板的前表面设置有单载波频器,所述单载波频器与低延时调度器电路连接,所述低时延电路板的前表面电路连接有高频谱器,所述高频谱器与QAM振幅调制器电路连接。
作为一种优选的实施方式,所述正交频OFDM连接端口和所述核心网UTRAN连接端口以及所述URLLC数据输出端均与低时延电路板电路连接。
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