[发明专利]并机地址识别系统及机柜有效
申请号: | 202110547408.0 | 申请日: | 2021-05-19 |
公开(公告)号: | CN113301181B | 公开(公告)日: | 2023-08-22 |
发明(设计)人: | 赖熙庭;牛兴卓;孙宗昌;郭震达;丘佳威 | 申请(专利权)人: | 漳州科华技术有限责任公司;科华数据股份有限公司 |
主分类号: | H04L61/5038 | 分类号: | H04L61/5038 |
代理公司: | 河北国维致远知识产权代理有限公司 13137 | 代理人: | 秦敏华 |
地址: | 363005 福*** | 国省代码: | 福建;35 |
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摘要: | |||
搜索关键词: | 地址 识别 系统 机柜 | ||
1.一种并机地址识别系统,其特征在于,包括地址波形生成模块和隔离模块;所述隔离模块与所述地址波形生成模块连接;
所述地址波形生成模块设置于机柜上,所述机柜包括至少两个容置槽,所述容置槽用于放置设备模块;
所述隔离模块和所述容置槽一一对应;
所述隔离模块用于与对应的容置槽内放置的设备模块连接;
所述地址波形生成模块用于生成各个容置槽分别对应的地址波形,并把各个容置槽分别对应的地址波形通过对应的隔离模块发送至对应的容置槽内放置的设备模块;
所述设备模块用于根据接收到的地址波形识别自身的地址。
2.根据权利要求1所述的并机地址识别系统,其特征在于,所述地址波形生成模块包括第一拨码开关和第一微处理器;
所述第一拨码开关、所述第一微处理器和所述容置槽一一对应;
所述第一微处理器分别与对应的第一拨码开关和对应的隔离模块连接;
所述第一拨码开关用于获取用户输入的拨码信号,并把所述用户输入的拨码信号发送至对应的第一微处理器;
所述第一微处理器用于根据所述用户输入的拨码信号生成地址波形,并把所述地址波形通过对应的隔离模块发送至对应的容置槽内放置的设备模块。
3.根据权利要求2所述的并机地址识别系统,其特征在于,所述第一微处理器还用于根据预设的拨码信号和频率的对应关系,生成频率为所述用户输入的拨码信号对应的频率的地址波形;
所述设备模块还用于确定接收到的地址波形的频率,并根据预设的频率和地址的对应关系,确定所述接收到的地址波形的频率对应的地址,并将该地址作为自身的地址。
4.根据权利要求2所述的并机地址识别系统,其特征在于,所述第一微处理器还用于根据预设的拨码信号和波头数的对应关系,生成波头数为所述用户输入的拨码信号对应的波头数的地址波形;
所述设备模块还用于确定接收到的地址波形的波头数,并根据预设的波头数和地址的对应关系,确定所述接收到的地址波形的波头数对应的地址,并将该地址作为自身的地址。
5.根据权利要求2所述的并机地址识别系统,其特征在于,所述第一拨码开关和对应的第一微处理器设置于对应的容置槽对应的后板位置处;或,
所有第一拨码开关和所有第一微处理器集中设置于所述机柜的后板上。
6.根据权利要求1所述的并机地址识别系统,其特征在于,所述地址波形生成模块包括至少一个集中地址板和第二微处理器,所述集中地址板和所述第二微处理器一一对应连接;
所述第二微处理器与至少两个隔离模块连接;
所述集中地址板用于生成至少两个地址信号,并把所述至少两个地址信号发送至对应的第二微处理器;
所述第二微处理器用于根据接收到的至少两个地址信号生成对应数量的地址波形,并将各个地址波形通过对应的隔离模块发送至对应的容置槽内放置的设备模块,其中,与该第二微处理器连接的隔离模块的数量和该第二微处理器生成的地址波形的数量相同。
7.根据权利要求6所述的并机地址识别系统,其特征在于,所述集中地址板和所述第二微处理器的数量均为1个,所述第二微处理器与所有的隔离模块均连接;或,
所述集中地址板和所述第二微处理器的数量均为至少两个,与各个第二微处理器连接的隔离模块的数量之和为所有隔离模块的数量;
其中,当所述集中地址板的数量为至少两个时,所述地址波形生成模块还包括与集中地址板一一对应连接的第二拨码开关;
所述第二拨码开关用于获取用户输入的拨码信号,并把所述用户输入的拨码信号发送至对应的集中地址板;
所述集中地址板还用于根据接收到的拨码信号生成至少两个地址信号。
8.根据权利要求6所述的并机地址识别系统,其特征在于,所述集中地址板和对应的第二微处理器设置于任意一个对应的容置槽对应的后板位置处;或,
所有集中地址板和所有第二微处理器集中设置于所述机柜的后板上。
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