[发明专利]数据驱动装置和数据驱动系统在审
申请号: | 202110450148.5 | 申请日: | 2021-04-25 |
公开(公告)号: | CN113570991A | 公开(公告)日: | 2021-10-29 |
发明(设计)人: | 金道锡;文龙焕;金洺猷;曹贤杓 | 申请(专利权)人: | 硅工厂股份有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20 |
代理公司: | 北京林达刘知识产权代理事务所(普通合伙) 11277 | 代理人: | 刘新宇 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 数据 驱动 装置 系统 | ||
1.一种数据驱动装置,包括:
通信电路,其包括均衡器,并且其被配置为接收包含用于配置所述均衡器的多个EQ配置信息的第一数据信号,然后在多个时间区间期间接收EQ训练信号,其中EQ是均衡器;以及
控制电路,其被配置为通过根据各个EQ配置信息在每个时间区间中改变所述均衡器的配置,来评估所述多个时间区间中的各个时间区间中所述通信电路的针对所述EQ训练信号的接收性能,并且根据评估结果选择最优EQ配置信息。
2.根据权利要求1所述的数据驱动装置,其中,所述第一数据信号还包括与EQ配置信息的数量有关的信息,并且所述控制电路通过与EQ配置信息的数量有关的信息来识别时间区间的数量。
3.根据权利要求1所述的数据驱动装置,其中,所述通信电路通过低速数据通信协议接收第一数据信号,并且通过与所述低速数据通信协议不同的高速数据通信协议接收所述EQ训练信号。
4.根据权利要求1所述的数据驱动装置,其中,所述EQ训练信号包括在每个时间区间中重复的训练序列,并且所述训练序列包括用于将各时间区间彼此区分开的空白信号、设置在所述空白信号的末尾处的EQ时钟训练信号、以及设置在所述EQ时钟训练信号的末尾处的EQ测试信号。
5.根据权利要求4所述的数据驱动装置,其中,在一个训练序列的空白信号接收区间中,所述通信电路对在所述一个训练序列之前的训练序列中训练的时钟进行初始化,并且在所述一个训练序列的EQ时钟训练信号接收区间中,所述通信电路再次执行时钟训练。
6.根据权利要求5所述的数据驱动装置,其中,所述第一数据信号和所述EQ训练信号是从数据处理装置发送来的,并且在对时钟进行初始化和再次执行时钟训练时,将从所述数据驱动装置发送到所述数据处理装置的锁定信号的电平维持为恒定。
7.根据权利要求4所述的数据驱动装置,其中,所述EQ测试信号包括PRBS模式,而且所述控制电路计算针对各个时间区间中的PRBS模式的误比特率,并且选择与所述多个时间区间中的具有最小误比特率的时间区间相对应的EQ配置信息作为最优EQ配置信息,其中PRBS是伪随机二进制序列。
8.根据权利要求4所述的数据驱动装置,其中,所述EQ测试信号包括以DC平衡码方法所编码的测试数据,而且所述控制电路检查各个时间区间中的测试数据中是否存在任何错误,并且选择与所述多个时间区间中的在测试数据中具有最小数量的错误的时间区间相对应的EQ配置信息作为最优EQ配置信息。
9.根据权利要求4所述的数据驱动装置,其中,在所述通信电路接收到所述空白信号时,所述控制电路改变所述均衡器的配置。
10.根据权利要求4所述的数据驱动装置,其中,在预定时间或更长时间期间接收到具有预定电压电平的信号的情况下,所述通信电路对时钟进行初始化并且在预定时间期间将所述空白信号维持在恒定电压电平。
11.一种数据驱动装置,包括:
通信电路,其包括均衡器,并且其被配置为接收第一数据信号,然后接收EQ训练信号,所述第一数据信号包含用于配置所述均衡器的多个EQ配置信息,所述EQ训练信号包括具有预定电平的空白信号、设置在所述空白信号的末尾处的EQ时钟训练信号、以及设置在所述EQ时钟训练信号的末尾处的EQ测试信号,其中EQ是均衡器;以及
控制电路,其被配置为在所述通信电路接收到所述EQ测试信号时将所述EQ测试信号的接收时间分割为多个时间区间,通过根据各个EQ配置信息在各个时间区间中改变所述均衡器的配置来评估所述多个时间区间中的各个时间区间中所述通信电路的针对所述EQ训练信号的接收性能,并且根据评估结果选择最优EQ配置信息。
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