[发明专利]均衡器和使用其的通信模块在审
申请号: | 202110263748.0 | 申请日: | 2021-03-11 |
公开(公告)号: | CN113452632A | 公开(公告)日: | 2021-09-28 |
发明(设计)人: | 石井俊雄 | 申请(专利权)人: | 富士通光器件株式会社 |
主分类号: | H04L25/03 | 分类号: | H04L25/03 |
代理公司: | 北京三友知识产权代理有限公司 11127 | 代理人: | 刘久亮;黄纶伟 |
地址: | 日本神*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 均衡器 使用 通信 模块 | ||
1.一种均衡器,该均衡器包括:
第一抽头延迟线,在所述第一抽头延迟线中N个抽头级联连接,其中,N是正整数;
第二抽头延迟线,所述第二抽头延迟线与所述第一抽头延迟线并联连接,所述第二抽头延迟线具有一个抽头;
第一乘法器,所述第一乘法器用于将从所述N个抽头提取的信号乘以对应的系数;
第二乘法器,所述第二乘法器用于将从所述第二抽头延迟线输出的信号乘以第二系数;以及
加法器,所述加法器用于将所述第一乘法器的乘积与所述第二乘法器的乘积相加,
其中,所述第一抽头延迟线具有固定延迟,并且所述第二抽头延迟线具有能够以所述固定延迟的1/M分辨率改变的可变延迟,其中,M是大于1的数。
2.根据权利要求1所述的均衡器,其中,所述可变延迟表示为
τ×(L+1/M)
其中,τ是在所述N个抽头的任何两个相邻抽头之间设置的所述固定延迟,并且L是大于或等于零的整数。
3.根据权利要求1所述的均衡器,该均衡器还包括:
N个开关,所述N个开关连接在所述第二抽头延迟线与所述N个抽头之间,
其中,所述N个开关中的任何一个是可选择的。
4.根据权利要求3所述的均衡器,其中,所述可变延迟根据所选的开关从τ/M到(N-1)×τ+τ/M不等。
5.根据权利要求1所述的均衡器,其中,所述第二乘法器连接到所述可变延迟的输出。
6.根据权利要求1所述的均衡器,其中,所述第一乘法器包括分别连接到所述N个抽头的N个乘法器。
7.一种通信模块,该通信模块包括:
数字信号处理器,所述数字信号处理器具有均衡器;以及
组件或部件,所述组件或所述部件连接到所述数字信号处理器,
其中,所述均衡器包括:
第一抽头延迟线,在所述第一抽头延迟线中N个抽头级联连接,其中,N是正整数,
第二抽头延迟线,所述第二抽头延迟线与所述第一抽头延迟线并联连接,所述第二抽头延迟线具有一个抽头,
第一乘法器,所述第一乘法器用于将从所述N个抽头提取的信号乘以对应的系数,
第二乘法器,所述第二乘法器用于将从所述第二抽头延迟线输出的信号乘以第二系数,以及
加法器,所述加法器用于将所述第一乘法器的乘积与所述第二乘法器的乘积相加,
其中,所述第一抽头延迟线具有固定延迟,并且所述第二抽头延迟线具有能够以所述固定延迟的1/M分辨率改变的可变延迟,其中,M是大于1的数,并且
其中,所述可变延迟的值根据在所述数字信号处理器与所述组件或所述部件之间生成的反射来确定。
8.根据权利要求7所述的通信模块,
其中,所述组件或所述部件是调制器驱动器或光学调制器,并且
其中,所述可变延迟的值根据所述数字信号处理器和所述调制器驱动器之间的传输延迟时间或所述调制器驱动器和所述光学调制器之间的传输延迟时间来确定。
9.根据权利要求7所述的通信模块,
其中,所述组件或所述部件是光电电路,并且
其中,所述可变延迟的值根据所述数字信号处理器与所述光电电路之间的传输延迟时间来确定。
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