[发明专利]阵列基板、显示面板及显示装置有效
申请号: | 202110206169.2 | 申请日: | 2021-02-24 |
公开(公告)号: | CN113160742B | 公开(公告)日: | 2022-10-04 |
发明(设计)人: | 冯宏庆;李洪瑞;曾祥韬;秦韶阳;赵成雨;王守坤 | 申请(专利权)人: | 合肥维信诺科技有限公司 |
主分类号: | G09G3/3208 | 分类号: | G09G3/3208;G09G3/3225;H01L27/32 |
代理公司: | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人: | 娜拉 |
地址: | 230037 安徽省合*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 阵列 显示 面板 显示装置 | ||
1.一种阵列基板,其特征在于,具有孔区和显示区,所述显示区包括绕线显示区和主显示区,所述绕线显示区位于所述孔区和所述主显示区之间,且所述绕线显示区围绕所述孔区;
所述阵列基板包括:
第一像素电路,多个所述第一像素电路阵列分布于所述绕线显示区;
第二像素电路,多个所述第二像素电路阵列分布于所述主显示区;
多条第一信号线,各所述第一信号线与所述第一像素电路及所述第二像素电路电连接且沿第一方向延伸,多条所述第一信号线包括多条第一类信号线和多条第二类信号线,各所述第二类信号线包括被所述孔区分隔的第一段和第二段;
多条第一连接信号线,多条所述第一连接信号线中的至少部分位于所述绕线显示区,所述第一连接信号线包括相互连接的第一连接段、第二连接段和第三连接段,所述第一连接段与所述第一段电连接,所述第三连接段与所述第二段电连接,所述第二连接段连接在所述第一连接段与所述第三连接段之间,所述第一连接段和所述第三连接段均沿第二方向延伸,所述第二连接段沿所述第一方向延伸;
其中,所述第一像素电路在所述阵列基板所在平面上的正投影面积小于所述第二像素电路在所述阵列基板所在平面上的正投影面积,且所述第一连接信号线在所述阵列基板所在平面上的正投影与所述第一像素电路在所述阵列基板所在平面上的正投影无交叠;
所述孔区在所述第二方向上具有中心线,所述第二类信号线与所述中心线在所述第二方向上的垂直距离的越小,所述第二类信号线电连接的所述第二连接段与所述中心线在所述第二方向上的垂直距离的越小,且所述第二类信号线与所述中心线在所述第二方向上的垂直距离的越小,所述第二类信号线电连接的所述第一连接段及所述第三连接段与所述孔区在所述第一方向上的垂直距离的越大;
所述孔区同一侧的相邻所述第二连接段之间间隔的沿所述第二方向排布的所述第一像素电路的数量相等,且相邻所述第一连接段之间间隔的沿所述第一方向排布的所述第一像素电路的数量与相邻所述第三连接段之间间隔的沿所述第一方向排布的所述第一像素电路的数量相等;
所述孔区同一侧的相邻所述第二连接段之间间隔的沿所述第二方向排布的所述第一像素电路的数量,等于相邻所述第一连接段之间间隔的沿所述第一方向排布的所述第一像素电路的数量的两倍。
2.根据权利要求1所述的阵列基板,其特征在于,所述第一像素电路的电路结构与所述第二像素电路的电路结构相同,且所述第一像素电路及所述第二像素电路均包括晶体管,所述第一像素电路中至少一个晶体管的尺寸小于所述第二像素电路中相同连接位置的晶体管的尺寸。
3.根据权利要求2所述的阵列基板,其特征在于,所述绕线显示区内的所述第一信号线的线宽小于所述主显示区内的所述第一信号线的线宽,所述绕线显示区内的相邻所述第一信号线的线间距小于所述主显示区内的相邻所述第一信号线的线间距。
4.根据权利要求1所述的阵列基板,其特征在于,相邻所述第二连接段之间间隔的沿所述第二方向排布的多个所述第一像素电路紧邻设置。
5.根据权利要求1所述的阵列基板,其特征在于,所述第二连接段与所述第一信号线设置为同层且同材质,且所述第一连接段及所述第三连接段与所述第一信号线位于不同膜层;
或者,所述第一连接段、所述第二连接段及所述第三连接段均与所述第一信号线位于不同膜层,且所述第一连接段、所述第二连接段及所述第三连接段位于同一膜层。
6.根据权利要求1至5任一项所述的阵列基板,其特征在于,所述第一方向为列方向,所述第二方向为行方向,所述第一信号线为数据信号线,或者,所述第一方向为行方向,所述第二方向为列方向,所述第一信号线为扫描信号线或发光控制信号线或参考电压信号线。
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