[发明专利]掩模坯料、转印用掩模、及半导体器件的制造方法在审
| 申请号: | 202011344580.8 | 申请日: | 2020-11-26 |
| 公开(公告)号: | CN112946996A | 公开(公告)日: | 2021-06-11 |
| 发明(设计)人: | 桥本雅广 | 申请(专利权)人: | HOYA株式会社 |
| 主分类号: | G03F1/50 | 分类号: | G03F1/50 |
| 代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 沈雪 |
| 地址: | 日本*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 坯料 转印用掩模 半导体器件 制造 方法 | ||
1.一种掩模坯料,其具备基板和位于基板上的图案形成用薄膜,
所述薄膜由含有铬的材料形成,
所述薄膜由与基板侧相反侧的上部区域、和除该上部区域以外的区域构成,
所述上部区域的结晶尺寸比除所述上部区域以外的区域的结晶尺寸大。
2.根据权利要求1所述的掩模坯料,其中,
所述薄膜的上部区域和除上部区域以外的区域均为多晶结构。
3.根据权利要求1或2所述的掩模坯料,其中,
利用电子衍射法获得的所述薄膜的上部区域和除上部区域以外的区域的各晶面间距均为0.2nm以上。
4.根据权利要求1或2所述的掩模坯料,其中,
所述薄膜的上部区域和除上部区域以外的区域均具有柱状结构。
5.根据权利要求1或2所述的掩模坯料,其中,所述薄膜的除上部区域以外的区域从基板侧起由下部区域及中部区域这两个区域构成,
所述薄膜的结晶尺寸按照中部区域、下部区域、上部区域的顺序变大。
6.根据权利要求1或2所述的掩模坯料,其中,
所述薄膜是所述铬的含量在厚度方向上变化的组成梯度膜。
7.根据权利要求1或2所述的掩模坯料,其中,
所述薄膜是对于曝光光具有3以上的光密度的遮光膜。
8.一种转印用掩模,其具备基板和位于基板上的具有转印图案的薄膜,
所述薄膜由含有铬的材料形成,
所述薄膜由与基板侧相反侧的上部区域、和除该上部区域以外的区域构成,
所述上部区域的结晶尺寸比除所述上部区域以外的区域的结晶尺寸大。
9.根据权利要求8所述的转印用掩模,其中,
所述薄膜的上部区域和除上部区域以外的区域均为多晶结构。
10.根据权利要求8或9所述的转印用掩模,其中,
利用电子衍射法获得的所述薄膜的上部区域和除上部区域以外的区域的各晶面间距均为0.2nm以上。
11.根据权利要求8或9所述的转印用掩模,其中,
所述薄膜的上部区域和除上部区域以外的区域均具有柱状结构。
12.根据权利要求8或9所述的转印用掩模,其中,
所述薄膜的除上部区域以外的区域从基板侧起由下部区域及中部区域这两个区域构成,
所述薄膜的结晶尺寸按照中部区域、下部区域、上部区域的顺序变大。
13.根据权利要求8或9所述的转印用掩模,其中,
所述薄膜为所述铬的含量在厚度方向上变化的组成梯度膜。
14.根据权利要求8或9所述的转印用掩模,其中,
所述薄膜是对于曝光光具有3以上的光密度的遮光膜。
15.一种半导体器件的制造方法,该方法具备:
使用权利要求8~14中任一项所述的转印用掩模,将转印图案曝光转印至半导体基板上的抗蚀膜的工序。
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G03F 图纹面的照相制版工艺,例如,印刷工艺、半导体器件的加工工艺;其所用材料;其所用原版;其所用专用设备
G03F1-00 用于图纹面的照相制版的原版,例如掩膜,光掩膜;其所用空白掩膜或其所用薄膜;其专门适用于此的容器;其制备
G03F1-20 .用于通过带电粒子束(CPB)辐照成像的掩膜或空白掩膜,例如通过电子束;其制备
G03F1-22 .用于通过100nm或更短波长辐照成像的掩膜或空白掩膜,例如 X射线掩膜、深紫外
G03F1-26 .相移掩膜[PSM];PSM空白;其制备
G03F1-36 .具有临近校正特征的掩膜;其制备,例如光学临近校正(OPC)设计工艺
G03F1-38 .具有辅助特征的掩膜,例如用于校准或测试的特殊涂层或标记;其制备





