[发明专利]一种提高访问片外存储器的效率的方法、设备及介质在审
申请号: | 201911385639.5 | 申请日: | 2019-12-29 |
公开(公告)号: | CN111177066A | 公开(公告)日: | 2020-05-19 |
发明(设计)人: | 刘同强;王朝辉;李拓;周玉龙;邹晓峰 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | G06F15/173 | 分类号: | G06F15/173 |
代理公司: | 北京连和连知识产权代理有限公司 11278 | 代理人: | 刘小峰 |
地址: | 215100 江苏省苏州市吴*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 提高 访问 外存 效率 方法 设备 介质 | ||
本发明公开了一种提高访问片外存储器的效率的方法、设备和存储介质,方法包括以下步骤:对多核处理器中的每个单核处理器配置对应的缓存和片外存储器;在每两个缓存之间设置对应的交叉缓存;响应于接收到处理任务,将任务分配到对应的单核处理器,并将单核处理器中的任务的数据分配到所述单核处理器对应的片外存储器;以及将不同单核处理器的任务之间的共享信息和/或交互数据分配到对应的交叉缓存中。本发明提出的提高访问片外存储器的效率的方法、设备及介质通过交叉缓存提高了通讯效率,通过给每个单核处理器设置对应的片外存储器提高了多核处理器访问片外存储器的效率。
技术领域
本发明涉及多核处理器领域,更具体地,特别是指一种提高访问片外存储器的效率的方法、计算机设备及可读介质。
背景技术
存储墙问题,即处理器内核的时钟频率和性能以极快的速度增长,但是主存的访问速度(DRAM)的增长却要慢的多,计算能力、存储容量、I/O速度之间越来越不匹配的现象。目前计算机体系结构采用大量的片内RAM(随机存储器)来减缓存储墙的问题。
在当代微处理器中,通过使用片上存储已经避免了大量的存储延迟,许多先进的技术也帮助消除或隐藏一小部分的存储延迟。片上存储技术提出将处理器与存储器做在同一块芯片上,这样可使访存延时大量减少,存储器带宽增加50-100倍以上。但是,采用传统逻辑工艺的情形下,DRAM单元存储密度仅能达到优化的DRAM工艺的5~25%,这样就造成芯片面积的大量占用。并且目前片外访存通信代价大、速度慢,这使得存储系统成为系统性能瓶颈的主要问题。
发明内容
有鉴于此,本发明实施例的目的在于提出一种提高访问片外存储器的效率的方法、计算机设备及计算机可读存储介质,通过交叉缓存提高了通讯效率,通过给每个单核处理器设置对应的片外存储器提高了多核处理器访问片外存储器的效率。
基于上述目的,本发明实施例的一方面提供了一种提高访问片外存储器的效率的方法,包括如下步骤:对多核处理器中的每个单核处理器配置对应的缓存和片外存储器;在每两个缓存之间设置对应的交叉缓存;响应于接收到处理任务,将任务分配到对应的单核处理器,并将单核处理器中的任务的数据分配到所述单核处理器对应的片外存储器;以及将不同单核处理器的任务之间的共享信息和/或交互数据分配到对应的交叉缓存中。
在一些实施方式中,所述对多核处理器中的每个单核处理器配置对应的缓存和片外存储器包括:对每个单核处理器配置由所述单核处理器管理的片外存储器,并在所述单核处理器和所述片外存储器之间设置缓存。
在一些实施方式中,所述在每两个缓存之间设置对应的交叉缓存包括:依次判断两个缓存之间是否存在交叉缓存;以及响应于所述两个缓存之间不存在交叉缓存,在所述两个缓存之间创建交叉缓存。
在一些实施方式中,所述将单核处理器中的任务的数据分配到所述单核处理器对应的片外存储器包括:对所述片外存储器统一编址,根据变量类型分配所述任务到对应的存储地址。
在一些实施方式中,所述将不同单核处理器的任务之间的共享信息和/或交互数据分配到对应的交叉缓存中包括:基于交互对象将共享信息和/或交互数据分配到对应的缓存的预定地址中;以及响应于所述任务执行,将所述共享信息和/或交互数据加载到所述交叉缓存中。
本发明实施例的另一方面,还提供了一种计算机设备,包括:至少一个处理器;以及存储器,存储器存储有可在处理器上运行的计算机指令,指令由处理器执行以实现如下步骤:对多核处理器中的每个单核处理器配置对应的缓存和片外存储器;在每两个缓存之间设置对应的交叉缓存;响应于接收到处理任务,将任务分配到对应的单核处理器,并将单核处理器中的任务的数据分配到所述单核处理器对应的片外存储器;以及将不同单核处理器的任务之间的共享信息和/或交互数据分配到对应的交叉缓存中。
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