[发明专利]一种阵列基板、显示面板及显示装置有效
| 申请号: | 201911374443.6 | 申请日: | 2019-12-27 |
| 公开(公告)号: | CN110992912B | 公开(公告)日: | 2022-04-29 |
| 发明(设计)人: | 王伟鹏 | 申请(专利权)人: | 厦门天马微电子有限公司 |
| 主分类号: | G09G3/36 | 分类号: | G09G3/36;G09G3/3208;G09G3/3266 |
| 代理公司: | 北京允天律师事务所 11697 | 代理人: | 王萌 |
| 地址: | 361101 福建*** | 国省代码: | 福建;35 |
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| 摘要: | |||
| 搜索关键词: | 一种 阵列 显示 面板 显示装置 | ||
1.一种阵列基板,其特征在于,包括:
子像素阵列,所述子像素阵列包括第一子像素行至第N子像素行,N为不小于2的整数;
以及,第一栅极线至第N栅极线,第i栅极线与第i子像素行相连,用于将扫描信号传输至相应子像素行中的子像素,i为不大于N的正整数;
其中,所述第一栅极线至所述第N栅极线中至少一个栅极线包括第一子栅极线和第二子栅极线,且所述第一子栅极线的输出端和所述第二子栅极线的输入端之间接入缓冲器,所述第一子栅极线连接相应子像素行中部分子像素,且该相应子像素行中另一部分子像素与所述第二子栅极线相连;
所述阵列基板包括第一级扫描电路至第N级扫描电路,所述第一级扫描电路至第N级扫描电路逐级输出所述扫描信号,其中,第i级扫描电路与所述第i栅极线电连接;与包括第一子栅极线和第二子栅极线的栅极线相连的扫描电路和子像素行中,沿所述子像素行中子像素排列方向,所述扫描电路与所述缓冲器分别位于所述像素行的两侧;
所述阵列基板包括显示区域及位于所述显示区域外侧的边框区域,所述缓冲器位于所述边框区域;
与包括第一子栅极线和第二子栅极线的栅极线相连的扫描电路和子像素行中:将所述第一子栅极线的输出端一侧电连接的部分子像素还与所述第二子栅极线电连接,以提高所述第一子栅极线的输出端侧的电连接的子像素的驱动效果,解决所述第一子栅极线的输出端侧相较于输入端侧传输信号的驱动能力减低问题;将所述第二子栅极线 的输出端一侧电连接的部分子像素还与所述第一子栅极线电连接,以提高所述第二子栅极线的输出端侧的电连接的子像素的驱动效果,解决所述第二子栅极线的输出端侧相较于输入端侧传输信号的驱动能力减低问题。
2.根据权利要求1所述的阵列基板,其特征在于,与包括第一子栅极线和第二子栅极线的栅极线相连的子像素行中,按间隔至少一个子像素划分为两组子像素组,且一组子像素组与所述第一子栅极线电连接,另一组子像素组与所述第二子栅极线电连接。
3.根据权利要求1所述的阵列基板,其特征在于,与包括第一子栅极线和第二子栅极线的栅极线相连的子像素行中,所有子像素按子像素的排列方向依次划分为两组子像素组,且一组子像素组与所述第一子栅极线电连接,另一组子像素组与所述第二子栅极线电连接。
4.根据权利要求1所述的阵列基板,其特征在于,所述第一栅极线至所述第N栅极线中所有栅极线均包括第一子栅极线和第二子栅极线。
5.根据权利要求1所述的阵列基板,其特征在于,所述阵列基板包括第一级扫描电路至第N级扫描电路,其中,第i级扫描电路与所述第i栅极线电连接;
沿所述子像素行中子像素排列方向,奇数级扫描电路及偶数级扫描电路分别位于所述子像素阵列的两侧。
6.根据权利要求1-5任意一项所述的阵列基板,其特征在于,沿所有子像素行的排列方向上,与所述子像素行相连的第一子栅极线和第二子栅极线,分别位于所述子像素行的两侧。
7.根据权利要求6所述的阵列基板,其特征在于,与所述第一子栅极线的输出端一侧电连接的预设数量的子像素,其还与所述第二子栅极线电连接。
8.根据权利要求6所述的阵列基板,其特征在于,与所述第二子栅极线的输出端一侧电连接的预设数量的子像素,其还与所述第一子栅极线电连接。
9.一种显示面板,其特征在于,所述显示面板包括权利要求1-8任意一项所述的阵列基板。
10.一种显示装置,其特征在于,所述显示装置包括权利要求9所述的显示面板。
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