[发明专利]一种数据处理的方法、装置及电子设备在审

专利信息
申请号: 201910080981.8 申请日: 2019-01-28
公开(公告)号: CN111488216A 公开(公告)日: 2020-08-04
发明(设计)人: 祝夭龙;何伟;冯杰 申请(专利权)人: 北京灵汐科技有限公司
主分类号: G06F9/50 分类号: G06F9/50
代理公司: 北京睿派知识产权代理事务所(普通合伙) 11597 代理人: 刘锋
地址: 100080 北京市*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 数据处理 方法 装置 电子设备
【说明书】:

发明提供了一种数据处理的方法、装置及电子设备,用于解决现有技术中在众核芯片中有效算力利用率低的问题。包括:确定众核芯片中多个执行第一处理的第一处理核在设定周期内输出进行池化操作后的数据进行第二处理的资源需求量;根据所述资源需求量确定所述第一处理核的资源配平数量;将所述资源配平数量的第一处理核的输出数据输入到所述众核芯片中的任一个第二处理核执行所述第二处理。

技术领域

本发明涉及通信技术领域,尤其涉及一种数据处理的方法、装置及电子设备。

背景技术

随着互联网应用的发展,人工智能技术得到越来越广泛的应用,影响人工智能技术的三大要素包括数据、算法和算力,其中,算力是由芯片提供的,是处理数据和运行算法的核心动力,如何在节约成本的情况下提升芯片的有效算力并且节约功耗,是目前需要解决的问题。

现有技术中,采用众核芯片来提升有效算力,例如,在卷积神经网络中对数据进行池化操作为例,假设众核芯片布局如图1所示,图1中有9个同构处理核(Processing Core,PCore),分别为PCore A、PCore B、PCore C、PCoreD、PCoreE、PCoreF、PCoreG、PCoreH和PCore I,核与核之间可以通过片上网络(Networks on Chip,NOC)进行通信,其中,PCore A为第n层卷积层的处理核,PCore E为第n+1层卷积层的处理核,在PCore A中对数据进行池化操作,池化后的数据输入到PCore E处理核,在第n层进行池化操作可以减少第n+1层卷积层的计算量,假设在每个时间段(Ti)中PCore A为满操作运算,采用2X2的池化操作,则计算量降低4倍,当数据输入PCore E时,由于PCore E与PCore A为同构处理核,算力相同,处理能力相同,当计算量降低4倍时,即处理四分之一的计算量,需要的运算时间为每个时间段的四分之一,具体如图2所示,为池化前后PCore A与PCore E的资源需求量分配示意图。可以看出,采用现有技术的方法,PCore E在每个时间段中有四分之三的时间之内是闲置的,浪费了PCore E的计算资源,即浪费了PCore E的算力,因此,如何在众核芯片中提升有效算力是目前需要解决的问题。

发明内容

有鉴于此,本发明提供了一种数据处理的方法、装置及电子设备,用于解决现有技术中在众核芯片中有效算力利用率低的问题。

根据本发明实施例的第一个方面,提供了一种数据处理的方法,包括:确定众核芯片中多个执行第一处理的第一处理核在设定周期内输出进行池化操作后的数据进行第二处理的资源需求量;根据所述资源需求量确定所述第一处理核的资源配平数量;将所述资源配平数量的第一处理核的输出数据输入到所述众核芯片中的任一个第二处理核执行所述第二处理。

通过上述方法,可以使第二处理核满负荷工作,提高了第二处理核的有效算力,避免了资源的浪费。

在一个实施例中,若所述众核芯片中的处理核为同构处理核,所述确定众核芯片中多个执行第一处理的第一处理核在设定周期内输出进行池化操作后的数据进行第二处理的资源需求量之前,该方法还包括:设置所述众核芯片中任一第一处理核的参数;将所述参数复制到所述众核芯片中的其它第一处理核。

通过该方法,对于多个同构处理核使用相同的参数,只要设置其中一个第一处理核的参数的参数即可,节约了参数配置的时间。

在一个实施例中,若所述第一处理核为满负荷工作,所述第一处理核在设定周期内输出进行池化操作后的资源需求量为池化操作前资源需求量的N分之一,其中,N为池化操作后资源需求量降低的倍数。

通过该方法,通过池化操作降低资源需求量,节约资源。

在一个实施例中,所述根据所述资源需求量确定所述第一处理核的资源配平数量,具体包括:根据所述N分之一确定第一处理核的资源配平数量为N。

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