[实用新型]一种适用于解密机计算板的外围电路有效

专利信息
申请号: 201820847807.2 申请日: 2018-06-01
公开(公告)号: CN208506753U 公开(公告)日: 2019-02-15
发明(设计)人: 周顺风;董学松;付信高 申请(专利权)人: 济南蓝剑钧新信息科技有限公司
主分类号: G06F21/72 分类号: G06F21/72;G06F11/30
代理公司: 济南泉城专利商标事务所 37218 代理人: 赵玉凤
地址: 250002 山东省济南*** 国省代码: 山东;37
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摘要:
搜索关键词: 计算板 电源管理模块 总线驱动模块 解密芯片 外围电路 总线 解密机 电源驱动能力 温度检测单元 本实用新型 输入转换 通信连接 总线电平 控制板 分出 挂接 过热 带宽 电源 保证 隔离 输出 检测 通信
【权利要求书】:

1.一种适用于解密机计算板的外围电路,所述解密机计算板上设有N颗进行密码破译的解密芯片,N为正整数,其特征在于:所述电路包括电源管理模块和总线驱动模块,所述电源管理模块包括主电源电路和辅助电源电路,主电源电路包括电源管理芯片TPS51621,电源管理芯片TPS51621提供不小于1V/40A的电力输出,为解密芯片核心电源Vcore供电;辅助电源电路包括电压转换芯片TLV62130和SGM2036,芯片TLV62130将12V输入转化为5V和3.3V输出,5V为TPS51621提供输出Vcore所需的驱动电源,3.3V电源同时还为SGM2036芯片供电,SGM2036芯片将3.3V输入转化为1V输出,用于为解密芯片的PLL部分供电;所述总线驱动模块包括CPLD芯片,CPLD芯片的输入端连接QSPI总线,CPLD芯片的输出端分出i组QSPI总线,每组总线挂接j颗解密芯片,i、j均为正整数,且N=i*j。

2.根据权利要求1所述的适用于解密机计算板的外围电路,其特征在于:解密机计算板上设有32颗解密芯片,电源管理模块包括8组主电源电路和辅助电源电路,每组主电源电路和辅助电源电路为4颗解密芯片供电。

3.根据权利要求2所述的适用于解密机计算板的外围电路,其特征在于:CPLD芯片的输出端分出8组QSPI总线,每组总线挂接4颗解密芯片。

4.根据权利要求1所述的适用于解密机计算板的外围电路,其特征在于:还包括温度控制单元,温度控制单元STC15W201S单片机和测温芯片,测温芯片与STC15W201S单片机双向通信连接,并且STC15W201S单片机与CPLD芯片相连。

5.根据权利要求1所述的适用于解密机计算板的外围电路,其特征在于:电源管理芯片TPS51621输入两组+12V 电压, +12V电压经过第一MOS管和第二MOS管级联到地,第一MOS管源极和第二MOS管漏极的连接处输出到Vcore并反馈至电源管理芯片TPS51621,并且MOS管的栅极由电源管理芯片TPS51621控制。

6.根据权利要求5所述的适用于解密机计算板的外围电路,其特征在于:第一个+12V电压连接至MOS管Q1的漏极,MOS管Q1的源极连接MOS管Q2的漏极并经电感L1输出到Vcore,MOS管Q2的源极接地;电源管理芯片TPS51621的DRVH2端连接MOS管Q1的栅极,电源管理芯片TPS51621的DRVL2连接MOS管Q2的栅极;MOS管Q1的源极和MOS管Q2的漏极的连接处又反馈到电源管理芯片TPS51621的VBST2及LL2端,且VBST2端与MOS管Q2的漏极之间连接有串联的电阻R35、电容C26,+5V驱动电压经二极管D2连接至电阻R35与电容C26之间;电源管理芯片TPS51621的V5IN端需要提供+5V电压;

第二个+12V电压连接至MOS管Q6的漏极,MOS管Q6的源极连接MOS管Q3的漏极然后经电感L2输出到Vcore,MOS管Q3的源极接地;电源管理芯片TPS51621的DRVH1端连接MOS管Q6的栅极,电源管理芯片TPS51621的DRVL1连接MOS管Q3的栅极;MOS管Q6的源极和MOS管Q3的漏极的连接处又反馈到电源管理芯片TPS51621的VBST1及LL1端,且VBST1端与MOS管Q3的漏极之间连接有串联的电阻R40、电容C30,+5V驱动电压经二极管D3连接至电阻R40与电容C30之间;电源管理芯片TPS51621的V5IN端需要提供+5V电压。

7.根据权利要求1所述的适用于解密机计算板的外围电路,其特征在于:电源管理芯片TPS51621的PGOOD端经电阻R00连接至三极管Q4的基极,三极管Q4的集电极连接+3.3V电压,三极管Q4的发射极经电阻R39连接至解密芯片的Reset1端,CPLD芯片的RST端连接至三极管Q5的基极,三极管Q5的发射极接地,三极管Q5的集电极连接至解密芯片的Reset1端。

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