[发明专利]处理器系统及其存储器控制方法在审
| 申请号： | 201811479297.9 | 申请日： | 2015-12-18 |
| 公开（公告）号： | CN109656838A | 公开（公告）日： | 2019-04-19 |
| 发明（设计）人： | 张和平;周如愿;徐国柱 | 申请（专利权）人： | 杭州士兰微电子股份有限公司 |
| 主分类号： | G06F12/0888 | 分类号： | G06F12/0888;G06F1/3234 |
| 代理公司： | 北京成创同维知识产权代理有限公司 11449 | 代理人： | 蔡纯;张靖琳 |
| 地址： | 310012*** | 国省代码： | 浙江;33 |
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| 摘要： | |||
| 搜索关键词： | 处理器系统 选择器 嵌入式存储器 存储器控制 第二信号 处理器 高速缓冲存储器 存储应用程序 低功耗模式 端口连接 访问模式 控制信号 路径连通 路由功能 芯片成本 运行效率 功耗 | ||
1.一种处理器系统，包括：
第一选择器，包括第一至第三端口；
分别与第一选择器的第一至第三端口连接嵌入式存储器、处理器和高速缓冲存储器，所述嵌入式存储器用于存储应用程序代码，
其中，所述第一选择器提供控制信号的路由功能，使得第一端口与第二端口之间的第一信号路径、或者第一端口与第三端口之间的第二信号路径连通。
2.根据权利要求1所述的处理器系统，其中，所述第一选择器还包括第一选择端口，所述第一选择器根据第一选择端口提供的第一选择信号，选择第一信号路径和第二信号路径之一连通。
3.根据权利要求2所述的处理器系统，其中，所述处理器提供所述第一选择信号，当处理器的频率小于第一阈值时，所述第一选择信号使得第一信号路径连通，当处理器的频率大于等于第一阈值时，所述第一选择信号使得第二信号路径连通。
4.根据权利要求1所述的处理器系统，其中，
在第一信号路径连通时，所述嵌入式存储器工作于低功耗模式，其中，处理器直接从嵌入式存储器读取数据，
在第二信号路径连通时，所述嵌入式存储器工作于高效访问模式，其中，在高速缓冲存储器与嵌入式存储器之间进行数据缓存。
5.根据权利要求4所述的处理器系统，其中，所述处理器获取的数据为指令和/或操作数。
6.一种用于处理器系统的存储器控制方法，包括：
将处理器的频率与第一阈值进行比较；
当处理器的频率小于第一阈值时，嵌入式存储器工作于低功耗模式；以及
当处理器的频率大于等于第一阈值时，嵌入式存储器工作于高速访问模式，
其中，在高速访问模式中，处理器经由高速缓冲存储器从嵌入式存储器获取指令和/或操作数；
在低功耗模式中，处理器直接从嵌入式存储器获取指令和/或操作数。
7.根据权利要求6所述的方法，其中，通过第一选择器提供控制信号的路由功能，使得嵌入式存储器工作于低功耗模式和高速访问模式之一。
8.根据权利要求7所述的方法，其中，第一选择器包括分别与嵌入式存储器、处理器和高速缓冲存储器相连的第一至第三端口，并且第一选择器根据第一选择信号，使得在第一端口与第二端口之间的第一信号路径、第一端口与第三端口之间的第二信号路径连通。
9.根据权利要求8所述的方法，其中，
在第一信号路径连通时，所述嵌入式存储器工作于低功耗模式，
在第二信号路径连通时，所述嵌入式存储器工作于高效访问模式。
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