[发明专利]GOA电路和显示面板有效

专利信息
申请号: 201811459972.1 申请日: 2018-11-30
公开(公告)号: CN109326261B 公开(公告)日: 2020-10-27
发明(设计)人: 戴荣磊 申请(专利权)人: 武汉华星光电技术有限公司
主分类号: G09G3/36 分类号: G09G3/36
代理公司: 深圳翼盛智成知识产权事务所(普通合伙) 44300 代理人: 黄威
地址: 430079 湖北省武汉市*** 国省代码: 湖北;42
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摘要:
搜索关键词: goa 电路 显示 面板
【权利要求书】:

1.一种GOA电路,其特征在于,所述GOA电路包括级联的多个GOA单元,其中,设N为大于2的正整数,第N级GOA单元包括:一正反向扫描控制模块、一节点信号控制输入模块、一第一节点下拉模块、一第二节点、一栅极信号下拉模块、一全局控制信号作用模块、一输出控制模块、一稳压模块以及一自举电容;其中,

所述正反向扫描控制模块用于通过正向直流扫描控制信号控制所述GOA电路正向扫描,或通过反向直流扫描信号控制所述GOA电路反向扫描;所述节点信号控制输入模块分别与所述正反向扫描控制模块、所述第一节点下拉模块、所述栅极信号下拉模块和所述全局控制信号作用模块相连,所述节点信号控制输入模块用于控制所述GOA电路低电位输出;所述第一节点下拉模块分别与所述正反向扫描控制模块、所述节点信号控制输入模块和所述稳压模块相连,所述第一节点下拉模块用于下拉第一节点的电平;所述栅极信号下拉模块分别与所述节点信号控制输入模块和所述输出控制模块相连,所述栅极信号下拉模块用于下拉本级栅极驱动信号电平及在触控屏扫描期间控制所述本级栅极驱动信号输出;所述全局控制信号作用模块分别与所述节点信号控制输入模块、所述栅极信号下拉模块和所述输出控制模块相连,所述全局控制信号作用模块通过一第一全局控制信号和一第二全局控制信号开启所述GOA电路的所有栅极驱动信号以及在所述触控屏扫描期间控制本级栅极驱动信号输出;所述输出控制模块分别与所述自举电容、所述全局控制信号作用模块和所述栅极信号下拉模块相连,所述输出控制模块用于控制本级栅极驱动信号输出;所述稳压模块分别与所述正反向扫描控制模块、所述第一节点下拉模块和所述自举电容相连,所述稳压模块用于维持一第一节点的电平;

其中,所述稳压模块包括第七薄膜晶体管,且所述第七薄膜晶体管的栅极接收一第三全局控制信号,源极连接所述正反向扫描控制模块及所述第一节点下拉模块,漏极连接所述第一节点,所述第三全局控制信号在所述触控屏扫描期间为恒压高电平信号,并且在所述触控屏中停期间为恒压低电位信号,以使第七薄膜晶体管处于截止状态;

所述第一节点下拉模块包括第五薄膜晶体管,所述第五薄膜晶体管的栅极连接至所述第二节点,源极接收所述恒压低电位信号,漏极连接所述第七薄膜晶体管的源极并通过所述第七薄膜晶体管与所述第一节点相连;

所述自举电容的一端连接至所述第一节点和所述第七薄膜晶体管的漏极,另一端接收所述恒压低电位信号,所述自举电容用于二次抬升所述第一节点电平;所述第五薄膜晶体管的漏极通过所述第七薄膜晶体管与所述第一节点相连,在所述触控屏中停期间为恒压低电位信号时,以避免第一节点的恒压高电平信号由所述自举电容向所述第一节点下拉模块中的第五薄膜晶体管的漏电路径。

2.根据权利要求1所述的GOA电路,其特征在于,所述第N级GOA单元还包括:一第二节点下拉模块,所述第二节点下拉模块分别与所述正反向扫描控制模块、所述节点信号控制输入模块和所述第一节点下拉模块相连,所述第二节点下拉模块用于下拉所述第二节点的电平。

3.根据权利要求2所述的GOA电路,其特征在于,所述正反向扫描控制模块包括第一薄膜晶体管和第二薄膜晶体管,其中所述第一薄膜晶体管的栅极连接至第N-2级GOA单元的栅极驱动信号,源极接收所述正向直流扫描控制信号,漏极连接所述第七薄膜晶体管的源极和所述第二薄膜晶体管的漏极;所述第二薄膜晶体管的栅极连接第N+2级GOA单元的栅极驱动信号,源极接收所述反向直流扫描控制信号。

4.根据权利要求2所述的GOA电路,其特征在于,所述节点信号控制输入模块包括第三薄膜晶体管、第四薄膜晶体管和第八薄膜晶体管,所述第三薄膜晶体管的栅极接收所述正向直流扫描控制信号,源极接收第N+1级GOA单元的时钟信号,漏极连接所述第四薄膜晶体管的漏极和所述第八薄膜晶体管的栅极;所述第四薄膜晶体管的栅极接收所述反向直流扫描控制信号,源极接收第N-1级GOA单元的时钟信号;所述第八薄膜晶体管的源极接收恒压高电位信号,漏极连接与所述第一节点下拉模块、所述第二节点下拉模块、所述栅极信号下拉模块和所述全局控制信号作用模块均连接的第二节点。

5.根据权利要求2所述的GOA电路,其特征在于,所述输出控制模块包括第九薄膜晶体管,所述第九薄膜晶体管的栅极连接所述第一节点,源极接收本级时钟信号,漏极连接本级栅极驱动信号。

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