[发明专利]侦错方法有效
申请号: | 201811131034.9 | 申请日: | 2018-09-27 |
公开(公告)号: | CN110955566B | 公开(公告)日: | 2023-08-08 |
发明(设计)人: | 杨顺杰 | 申请(专利权)人: | 佛山市顺德区顺达电脑厂有限公司;神云科技股份有限公司 |
主分类号: | G06F11/22 | 分类号: | G06F11/22 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 528308 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 方法 | ||
本发明提供一种侦错方法,适用于一包含一个中央处理器及一个存储器的计算机主机并包含下列步骤:藉由该中央处理器执行一个基本输入输出系统的程序码,以执行一个开机自我检测;该基本输入输出系统的程序码提供一个驱动程序,使得多个侦错信息可以对应输出至该存储器;在该开机自我检测的初始阶段,当该存储器完成初始化之后,该中央处理器将该侦错信息储存至该存储器;当该开机自我检测结束之后,藉由一个应用软件读取储存于该存储器的该侦错信息。本案利用将侦错信息储存至存储器的侦错方法,大幅提高开机自我检测的执行效率,进而缩短开发时间。
技术领域
本发明是有关于一种侦错方法,特别是指一种可以提高侦错效率的侦错方法。
背景技术
参阅图1,习知的计算机主机9包含一个中央处理器(CPU)91、一个电连接该中央处理器的芯片组(PCH)92、一个电连接该芯片组的基本输入输出系统(BIOS)93、及一个电连接该芯片组的通用异步收发传输器(Universal Asynchronous Receiver/Transmitter;UART)94。该基本输入输出系统93的开机程序操作在一个正常模式(Release Mode)及一个侦错模式(Debug Mode)之间。当该基本输入输出系统93操作在该侦错模式时,该芯片组92藉由该通用异步收发传输器94将该基本输入输出系统93的侦错信息,经由一个支援该通用异步收发传输器94的标准的连接埠,例如COM1,传送至另一个计算机主机8,使得一个程序开发者可以藉由该计算机主机8取得侦错模式的相关侦错信息,进而据以修改该基本输入输出系统93的程序码。
由于支援该通用异步收发传输器94的标准的连接埠的传输速度相当缓慢,使得该基本输入输出系统93在该正常模式及该侦错模式时,该开机程序在执行开机自我检测(Power ON Self Test;POST)的时间差异相当的大。举例来说,在该正常模式下,执行开机自我检测的时间约为78秒,而在该侦错模式下,执行开机自我检测的时间却约为264秒。这样的时间差异显示侦错的效率不佳,也就导致开发基本输入输出系统的时间变长,因此成为一个待解决的问题。
发明内容
本发明要解决的技术问题是在于提供一种可以提高侦错效率的侦错方法。
为解决上述技术问题,一种侦错方法,适用于一包含一个中央处理器及一个存储器的计算机主机并包含步骤(a)~(d)。
于步骤(a),藉由该中央处理器执行一个基本输入输出系统的程序码,以执行一个开机自我检测(POST)。
于步骤(b),该基本输入输出系统的程序码提供一个驱动程序,使得多个侦错信息可以对应输出至该存储器的一个位址区块。
于步骤(c),在该开机自我检测的初始阶段,当该存储器完成初始化之后,该中央处理器将该侦错信息储存至该存储器的该位址区块。
于步骤(d),当该开机自我检测结束之后,藉由该中央处理器执行一个应用软件,以读取储存于该存储器的该位址区块的该侦错信息。
优选地,该中央处理器包括一个快取存储器,该侦错方法还包含一个步骤(e),在该开机自我检测的初始阶段,当该快取存储器完成初始化之后,且该存储器初始化之前,该快取存储器被虚拟成该存储器的该位址区块,使得该中央处理器将该侦错信息储存至该快取存储器。
优选地,其中,在步骤(c)中,当该存储器完成初始化之后,该中央处理器还先将该快取存储器所储存的该侦错信息储存至该存储器的该位址区块。
优选地,该侦错方法还适用于一个计算机主机,并还包含一个步骤(f),在该开机自我检测的过程中,藉由该计算机主机经由一个扩增侦错埠(Extended Debug Port;XDP)与该中央处理器连线,以在该基本输入输出系统执行该开机自我检测(POST)的过程中,就能够读取该存储器的该位址区块所储存的该侦错信息。
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