[发明专利]抑制梳状滤波效应的听力设备有效
申请号: | 201810641982.0 | 申请日: | 2018-06-21 |
公开(公告)号: | CN109121055B | 公开(公告)日: | 2021-07-27 |
发明(设计)人: | A·蒂芬奥;J·博利;马长学 | 申请(专利权)人: | 大北欧听力公司 |
主分类号: | H04R25/00 | 分类号: | H04R25/00 |
代理公司: | 北京尚诚知识产权代理有限公司 11322 | 代理人: | 顾小曼 |
地址: | 丹麦,*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 抑制 滤波 效应 听力 设备 | ||
1.一种听力设备,包括:
输入模块,用于提供第一输入信号,所述输入模块包括第一麦克风;
处理器,用于基于所述第一输入信号来提供处理器输出信号;
抑制器,用于基于包括第一抑制器输入信号的一个或多个抑制器输入信号来提供第一抑制器输出信号;
第一加法器,耦合至所述抑制器,所述第一加法器配置为用于基于所述处理器输出信号和所述第一抑制器输出信号来提供第一加法器输出信号;
接收器,用于将基于所述第一加法器输出信号的输出信号转换为音频输出信号;
其特征在于,所述抑制器是配置为向所述第一抑制器输入信号应用第一延迟和具有第一增益的第一滤波器的梳状抑制器,其中,所述第一延迟在从4ms到10ms的范围内或在从8ms到20ms的范围内,其中,所述梳状抑制器包括主抑制器部分,所述主抑制器部分具有第一主输入端,所述第一主输入端连接至所述输入模块以用于接收所述第一抑制器输入信号或连接至所述处理器以用于接收所述第一抑制器输入信号或连接至所述第一加法器的输出端以用于接收所述第一加法器输出信号作为所述第一抑制器输入信号,所述主抑制器部分配置为对所述第一抑制器输入信号应用作为所述第一延迟的第一主延迟和作为所述第一增益的第一主增益,以形成第一主输出信号,其中,所述第一主输出信号形成所述第一抑制器输出信号的至少一部分。
2.根据权利要求1所述的听力设备,其中,所述梳状抑制器包括配置为控制所述第一延迟和所述第一滤波器的抑制器控制器。
3.根据权利要求2所述的听力设备,其中,所述抑制器控制器配置为基于所述第一输入信号来控制所述主抑制器部分。
4.根据权利要求2至3中任一项所述的听力设备,其中,所述抑制器控制器配置为基于来自所述输入模块的输入信号来控制所述第一延迟和所述第一滤波器。
5.根据权利要求4所述的听力设备,其中,所述输入模块包括用于提供耳道输入信号的耳道麦克风,并且其中,所述抑制器控制器配置为基于来自所述输入模块的第二输入信号来控制所述第一延迟和所述第一滤波器,所述耳道输入信号是所述第二输入信号。
6.根据权利要求2至3中任一项所述的听力设备,其中,所述抑制器控制器配置为基于来自所述处理器的控制信号来控制所述第一延迟和所述第一滤波器。
7.根据权利要求2至3中任一项所述的听力设备,其中,所述抑制器控制器配置为确定抑制器模式,并且如果所述抑制器模式是第一抑制器模式,则应用第一抑制器方案,而如果所述抑制器模式是第二抑制器模式,则应用第二抑制器方案。
8.根据权利要求1至3中任一项所述的听力设备,其中,所述主抑制器部分配置为将第二主延迟和第二主滤波器应用于所述第一抑制器输入信号的至少一部分,以基于所述第一抑制器输入信号形成第二主输出信号,其中,所述第二主输出信号形成所述第一抑制器输出信号的至少一部分。
9.根据权利要求1至3中任一项所述的听力设备,其中,所述输入模块包括第二麦克风和第一波束形成器,其中,所述第一波束形成器连接至所述第一麦克风和所述第二麦克风,并且配置为基于第一和第二麦克风信号提供波束形成信号作为第一输入信号。
10.根据权利要求1至3中任一项所述的听力设备,其中,所述听力设备包括滤波器组和第二加法器,所述滤波器组连接至所述处理器,用于将所述处理器输出信号至少滤波为第一滤波器输出信号和第二滤波器输出信号;
其中,所述第一加法器配置为接收所述第一滤波器输出信号,并且所述第二加法器配置为接收所述第二滤波器输出信号和所述第一加法器输出信号;并且
其中,所述第二加法器耦合至所述接收器,用于向所述接收器提供第二加法器输出信号。
11.一种操作听力设备的方法,所述听力设备包括输入模块和处理器,所述方法包括:
将音频输入转换为第一输入信号;
基于所述第一输入信号来提供处理器输出信号;
基于包括第一抑制器输入信号的一个或多个抑制器输入信号来提供第一抑制器输出信号;
基于所述处理器输出信号和所述第一抑制器输出信号来提供第一加法器输出信号;并且
将基于所述第一加法器输出信号的输出信号转换为音频信号,
其特征在于,提供所述第一抑制器输出信号的动作包括将第一延迟和具有第一增益的第一滤波器应用于所述第一抑制器输入信号,所述第一延迟在从4ms到10ms的范围内或在从8ms到20ms的范围内,并且其中,所述第一抑制器输入信号包括或基于所述第一输入信号、所述第一加法器输出信号或所述处理器输出信号。
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