[发明专利]用于功率高效驱动电路的设备及方法有效

专利信息
申请号: 201780069359.6 申请日: 2017-08-08
公开(公告)号: CN109923611B 公开(公告)日: 2023-08-08
发明(设计)人: T·M·霍利斯;D·D·甘斯;L·G·韦伯 申请(专利权)人: 美光科技公司
主分类号: G11C7/10 分类号: G11C7/10
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 功率 高效 驱动 电路 设备 方法
【权利要求书】:

1.一种用于功率高效驱动电路的设备,其包括:

驱动电路,其经配置以基于一或多个启用信号,在第一操作模式中将第一供应电压选择性地提供到输出节点且在第二操作模式中将第二供应电压选择性地提供到所述输出节点,并且基于一或多个启用信号在所述第一操作模式和所述第二操作模式选择性地将小于所述第一供应电压和所述第二供应电压的第三供应电压提供到所述输出节点。

2.根据权利要求1所述的设备,其中所述驱动电路包括:

第一组上拉驱动接脚,其经配置以基于第一启用信号将所述第一供应电压选择性地提供到所述输出节点;

第二组上拉驱动接脚,其经配置以基于第二启用信号将所述第二供应电压选择性地提供到所述输出节点;及

一组下拉驱动接脚,其经配置以基于第三启用信号将所述第三供应电压选择性地提供到所述输出节点。

3.根据权利要求2所述的设备,其中所述第一组上拉驱动接脚中的每一上拉驱动接脚包括耦合在第一供应电压源与所述输出节点之间的NFET。

4.根据权利要求2所述的设备,其中所述第二组上拉驱动接脚中的每一上拉驱动接脚包括耦合在第二供应电压源与所述输出节点之间的PFET。

5.根据权利要求2所述的设备,其中所述组下拉驱动接脚中的每一下拉驱动接脚包括耦合在接地与所述输出节点之间的NFET。

6.根据权利要求2所述的设备,其中所述第一组上拉驱动接脚并联耦合到所述输出节点,所述第二组上拉驱动接脚并联耦合到所述输出节点,且所述组下拉驱动接脚并联耦合到所述输出节点。

7.根据权利要求2所述的设备,其中所述第一组上拉驱动接脚及所述第二组上拉驱动接脚中的每一上拉驱动接脚及每一下拉驱动接脚包括用于选择性地激活对应上拉驱动接脚或下拉驱动接脚的开关。

8.根据权利要求2所述的设备,其进一步包括:

多个上拉晶体管,所述多个上拉晶体管中的每一上拉晶体管经耦合到所述第一组上拉驱动接脚中的上拉驱动接脚、所述第二组上拉驱动接脚中的上拉驱动接脚及所述输出节点,其中所述多个上拉晶体管经配置以基于所述第三启用信号将所述第一供应电压及所述第二供应电压中的一者选择性地提供到所述输出节点。

9.根据权利要求2所述的设备,其中所述驱动电路进一步经配置以当在所述第一操作模式中操作时提供二进制信号且当在所述第二操作模式中操作时提供多电平信号。

10.根据权利要求1所述的设备,其中所述第二供应电压大于所述第一供应电压。

11.一种用于功率高效驱动电路的设备,其包括:

驱动电路,其经配置以基于一或多个启用信号在第一操作模式利用第一供应电压或在第二操作模式利用第二供应电压驱动输出信号,并且在基于所述一或多个启用信号在所述第一操作模式和所述第二操作模式选择性地将小于所述第一供应电压和所述第二供应电压的第三供应电压提供到输出节点;及

信号模式电路,其经配置以基于存储器的操作速度提供所述一或多个启用信号。

12.根据权利要求11所述的设备,其中所述信号模式电路经配置以接收指示所述存储器的所述操作速度的信号模式命令。

13.根据权利要求12所述的设备,其进一步包括:

串行器电路,其经耦合到所述存储器阵列及所述信号模式电路,所述串行器电路经配置以接收平行数据且将串行数据提供到所述信号模式电路。

14.根据权利要求13所述的设备,其中所述信号模式电路进一步经配置以基于所述平行数据及所述串行数据提供所述启用信号。

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