[发明专利]一种FPGA程序数据的加载方法及装置有效

专利信息
申请号: 201711348549.X 申请日: 2017-12-15
公开(公告)号: CN108132811B 公开(公告)日: 2021-09-21
发明(设计)人: 项东阳 申请(专利权)人: 杭州迪普科技股份有限公司
主分类号: G06F9/445 分类号: G06F9/445
代理公司: 北京博思佳知识产权代理有限公司 11415 代理人: 林祥
地址: 310051 浙江省杭*** 国省代码: 浙江;33
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摘要:
搜索关键词: 一种 fpga 程序 数据 加载 方法 装置
【权利要求书】:

1.一种FPGA程序数据的加载方法,应用于网络设备,其特征在于,包括:

从外部设备的指定位置获取程序数据,并将所述程序数据存储至用户态空间;

将所述程序数据复制到内核态空间的程序数据缓存区;

向版本控制FPGA发送加载指令,以由所述版本控制FPGA从所述程序数据缓存区将所述程序数据加载至业务处理FPGA;

在将所述程序数据复制到内核态空间的程序数据缓存区前,包括:

接收缓存区分配指令;

在所述内核态空间分配所述程序数据缓存区,并确定是否分配成功;

如果否,输出失败提示信息;

如果是,将所述程序数据缓存区的缓存区起始位置、缓存区大小和回写确认地址写入所述版本控制FPGA。

2.根据权利要求1所述的方法,其特征在于,所述将所述程序数据复制到内核态空间的程序数据缓存区,包括:

基于所述缓存区大小将所述程序数据划分为若干程序子数据;

依次将若干程序子数据选为目标子数据;

将所述目标子数据从所述用户态空间复制到所述程序数据缓存区。

3.根据权利要求2所述的方法,其特征在于,所述向版本控制FPGA发送加载指令,以由所述版本控制FPGA从所述程序数据缓存区将所述程序数据加载至业务处理FPGA,包括:

向所述版本控制FPGA发送所述加载指令,以由所述版本控制FPGA基于所述缓存区起始地址和所述缓存区大小将所述目标子数据加载至所述业务处理FPGA并在所述回写确认地址写入所述回写完成标识。

4.根据权利要求3所述的方法,其特征在于,所述方法还包括:

检查所述回写确认地址是否写入回写完成标识;其中,所述回写完成标识表征所述版本控制FPGA已将所述目标子数据加载至所述业务处理FPGA;

如果是,将下一个程序子数据选为目标子数据,并将所述回写确认地址的所述回写完成标识更换为回写未完成标识;

如果否,等待预设时长后,重新检查所述回写确认地址是否写入所述回写完成标识。

5.根据权利要求4所述的方法,其特征在于,所述将下一个程序子数据选为目标子数据,包括:

确定所述程序数据是否加载完成;

如果是,结束加载流程;

如果否,将下一个程序子数据选为目标子数据。

6.根据权利要求4所述的方法,其特征在于,所述等待预设时长后,重新检查所述回写确认地址是否写入所述回写完成标识的步骤,包括:

等待预设时长后,确定所述目标子数据的加载是否超时;

如果是,结束加载流程;

如果否,重新检查所述回写确认地址是否写入所述回写完成标识。

7.一种FPGA程序数据的加载装置,应用于网络设备,其特征在于,包括:

获取单元,用于从外部设备的指定位置获取程序数据,并将所述程序数据存储至用户态空间;

复制单元,用于将所述程序数据复制到内核态空间的程序数据缓存区;

发送单元,用于向版本控制FPGA发送加载指令,以由所述版本控制FPGA从所述程序数据缓存区将所述程序数据加载至业务处理FPGA;

接收单元,用于接收到缓存区分配指令;

分配单元,用于在所述内核态空间分配所述程序数据缓存区,并确定是否分配成功;

输出单元,用于如果否,输出失败提示信息;

写入单元,用于如果是,将所述程序数据缓存区的缓存区起始位置、缓存区大小和回写确认地址写入所述版本控制FPGA。

8.根据权利要求7所述的装置,其特征在于,所述复制单元,进一步用于:

基于所述缓存区大小将所述程序数据划分为若干程序子数据;

依次将若干程序子数据选为目标子数据;

将所述目标子数据从所述用户态空间复制到所述程序数据缓存区。

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