[发明专利]显示装置、阵列基板、像素电路及其驱动方法在审

专利信息
申请号: 201711339732.3 申请日: 2017-12-14
公开(公告)号: CN107863072A 公开(公告)日: 2018-03-30
发明(设计)人: 董甜 申请(专利权)人: 京东方科技集团股份有限公司
主分类号: G09G3/3233 分类号: G09G3/3233
代理公司: 北京清亦华知识产权代理事务所(普通合伙)11201 代理人: 张润
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 显示装置 阵列 像素 电路 及其 驱动 方法
【说明书】:

技术领域

发明涉及显示技术领域,特别涉及一种像素电路、一种像素电路的驱动方法、一种阵列基板和一种显示装置。

背景技术

AMOLED(Active-matrix Organic Light Emitting Diode,有源矩阵有机发光二极体或主动矩阵有机发光二极体)显示技术,其显示亮度与OLED器件的驱动电流成正比,在OLED器件点亮的时刻,像素电路给OLED器件提供相应的驱动电流,从而形成了从电源电压ELVDD到OLED的阴极ELVSS的通路。其中,电源电压ELVDD从有效显示区域外部输入后,在有效显示区域内通过导线传输至各个像素电路,而在传输过程中,由于导线具有一定的电阻,所以电源电压ELVDD在传输过程中会产生一个直流压降,常被称为IR drop。

由于IR drop的存在,导致电源电压ELVDD在有效显示区域内的分布不均匀,具体原因为:每个像素电路实际的电源电压VDD_pixel=ELVDD-I*R,其中,I为ELVDD信号网络的电流值,R为像素电路至电源电压ELVDD输入端的导线电阻,由于每个像素电路到电源电压ELVDD输入端的导线走线长度不同,所以对应每个导线电阻R不同,即IR drop不同,当驱动晶体管饱和不平时,使得每个像素电路的像素电流不同,进而造成显示的不均匀,且随着显示面板尺寸增大,IR drop问题越来越严重,导致面板显示亮度不均匀。

另外,像素电路中驱动晶体管的阈值电压漂移也会引起面板显示亮度不均匀,而且驱动晶体管的磁滞效应会造成短期残像,影响面板的显示品质。

发明内容

本发明旨在至少在一定程度上解决相关技术中的技术问题之一。为此,本发明的第一个目的在于提出一种像素电路,能够有效改善因磁滞效应产生的短期残像的问题,同时可以实现阈值电压补偿和IR drop补偿,有效提高像素电流的均匀性,解决面板显示亮度不均匀的问题。

本发明的第二个目的在于提出一种像素电路的驱动方法。

本发明的第三个目的在于提出一种阵列基板。

本发明的第四个目的在于提出一种显示装置。

为实现上述目的,本发明第一方面实施例提出了一种像素电路,包括:复位单元、驱动控制单元、供电单元、储能单元、驱动单元和发光单元,其中,所述复位单元分别与第一扫描端、复位端、第二扫描端、参考电源端、第一控制点和第二控制点相连,用于根据所述第一扫描端的扫描信号将所述复位端的输入电压写入所述第一控制点,并根据所述第二扫描端的扫描信号将所述参考电源端的输入电压写入所述第二控制点;所述驱动控制单元分别与第三扫描端、数据端和所述第一控制点相连,用于根据所述第三扫描端的扫描信号将所述数据端的输入电压写入所述第一控制点,其中,所述数据端的输入电压大于所述复位端的输入电压与所述驱动单元的阈值电压之差;所述供电单元分别与第一电源端、所述第二扫描端、所述第二控制点、第三控制点和第四控制点相连,用于根据所述第二扫描端的扫描信号将所述第一电源端的电压提供给所述第二控制点,并使所述第三控制点和所述第四控制点相连通;所述储能单元分别与所述第一控制点和所述第二控制点相连,用于存储所述第一控制点和所述第二控制点的电压;所述驱动单元分别与所述第一控制点、所述第二控制点和所述第三控制点相连,用于在所述第一控制点和所述第二控制点的电压的控制下放电;所述发光单元分别与所述第四控制点和第二电源端相连,用于在所述第四控制点的电压的控制下发光。

根据本发明实施例的像素电路,通过复位单元对第一控制点和第二控制点的电压进行复位,以使驱动单元处于固定电压偏置状态,从而可以有效改善因磁滞效应产生的短期残像的问题。同时,驱动控制单元还将驱动单元的阈值电压写入第一控制点,并且供电单元还将第一电源端的电压提供给第二控制点,以及在储能单元的作用下,使得最终获得的像素电流中既不包含阈值电压也不包含第一电源端的电压,从而实现了阈值电压补偿和IR drop补偿,有效提高了像素电流的均匀性,解决了面板显示亮度不均匀的问题。

另外,根据本发明上述实施例的像素电路还可以具有如下附加的技术特征:

根据本发明的一个实施例,所述复位单元包括:第一晶体管,所述第一晶体管的控制极与所述第一扫描端相连,所述第一晶体管的第一极与所述复位端相连,所述第一晶体管的第二极与所述第一控制点相连;第二晶体管,所述第二晶体管的控制极与所述第二扫描端相连,所述第二晶体管的第一极与所述参考电源端相连,所述第二晶体管的第二极与所述第二控制点相连。

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