[发明专利]一种显示面板及显示装置在审
申请号: | 201711129697.2 | 申请日: | 2017-11-15 |
公开(公告)号: | CN107808651A | 公开(公告)日: | 2018-03-16 |
发明(设计)人: | 席克瑞;崔婷婷;林柏全;欧阳珺婷 | 申请(专利权)人: | 武汉天马微电子有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G09G3/3266 |
代理公司: | 北京同达信恒知识产权代理有限公司11291 | 代理人: | 黄志华 |
地址: | 430205 湖北省武汉市*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 一种 显示 面板 显示装置 | ||
技术领域
本发明涉及显示技术领域,特别涉及一种显示面板及显示装置。
背景技术
随着显示技术的飞速发展,显示面板越来越向着高集成度和低成本的方向发展。其中,阵列基板行驱动(Gate Driver on Array,GOA)技术将薄膜晶体管(Thin Film Transistor,TFT)栅极开关电路集成在显示面板的阵列基板上以形成对显示面板的扫描驱动,从而可以省去栅极集成电路(Integrated Circuit,IC)的绑定(Bonding)区域以及扇出(Fan-out)区域的布线空间,不仅可以在材料成本和制备工艺两方面降低产品成本,而且可以使显示面板做到两边对称和窄边框的美观设计。
目前,一般的栅极驱动电路均是由多个级联的移位寄存器组成,各级移位寄存器分别对应连接一条栅线,通过各级移位寄存器实现从上往下依次向连接的栅线输入扫描信号以进行逐行扫描,同时源极驱动电路向各条数据线加载对应的数据信号,以完成显示一个画面。然而,在显示面板仅需要显示时间、日历、天气等部分内容时,由于栅极驱动电路需要对显示面板中的各栅线进行逐行扫描进行显示驱动,才能使显示面板显示上述内容,导致功耗增加。
发明内容
本发明实施例提供一种显示面板及显示装置,用以降低显示面板的功耗。
本发明实施例提供了一种显示面板,所述显示面板包括:多条驱动信号线,以及具有多个移位寄存器的驱动控制电路;其中,所述移位寄存器分为依次排布的M个寄存器组,每个所述寄存器组对应电连接相邻的多条驱动信号线;每个所述寄存器组中的各移位寄存器级联设置,且每一所述移位寄存器与至少一条驱动信号线电连接;并且每个所述寄存器组分别与不同的帧起始信号端和不同的时钟控制信号端相对应连接;M为大于1的整数;
在所述显示面板分区域显示时,在一帧扫描时间内,所述M个寄存器组中的部分寄存器组用于在电连接的帧起始信号端和时钟控制信号端的信号的控制下独立工作,对电连接的驱动信号线逐行驱动;其中,除所述部分寄存器组之外,其余寄存器组电连接的帧起始信号端的信号与所述部分寄存器组电连接的帧起始信号端的信号不同;
在所述显示面板整体显示时,在所述一帧扫描时间内,各所述寄存器组用于在电连接的帧起始信号端和时钟控制信号端的信号的控制下顺序工作,对所述显示面板中的驱动信号线逐行驱动;其中,每个所述寄存器组电连接的时钟控制信号端的信号的时序相同,且除第一个寄存器组之外,其余寄存器组电连接的帧起始信号端的信号与相邻排布的上一个寄存器组中最后一级移位寄存器输出的信号的时序相同。
相应地,本发明实施例还提供了一种显示装置,包括本发明实施例提供的上述显示面板。
本发明有益效果如下:
本发明实施例提供的显示面板及显示装置,通过对驱动控制电路中的移位寄存器进行分组,每个寄存器组中的移位寄存器采用级联设置,且每个寄存器组电连接相邻的多条驱动信号线,以及通过对各个寄存器组分别设置不同的帧起始信号端和不同的时钟控制信号端,以便可以独立控制各个寄存器组对电连接的驱动信号线进行驱动。其中,在显示面板分区域显示时,通过设置各个帧起始信号端与时钟控制信号端的信号以使部分寄存器组独立工作,以使工作的寄存器组对应的区域进行显示驱动,而不使其余寄存器组对应的区域进行显示驱动,从而可以降低功耗。在显示面板整体显示时,通过设置各个帧起始信号端与时钟控制信号端的信号以使各寄存器组顺序工作,对显示面板中的驱动信号线进行逐行显示驱动,从而可以使显示面板实现整体显示的功能。
附图说明
图1为本发明实施例提供的显示面板的结构示意图之一;
图2为本发明实施例提供的显示面板的结构示意图之二;
图3为本发明实施例提供的显示面板的结构示意图之三;
图4a为本发明实施例提供的显示面板的结构示意图之四;
图4b为本发明实施例提供的显示面板的结构示意图之五;
图5a为本发明实施例提供的移位寄存器的结构示意图之一;
图5b为本发明实施例提供的移位寄存器的结构示意图之二;
图6a为本发明实施例提供的电路时序图之一;
图6b为本发明实施例提供的电路时序图之二;
图7为本发明实施例提供的显示面板的具体结构示意图;
图8为本发明实施例提供的电路时序图之三;
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