[发明专利]一种传输流复用的插包控制方法及系统有效

专利信息
申请号: 201710855390.4 申请日: 2017-09-20
公开(公告)号: CN107613320B 公开(公告)日: 2019-09-06
发明(设计)人: 陈泽武 申请(专利权)人: 高斯贝尔数码科技股份有限公司
主分类号: H04N21/236 分类号: H04N21/236;H04N21/433
代理公司: 深圳市瑞方达知识产权事务所(普通合伙) 44314 代理人: 冯小梅;郭方伟
地址: 423038 湖南省郴*** 国省代码: 湖南;43
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摘要:
搜索关键词: 一种 传输 流复用 控制 方法 系统
【权利要求书】:

1.一种传输流复用的插包控制方法,其特征在于,所述方法包括以下步骤:

S1.将TS流码率及需要进行插包间隔控制的TS包的插包周期写入第一存储器;

S2.将需要进行插包间隔控制的TS包的插包周期按公式换算成表示TS流长度的包周期数写入第二存储器,并将表示距离上次TS插入需要进行插包间隔控制的TS包以来TS流所经历的长度的包周期计数清零;其中,所述公式是:其中所述TS流码率恒定,TS包包长度固定为188字节;

S3.创建需要进行插包间隔控制的TS包;

S4.将不需要进行插包间隔控制的TS包存放在数据缓存区;

S5.比较需要进行插包间隔控制的TS包的包周期计数与其相应包周期数的值,若包周期计数大于等于包周期数则执行步骤S6,若包周期计数小于包周期数则执行步骤S8;

S6.将相应TS包拷贝至TS缓存区,并将相应TS包的包周期计数进行清零;

S7.更新需要进行插包间隔控制的TS包的包周期计数,然后执行步骤S5;

S8.从数据缓存区中读取一个TS包,并写入到TS缓存区;

S9.判断数据缓存区是否为空,若为空则执行步骤S10,否则执行步骤S7;

S10.结束插包过程。

2.如权利要求1所述的传输流复用的插包控制方法,其特征在于,所述需要进行插包间隔控制的TS包包括PCR包及各PSI/SI信息表,所述不需要进行插包间隔控制的TS包包括音、视频及空包的TS包,所述第一存储器是插包控制参数寄存器,所述第二存储器是包周期数寄存器,所述数据缓存区是FIFO缓存区。

3.如权利要求2所述的传输流复用的插包控制方法,其特征在于,所述步骤S2中TS流所经历的长度是TS缓存区增加的TS包总数,包周期计数清零是将包周期计数器清零。

4.如权利要求3所述的传输流复用的插包控制方法,其特征在于,所述步骤S5中比较PCR包及各PSI/SI信息表的包周期计数与其相应包周期数的值是判断PCR包及各PSI/SI信息表的包周期计数是否大于等于相应包周期数的值。

5.如权利要求4所述的传输流复用的插包控制方法,其特征在于,所述步骤S7中更新PCR包及各PSI/SI信息表的包周期计数是更新包周期计数器,根据TS缓存区增加的TS包数目相应增加PCR包及各PSI/SI信息表的包周期计数。

6.一种传输流复用的插包控制系统,其特征在于,包括:

第一存储器,用于存放TS流码率及需要进行插包间隔控制的TS包的插包周期;

第二存储器,用于存放按公式将需要进行插包间隔控制的TS包的插包周期换算成表示TS流长度的包周期数;其中,所述公式是:其中所述TS流码率恒定,TS包包长度固定为188字节;

计数器,用于记录表示距离上次TS插入需要进行插包间隔控制的TS包以来,TS流所经历的长度的包周期计数;

数据缓存区,用于存放不需要进行插包间隔控制的TS包;

TS缓存区,用于接收TS插包控制器的输出,存放复用后的TS流数据;

第一TS包模块和第二TS包模块,用于分别存放需要进行插包间隔控制的TS包;

TS插包控制器,用于从所述第一存储器中获取需要进行插包间隔控制的TS包的插包周期,按公式换算成表示TS流长度的包周期数并存放到所述第二存储器中;同时,用于比较需要进行插包间隔控制的TS包的包周期计数与其相应包周期数的值,将TS包数据从所述第一TS包模块、所述第二TS包模块和所述数据缓存区存放至所述TS缓存区;

所述TS插包控制器分别与所述第一存储器、所述第二存储器、所述数据缓存区、所述TS缓存区、所述计数器、所述第一TS包模块、所述第二TS包模块相连。

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