[发明专利]中断响应方法、装置及计算机可读存储介质有效

专利信息
申请号: 201710594076.5 申请日: 2017-07-20
公开(公告)号: CN109284176B 公开(公告)日: 2020-11-03
发明(设计)人: 邢金璋;杨灿;汪文祥 申请(专利权)人: 龙芯中科技术有限公司
主分类号: G06F9/48 分类号: G06F9/48
代理公司: 北京同立钧成知识产权代理有限公司 11205 代理人: 杨泽;刘芳
地址: 100095 北京市海淀*** 国省代码: 北京;11
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摘要:
搜索关键词: 中断 响应 方法 装置 计算机 可读 存储 介质
【说明书】:

本申请提供一种中断响应方法、装置及计算机可读存储介质,其中,该方法包括:在获取到中断源发出的中断请求时,依次在处理器流水线中的访存级、访存级之前的流水级和取指级中索引有效指令,将索引到的第一条有效指令作为目标有效指令,在该目标有效指令上标记上述中断请求对应的中断标识,记录目标有效指令的程序计数器值,将标记有中断标识的目标有效指令传递至提交级报出,以使处理器响应上述中断请求。该技术方案中,处理器在获取到中断源发出的中断请求后,可以快速进行响应,大大提升了处理器的实时性和可靠性。

技术领域

本申请涉及计算机技术领域,尤其涉及一种中断响应方法、装置及计算机可读存储介质。

背景技术

现有计算机系统中,处理器作为系统控制中心,需要对系统中的多个硬件设备进行管理。例如,当处理器正常执行系统中的某个程序时,可能会被外部事件打断,产生中断。理论上来说,一旦产生中断,处理器应该立即进行响应,打断正常执行的程序,而跳到规定的入口地址去取指执行中断处理程序。

通常来说,系统中正常执行的程序是可以被中断所打断的,但是当处理器正在执行一条非回滚指令或者处理器流水线中的中断采样处不存在有效指令时,处理器便无法对其立即作出响应,需要等到非回滚指令执行完毕或者有效指令到达中断采样处时才能作出响应,这使得中断响应的时间是不确定的,可能会很长,影响了中断响应的及时性。

综上所述,现有的中断响应方法中中断响应延迟的时间可能会很长,致使处理器的实时性和可靠性低。

发明内容

本申请提供一种中断响应方法、装置及计算机可读存储介质,以解决现有中断响应方法中处理器的实时性和可靠性低的问题。

本申请第一方面提供的一种中断响应方法,包括:

在获取到中断源发出的中断请求时,依次在处理器流水线中的访存级、所述访存级之前的流水级和取指级中索引有效指令,将索引到的第一条有效指令作为目标有效指令;

在所述目标有效指令上标记所述中断请求对应的中断标识,并记录所述目标有效指令的程序计数器值,所述程序计数器值用于指示所述中断请求对应中断发生处的指令地址;

将标记有所述中断标识的所述目标有效指令传递至提交级报出,以使处理器响应所述中断请求。

可选的,所述依次在处理器流水线中的访存级、所述访存级之前的流水级和取指级中索引有效指令,将索引到的第一条有效指令作为目标有效指令,包括:

判断所述处理器流水线中的访存级中是否存在有效指令;

在所述访存级不存在有效指令时,从所述访存级开始,向前索引流水级中的有效指令,并在所述访存级之前的流水级中存在有效指令时,将在所述流水级中索引到的第一条有效指令作为目标有效指令;

在所述访存级不存在有效指令、且所述访存级之前的流水级中均不存在有效指令时,将所述取指级处程序计数器值对应的指令作为目标有效指令;

在所述访存级存在有效指令时,将所述访存级的有效指令作为目标有效指令。

可选的,所述访存级不存在有效指令,包括:所述访存级的指令为非回滚指令,所述非回滚指令包括:已发出请求的存储指令和非缓存加载指令;

所述方法还包括:确定所述非回滚指令对应的操作由所述处理器中的无等待处理模块处理。

可选的,所述确定所述非回滚指令对应的操作由所述处理器中的无等待处理模块处理,包括:

在所述非回滚指令为已发出访存请求的存储指令时,确定所述访存请求被压入处理器中的存储缓存器中,且由所述存储缓存器执行所述访存请求对应的存储操作。

可选的,所述确定所述非回滚指令对应的操作由所述处理器中的无等待处理模块处理,包括:

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