[发明专利]一种应用于SVG的综合对时装置及对时方法在审
| 申请号： | 201710349710.9 | 申请日： | 2017-05-17 |
| 公开（公告）号： | CN106992832A | 公开（公告）日： | 2017-07-28 |
| 发明（设计）人： | 冯丽;康长路;方乾增;宋岳文;韩猛 | 申请（专利权）人： | 山东泰开电力电子有限公司 |
| 主分类号： | H04J3/06 | 分类号： | H04J3/06 |
| 代理公司： | 济南舜源专利事务所有限公司37205 | 代理人： | 张亮 |
| 地址： | 271000 山东省泰安*** | 国省代码： | 山东;37 |
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| 摘要： | |||
| 搜索关键词： | 一种 应用于 svg 综合 时装 时方 | ||
1.一种应用于SVG的综合对时装置，其特征在于，包括电源模块，所述电源模块连接有数据处理模块和通讯接口模块；
通讯接口模块包括与数据处理模块连接的RS485总线接口、RS-232总线接口、光纤收发接口；
数据处理模块包括总线协议编码单元，所述总线协议编码单元连接有总线协议解码单元和延时消除单元。
2.根据权利要求1所述的一种应用于SVG的综合对时装置，其特征在于，通讯接口模块包括一路IRIG-B(DC)码输入、一路RS-485输入、一路RS-232输入、光纤输入、两路RS-485输出、两路RS-232输出和光纤输出。
3.根据权利要求2所述的一种应用于SVG的综合对时装置，其特征在于，光纤输入包括一路塑料光纤输入和一路玻璃光纤输入；光纤输出包括四路塑料光纤输出和四路玻璃光纤输出。
4.根据权利要求3所述的一种应用于SVG的综合对时装置，其特征在于，所述电源模块由电源芯片及其外围电路组成，为数据处理模块和通讯接口模块提供电源。
5.根据权利要求4所述的一种应用于SVG的综合对时装置，其特征在于，数据处理模块选用型号为EP2C8T14418N的CPLD芯片或其他管脚数量满足的单片机。
6.根据权利要求5所述的一种应用于SVG的综合对时装置，其特征在于，一路IRIG-B(DC)码输入用来接收场站统一时钟源的数据。
7.根据权利要求6所述的一种应用于SVG的综合对时装置，其特征在于，RS-485总线接口输出标准的IRIG-B(DC)码。
8.一种应用于SVG的综合对时方法，其特征在于，包括以下步骤：
步骤801：接收现场统一时钟源提供的IRIG-B(DC)码信号根据B码的格式完成解码；
步骤802：将时间数据依照装置中所包含的通讯接口协议进行编码；
步骤803：根据编解码过程和接收时间设备解码所消耗的时间对时间数据进行处理，使时间数据到达需要对时的设备时和实际时间相符合；
步骤804：将经过延时消除单元处理过的数据通过通讯接口模块的各路输出接口发送到需要对时的设备。
9.根据权利要求8所述的一种应用于SVG的综合对时方法，其特征在于，步骤803的实现过程为：根据选择的数据处理模块芯片的处理周期来计算解码和编码的时间，同时考虑设备接收并解码的时间，来确定实际发出的时间需要减去的延时时间。
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