[发明专利]一种供电与信号相结合的两线制LED驱动控制集成电路在审

专利信息
申请号: 201510559991.1 申请日: 2015-09-06
公开(公告)号: CN105101574A 公开(公告)日: 2015-11-25
发明(设计)人: 郑明松;马连锋 申请(专利权)人: 广德利德光电有限公司
主分类号: H05B37/02 分类号: H05B37/02
代理公司: 合肥鼎途知识产权代理事务所(普通合伙) 34122 代理人: 叶丹
地址: 242200 安徽*** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 供电 信号 相结合 两线制 led 驱动 控制 集成电路
【说明书】:

技术领域

发明涉及集成电路,具体涉及一种供电与信号相结合的两线制LED驱动控制集成电路。

背景技术

图1是传统的信号LED控制电路,单独的电源VCC和GND,通过Data-in数据输入得到数据,判断是否是当前LED如果不是,从Data-out输出给下一个LED,如果是当前LED,那么将使用数据去驱动当前LED。

发明内容

针对以上现有技术中存在的不足,本发明提供了一种供电与信号相结合的两线制LED驱动控制集成电路。

一种供电与信号相结合的两线制LED驱动控制集成电路,所述供电与信号相结合的两线制LED驱动控制集成电路包括检测电压模块、震荡模块、Logic模块、解码模块、恒流模块、数组发光二极管、电源,所述检测电压模块、震荡模块连接Logic模块,所述Logic模块连接解码模块,所述数组发光二极管中的每组发光二极管由N个二极管连接而成,所述数组发光二极管的负极并联后接地,正极通过开关连接恒流模块,所述恒流模块另一端并联后连接电源,所述解码模块连接开关,所述检测电压模块另一端连接电源。

所述检测电压模块为DetectVDDvoltage检测电压模块。

所述震荡模块为OSC模块。

所述恒流模块为CC恒流模块。

所述解码模块为Codec模块。

本发明的有益效果为:本发明提供一种供电与信号相结合的两线制LED驱动控制集成电路,利用高电位和低电位的下降沿时间来判断信号1.0.mark,通过一段连续的信号分别读出地址,亮度值等,从而实现可编程两线制LED驱动集成电路。

附图说明

图1为传统的信号LED控制电路;

图2为本发明的电路连接图;

图中:1为检测电压模块;2为震荡模块;3为Logic模块;4为解码模块;5为恒流模块;6为发光二极管;7为开关。

具体实施方式

以下结合具体实施方式和附图说明对本发明做进一步详细说明。

如图2所示,一种供电与信号相结合的两线制LED驱动控制集成电路,所述供电与信号相结合的两线制LED驱动控制集成电路包括检测电压模块1、震荡模块2、Logic模块3、解码模块4、恒流模块5、数组发光二极管6、电源,所述检测电压模块1、震荡模块2连接Logic模块3,所述Logic模块3连接解码模块4,所述数组发光二极管6中的每组发光二极管6由N个二极管连接而成,所述数组发光二极管6的负极并联后接地,正极通过开关7连接恒流模块5,所述恒流模块5另一端并联后连接电源,所述解码模块4连接开关7,所述检测电压模块1另一端连接电源,在本发明中发光二极管6的类型并不限定,可以为其他驱动管,如果改变发光二极管6的类型,来实现其他功能也是可以的。本发明提供一种供电与信号相结合的两线制LED驱动控制集成电路,利用高电位和低电位的下降沿时间来判断信号1.0.mark,通过一段连续的信号分别读出地址,亮度值等,从而实现可编程两线制LED驱动集成电路。

如图1所示,传统的信号LED控制电路,单独的电源VCC和GND,通过Data-in数据输入得到数据,判断是否是当前LED如果不是,从Data-out输出给下一个LED,如果是当前LED,那么将使用数据去驱动当前LED。本发明针对现有技术的弊端,提出一种具有供电与信号相结合的两线制LED驱动控制集成电路,利用高电位和低电位的下降沿时间来判断信号1.0.mark.例如将高电位设为5V,低电位设为2.5V,5V到2.5V的下降沿处触发后,读取2.5V是时间来判断信号1.0.mark,通过一段连续的信号分别读出地址,亮度值等,从而实现可编程两线制LED驱动集成电路。

DetectVDDvoltage检测电压模块1:当VDD<3V时,该模块输出低电平;VDD>3V时,该模块输出高电平。通过此模块,可将电源信号转换为数据信号。

CC恒流模块5:该模块用于产生恒流输出,防止电源电压变化较大时输出电流变化过大。

OSC模块:震荡模块2。

Logic模块3:按键与逻辑电路,脉冲重置,其中包含多个与门非门或门.触发器。该模块检测detectVDDvoltage低电平的时间,当低电平时间为OSC周期的16~32倍时,认为是0码;当低电平时间为OSC周期的32~64倍时,认为是1码;当低电平时间大于64倍OSC周期时,认为是帧结束码。当模块接收到的地址与模块本身被固定的地址一致,才会接收数据,否则认为无效。

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