[发明专利]阵列基板、显示装置及子像素渲染方法有效

专利信息
申请号: 201510540514.0 申请日: 2015-08-28
公开(公告)号: CN105096885B 公开(公告)日: 2018-01-02
发明(设计)人: 张沼栋;周秀峰;吴玲 申请(专利权)人: 厦门天马微电子有限公司;天马微电子股份有限公司
主分类号: G09G3/36 分类号: G09G3/36;G09G3/3225
代理公司: 北京汇思诚业知识产权代理有限公司11444 代理人: 王刚,龚敏
地址: 361101 福建*** 国省代码: 福建;35
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摘要:
搜索关键词: 阵列 显示装置 像素 渲染 方法
【说明书】:

技术领域

本申请涉及电子技术领域,具体涉及显示设备领域,尤其涉及一种阵列基板、包含该阵列基板的显示装置及子像素渲染方法。

背景技术

为了满足人们对显示效果的不断追求,高PPI(Pixels Per Inch,每英寸的像素数量)的显示屏幕已经成为各种显示终端必备的配置之一。高PPI的显示器件虽然能够提供更加细腻精美的画面,但是由于显示面板所需的数据线和扫描线明显增多,会导致显示面板的穿透率大幅下降,功耗大幅攀升,工艺难度和制造成本都大幅增加的问题。

在现有技术中,可以使用子像素渲染(Sub Pixel Rendering,SPR)技术,在低PPI的产品上通过合理排布RGB像素,并结合相适应的算法,使其具有高PPI的显示效果。图1是现有技术中的一种像素阵列的结构示意图。如图1所示,现有技术中的有机发光二极管(Organic Light-Emitting Diode,OLED)显示装置可以使用Diamond(钻石)像素结构。相对于惯用的长宽比为3:1的子像素矩阵来说,这种Diamond像素结构的绿色子像素G的数量保持不变,但是红色子像素R和蓝色子像素B的数量减少一半,同时子像素R和B的面积为子像素G的两倍。并且,子像素RGB的几何形状均为正方形,子像素R和B的面积均为惯用的长宽比为3:1的子像素的面积的3倍。这样,在保证RGB三色均匀的同时,其实际PPI降低了1/3,数据线也相应减少了1/3。并且,在搭配合理算法后,这种低分辨的像素结构同样可以实现高PPI(子像素的长宽比为3:1)的显示效果。

虽然这种Diamond像素结构在OLED产品上,通过设置有机发光二极管位置就可以轻松实现。但是,对于液晶显示屏(Liquid Crystal Display,LCD)产品来说,像素结构的实现不但需要重新设计彩膜中各颜色子像素的结构,还要重新设计像素电极的结构,而这种不规则的结构在工艺上是很难实现的。

发明内容

鉴于现有技术中的上述缺陷或不足,期望能够提供一种适用于各类显示产品的方案。为了实现上述一个或多个目的,本申请实施例提供了一种阵列基板、显示装置及子像素渲染方法。

第一方面,本申请实施例提供了一种阵列基板,该阵列基板包括像素阵列,所述像素阵列包括沿第一方向间隔排列的第一像素单元和第二像素单元;

所述第一像素单元包括沿所述第一方向依次排列的第一像素序列、第二像素序列、第三像素序列和所述第二像素序列;

所述第二像素单元包括沿所述第一方向依次排列的所述第一像素序列、所述第二像素序列、所述第三像素序列和所述第二像素序列,或所述第三像素序列、所述第二像素序列、所述第一像素序列和所述第二像素序列;

所述第一像素序列包括沿第二方向排列的多个第一子像素序列,所述第一子像素序列包括沿第二方向依次排列的第一子像素和第二子像素;

所述第二像素序列包括沿所述第二方向重复排列的第三子像素;

所述第三像素序列包括沿所述第二方向排列的多个第二子像素序列,所述第二子像素序列包括沿第二方向依次排列的所述第二子像素和所述第一子像素;

其中,所述第一子像素序列和所述第三子像素在所述第二方向上交错排布,所述第二子像素序列和所述第三子像素在所述第二方向上交错排布;

所述第一方向与所述第二方向垂直。

第二方面,本申请实施例提供了一种子像素渲染方法,该方法包括:

获取原始像素阵列的亮度矩阵;

基于所述亮度矩阵的亮度中心,从上述第一方面所提供的阵列基板中确定出显示单元;

基于所述亮度矩阵中以所述亮度中心为中心的子矩阵,确定所述显示单元中各子像素的亮度值。

第三方面,本申请实施例提供了一种显示装置,该显示装置包括扫描线、与所述扫描线绝缘相交的数据线,以及上述第一方面所提供的阵列基板。

本申请实施例提供的阵列基板、显示装置及子像素渲染方法,通过设置子像素的形状及子像素之间的位置排列关系,可以大幅减少显示时所需要的数据线数量,并且其像素阵列的结构简单,在工艺上易于实现,适用于各类显示原理的显示装置。

附图说明

通过阅读参照以下附图所作的对非限制性实施例所作的详细描述,本申请的其它特征、目的和优点将会变得更明显:

图1是现有技术中的一种像素阵列的结构示意图;

图2是本申请阵列基板的一个实施例的结构示意图;

图3是本申请阵列基板的另一个实施例的结构示意图;

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