[发明专利]多路选择器及应用其的数据驱动电路和液晶显示面板在审
| 申请号: | 201510452304.6 | 申请日: | 2015-07-29 |
| 公开(公告)号: | CN104952420A | 公开(公告)日: | 2015-09-30 |
| 发明(设计)人: | 赵莽;田勇;易士娟 | 申请(专利权)人: | 武汉华星光电技术有限公司 |
| 主分类号: | G09G3/36 | 分类号: | G09G3/36 |
| 代理公司: | 北京聿宏知识产权代理有限公司 11372 | 代理人: | 张文娟;朱绘 |
| 地址: | 430070 湖北省武汉市*** | 国省代码: | 湖北;42 |
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| 摘要: | |||
| 搜索关键词: | 选择器 应用 数据 驱动 电路 液晶显示 面板 | ||
技术领域
本发明涉及液晶显示技术领域,尤其涉及一种多路选择器及应用其的数据驱动电路和液晶显示面板。
背景技术
液晶显示器具有驱动电压和功耗低、体积小、重量轻、无辐射等一系列优点,受到了广泛的重视,发展非常迅速,已经成为平板显示器的主流技术。
在液晶显示面板的设计中,尤其是针对应用在数据驱动电路中的多路选择器的设计,一般利用单纯的NMOS或者PMOS进行门开关控制时,寄生电容会对控制的信号线(也称数据线)造成馈通(Feedthrough)的影响,使输出信号的波形发生严重的失真。而采用CMOS传输门进行门开关控制时,虽然可以解决上述这种问题,但是增加的CK控制信号线和与NMOS或PMOS相反类型的晶体管会增加面板设计的成本和复杂性,不利于高规格面板的设计。
因此,亟需提供一种解决方案,在消除信号失真的同时,减少面板设计的成本和复杂性。
发明内容
本发明所要解决的技术问题之一是需要提供一种在消除信号失真的同时,减少面板设计的成本和复杂性的多路选择器。
为了解决上述技术问题,本申请的实施例首先提供了一种多路选择器,其应用于数据驱动电路中,该多路选择器包括:多个选择模块,所述多个选择模块的一端与同一数据信号输出端连接,另一端分别与不同的数据线连接,每个选择模块在被选通后通过连接的数据线向对应的子像素提供数据信号,其中,每个选择模块包括:开关;第一时钟信号控制端,其与所述开关的控制端连接,输出第一时钟信号以控制所述开关的开启和关闭;信号补偿单元,其与所述开关的输出端连接,对经传输产生的数据信号的误差进行信号补偿以消除信号失真。
优选地,所述开关为NMOS薄膜晶体管或PMOS薄膜晶体管。
优选地,所述开关为基于LTPS的NMOS薄膜晶体管或PMOS薄膜晶体管。
优选地,所述信号补偿单元包括:与所述开关的寄生电容大小相等的电容,其一端与所述开关的输出端连接;第二时钟信号控制端,其与所述电容的另一端连接,输出第二时钟信号并通过所述电容来补偿数据信号的误差。
优选地,所述每个信号补偿单元的第二时钟信号控制端为同一时钟信号控制端,输出同一时钟信号。
优选地,所述第二时钟信号控制端在所有选择模块被选通后产生第二时钟信号集中补偿所有数据信号的误差。
优选地,所述第二时钟信号控制端在自身所处的选择模块被选通后产生第二时钟信号单独补偿当前传输的数据信号的误差。
根据本发明的另一方面,还提供了一种数据驱动电路,包括:如上所述的多路选择器;与所述多路选择器连接的时序控制器,其向所述多路选择器输出时钟信号。
根据本发明的另一方面,还提供了一种液晶显示面板,包括:如上所述的数据驱动电路;显示区域,其包括多个子像素,每个子像素分别接收来自数据驱动电路的数据信号。
与现有技术相比,上述方案中的一个或多个实施例可以具有如下优点或有益效果。
本发明实施例提供的多路选择器,利用新增的时钟信号XCK通过与之相连的电容实现对输出的数据信号的补偿,能够很好地解决数据信号失真的问题。而且,本多路选择器相对于采用CMOS来设计的多路选择器而言,大大减小了控制所需的晶体管和时钟信号线的数量,在一定程度上节省了面板设计的成本,且有利于高规格面板的设计。
本发明的其它特征和优点将在随后的说明书中阐述,并且,部分地从说明书中变得显而易见,或者通过实施本发明的技术方案而了解。本发明的目的和其他优点可通过在说明书、权利要求书以及附图中所特别指出的结构和/或流程来实现和获得。
附图说明
附图用来提供对本申请的技术方案或现有技术的进一步理解,并且构成说明书的一部分。其中,表达本申请实施例的附图与本申请的实施例一起用于解释本申请的技术方案,但并不构成对本申请技术方案的限制。
图1是液晶显示面板的区域分布示意图。
图2(a)是现有技术中数据驱动电路中的多路选择器的结构示意图。
图2(b)是图2(a)所示多路选择器的时序波形图。
图3(a)是现有技术中数据驱动电路中的另一多路选择器的结构示意图。
图3(b)是图3(a)所示多路选择器的时序波形图。
图4是本发明实施例的数据驱动电路的多路选择器的概略示意图。
图5是图4所示多路选择器的结构示意图。
图6是图5所示多路选择器的时序波形图。
具体实施方式
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