[发明专利]一种基于非易失控制的射频模块初始化系统及方法有效
| 申请号: | 201510395055.1 | 申请日: | 2015-07-07 |
| 公开(公告)号: | CN105159695B | 公开(公告)日: | 2018-07-27 |
| 发明(设计)人: | 王逸群;刘勇攀;杨华中;盛骁;李泽伟;武通达;王忠俊;内貴崇;谷内光治 | 申请(专利权)人: | 清华大学;罗姆株式会社 |
| 主分类号: | G06F9/445 | 分类号: | G06F9/445;G06K17/00 |
| 代理公司: | 北京路浩知识产权代理有限公司 11002 | 代理人: | 李相雨 |
| 地址: | 100084 北京市海*** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 一种 基于 失控 射频 模块 初始化 系统 方法 | ||
1.一种基于非易失控制的射频模块初始化方法,其特征在于,包括:
S1,非易失存储阵列存储初始化射频模块的配置信息,在接收到掉电指令时,备份所述配置信息;
S2,在接收到上电指令时,射频模块初始化加速器从所述非易失存储阵列读取所述配置信息,将所述配置信息发送至所述射频模块,以初始化所述射频模块;
其中,所述非易失存储阵列为非易失存储器或非易失寄存器组,其中,所述非易失寄存器组包括多个非易失触发器和一个非易失读写控制器;
当所述非易失存储阵列为非易失寄存器组时,所述非易失读写控制器在接收到掉电指令时,根据所述配置信息的数据量和/或复杂度确定用于备份所述配置信息的非易失触发器,并向非易失触发器发送预设时序的控制信号,以使非易失触发器备份所述配置信息。
2.一种基于非易失控制的射频模块初始化系统,其特征在于,包括:
非易失存储阵列,用于存储初始化射频模块的配置信息,在接收到掉电指令时,备份所述配置信息;
可重构射频模块控制器,在接收到上电指令时,从所述非易失存储阵列读取所述配置信息,并将所述配置信息发送至前端接口电路;
所述前端接口电路,用于根据预设协议将所述配置信息发送至所述射频模块,以初始化所述射频模块;
其中,所述非易失存储阵列为非易失存储器或非易失寄存器组,其中,所述非易失寄存器组包括多个非易失触发器和一个非易失读写控制器;
当所述非易失存储阵列为非易失寄存器组时,所述非易失读写控制器在接收到掉电指令时,根据所述配置信息的数据量和/或复杂度确定用于备份所述配置信息的非易失触发器,并向非易失触发器发送预设时序的控制信号,以使非易失触发器备份所述配置信息。
3.根据权利要求2所述基于非易失控制的射频模块初始化系统,其特征在于,所述可重构射频模块控制器包括:
非易失FPGA,用于根据需要初始化的目标射频模块的型号进行编程,以切换所述前端接口电路与所述目标射频模块相对应;
非易失编程信息存储器,用于存储所述非易失FPGA的编程信息,并在接收到掉电指令时,备份所述编程信息,在接收到上电指令时,恢复所述编程信息。
4.根据权利要求2 所述基于非易失控制的射频模块初始化系统,其特征在于,所述前端接口电路包括:
数据缓存器,用于存储从所述射频模块读取到的射频收发数据;
串并转换器,其中,所述串并转换器包括:
分频器,用于对所述前端接口电路接收到的系统时钟进行分频,得到串口时钟信号,并将串口时钟信号发送至输入输出移位器;
所述输入输出移位器,用于产生串口数据信号;
时序控制电路,用于将所述串口时钟信号与所述串口数据信号对齐,以生成与所述预设协议相符的波形。
5.根据权利要求2所述基于非易失控制的射频模块初始化系统,其特征在于,还包括:
处理器,用于根据接收到的写入指令,将所述配置信息写入所述非易失存储阵列,根据接收到的开启或关闭指令,开启或关闭所述可重构射频模块控制器,以及根据接收到的控制指令,控制所述可重构射频模块控制器进行接收或发送操作。
6.根据权利要求5所述基于非易失控制的射频模块初始化系统,其特征在于,还包括:
射频模块选择器,根据来自所述处理器的选择指令,向所述可重构射频模块控制器发送选择信号,以使所述可重构射频模块控制器从所述非易失存储阵列读取目标配置信息,并初始化目标射频模块。
7.根据权利要求2所述基于非易失控制的射频模块初始化系统,其特征在于,所述可重构射频模块控制器还用于控制所述前端接口电路从所述射频模块读取数据,并获取读取到的数据以存储至所述非易失存储阵列。
8.根据权利要求2所述基于非易失控制的射频模块初始化系统,其特征在于,所述前端接口电路还用于根据所述配置信息切换前端接口类型,以与所述射频模块相对应。
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