[发明专利]具处理器件之间流量控制的装置、单芯片系统与方法在审

专利信息
申请号: 201510106820.3 申请日: 2015-03-11
公开(公告)号: CN104917693A 公开(公告)日: 2015-09-16
发明(设计)人: 西昂·克里希纳·巴布拉帕特 申请(专利权)人: 领特德国公司
主分类号: H04L12/851 分类号: H04L12/851
代理公司: 北京德恒律治知识产权代理有限公司 11409 代理人: 章社杲;李伟
地址: 德国诺伊*** 国省代码: 德国;DE
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摘要:
搜索关键词: 处理 器件 之间 流量 控制 装置 芯片 系统 方法
【权利要求书】:

1.一种装置,其特征在于,包括:

辅助处理器件,用以接收待处理数据,

主处理器件,以及

从所述主处理器件至所述辅助处理器件的反馈路径,所述主处理器件用以通过所述反馈路径将所述主处理器件的负荷通知所述辅助处理器件,其中所述辅助处理器件用以根据所述主处理器件的所述负荷及所述数据的优先权来选择性地舍弃所接收的数据。

2.如权利要求1所述的装置,其特征在于,所述辅助处理器件进一步用以根据所述优先权及所述负荷将经过预处理的数据转发至所述主处理器件。

3.如权利要求1所述的装置,其特征在于,所述辅助处理器件包括有限的功能集合以处理数据。

4.如权利要求3所述的装置,其特征在于,所述辅助处理器件包括硬件、固件、或硬件与固件的组合,以对所述有限的功能集合执行处理。

5.如权利要求1所述的装置,其特征在于,所述辅助处理器件包括分类引擎,以对所接收的数据指派优先权。

6.如权利要求1所述的装置,其特征在于,所述主处理器件用以通过指示至少两个不同的负荷区中的一个来发送关于所述主处理器件的负荷的信息。

7.如权利要求1所述的装置,其特征在于,所述辅助处理器件用以在所述主处理器件的负荷高时舍弃具有低优先权的资料。

8.一种单芯片系统,其特征在于,包括:

数据单元处理引擎,用以接收输入数据单元,

中央处理器(CPU),

CPU队列,可操作地耦接于所述数据单元处理引擎与所述CPU之间,以及

从所述CPU至所述数据单元处理引擎的反馈路径,所述CPU用以通过所述反馈路径将所述CPU的负荷通知所述数据单元处理引擎,

其中所述数据单元处理引擎用以根据所接收数据单元的优先权及从所述CPU接收的所述负荷信息将所述数据单元选择性地转发至所述CPU队列。

9.如权利要求8所述的单芯片系统,其特征在于,所述数据单元处理引擎用以在将所述数据单元转发至所述CPU队列之前预处理所述数据单元。

10.如权利要求8所述的单芯片系统,其特征在于,所述数据单元处理引擎用以根据所述负荷信息及所述数据单元的所述优先权来舍弃未被转发至所述CPU队列的所述数据单元中的至少某些数据单元。

11.如权利要求8所述的单芯片系统,其特征在于,所述数据单元是封包。

12.如权利要求8所述的单芯片系统,其特征在于,所述数据单元处理引擎进一步包括分类引擎,以用于对所述数据单元指派优先权。

13.如权利要求8所述的单芯片系统,其特征在于,所述负荷信息选自用于指示低负荷的第一信息、用于指示中等负荷的第二信息及用于指示高负荷的第三信息。

14.如权利要求13所述的单芯片系统,其特征在于,所述优先权选自高优先权、中等优先权及低优先权,

其中在低负荷下,所有数据单元均被转发至所述CPU队列而无论所述数据单元的所述优先权如何,

其中在中等负荷下,仅将具有高优先权或中等优先权的数据单元转发至所述CPU队列,具有低优先权的数据单元则被舍弃,且

其中在高负荷下,仅将具有高优先权的数据单元转发至所述CPU队列,具有中等优先权及低优先权的数据单元则被舍弃。

15.一种方法,其特征在于,包括:

在辅助处理器件处接收数据,

在所述辅助处理器件处接收主处理器件的负荷,以及

根据所接收的所述负荷及所述数据的优先权来选择性地舍弃数据。

16.如权利要求15所述的方法,其特征在于,进一步包括根据所述负荷及所述数据的所述优先权将经过预处理的数据选择性地转发至所述主处理器件。

17.如权利要求15所述的方法,其特征在于,接收数据包括接收数据封包。

18.如权利要求15所述的方法,其特征在于,进一步包括对所接收数据指派优先权。

19.如权利要求18所述的方法,其特征在于,指派所述优先权包括以下中的至少一者:根据数据的类型指派优先权,或根据所述数据的发送方或接收方的服务类别指派所述优先权。

20.如权利要求15所述的方法,其特征在于,将所述数据转发至所述主处理器件包括:将所述数据转发至被指派给所述主处理器件的队列。

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