[发明专利]数据驱动电路、电学补偿方法、阵列基板及显示装置有效
申请号: | 201510065368.0 | 申请日: | 2015-02-06 |
公开(公告)号: | CN104637447B | 公开(公告)日: | 2017-06-27 |
发明(设计)人: | 杨飞;张晨;孟松 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | G09G3/3208 | 分类号: | G09G3/3208 |
代理公司: | 北京三高永信知识产权代理有限责任公司11138 | 代理人: | 滕一斌 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 数据 驱动 电路 电学 补偿 方法 阵列 显示装置 | ||
技术领域
本发明涉及显示技术领域,具体涉及一种数据驱动电路、电学补偿方法、阵列基板及显示装置。
背景技术
当今的市场上,消费者不仅对产品的外观和质量有苛刻的需求,而且对产品的价格和实用性有更高的关注;在显示领域,特别是有机电致发光二极管(Organic Light-Emitting Diode,OLED)显示领域,OLED显示装置因其广色域、广视角、薄型化、轻型化、低耗能、高对比度、可弯曲的出色的功能而被广泛接受,逐渐成为未来显示技术的发展方向。
然而在OLED的驱动上,每个像素内驱动TFT(Thin Film Transistor,薄膜晶体管)的阈值电压Vth不同,会导致显示画面亮度不均。为解决这一问题,现有技术常采用位于像素内部的补偿电路对Vth漂移进行补偿。但是,这样的补偿方式具有一定的局限性,即当Vth漂移幅度过大时,内部补偿电路难以进行完全补偿。然而,如果要通过外部电路进行补偿,现有技术通常会在TCON(Time Controller,时序控制电路)周围设置用于存储电学补偿数据的存储器以及用于进行数据处理的随机存储器,还会将用于传输阈值电压采集信号的信号走线引入到TCON所在电路板中,从而导致TCON板的器件布设以及走线布设复杂化,继而导致TCON板的制造成本以及OLED显示装置的制造成本的升高。
发明内容
针对现有技术中的缺陷,本发明提供一种数据驱动电路、电学补偿方法、阵列基板及显示装置,可以解决现有技术中像素内部电路的阈值电压补偿效果有限,外部电路又会导致TCON板设计复杂化的问题。
第一方面,本发明提供了一种数据驱动电路,包括:
采集模块,用于在一行像素的第一扫描信号到来的同时通过与任一列像素相连的第一信号线采集该行该列的像素的阈值电压信号;
与所述采集模块相连的转换模块,用于根据与该行该列的像素对应的外部控制信号将来自所述采集模块的所述阈值电压信号进行转换,得到补偿电压信号;
接收模块,用于接收来自时序控制电路的该行该列的像素的数据电压信号;
与所述转换模块和接收模块相连的加法模块,用于将来自所述转换模块的补偿电压信号与来自所述接收模块的数据电压信号相加,得到输出电压信号;
与所述加法模块相连的输出模块,用于在该行像素的第二扫描信号到来的同时通过与该列像素相连的第二信号线向该行该列的像素输出来自所述加法模块的输出电压信号。
可选地,所述采集模块包括与多列像素的所述第一信号线相连的第一缓冲器;所述输出模块包括与多列像素的所述第二信号线相连的第二缓冲器。
可选地,所述第一缓冲器与第一控制信号线及第二控制信号线相连,用于在第一控制信号线所接信号的触发下通过所述第一信号线采集所述阈值电压信号,并用于在第二控制信号线所接信号的触发下向所述第一信号线输出第一预设电平;
所述第二缓冲器与第三控制信号线及第四控制信号线相连,用于在所述第三控制信号线所接信号的触发下通过所述第二信号线输出所述输出电压信号,并用于在第四控制信号线所接信号的触发下向所述第二信号线输出第二预设电平。
可选地,所述加法模块与第二控制信号线及第三控制信号线相连,用于在所述第二控制信号线所接信号的触发下接收来自所述转换模块的补偿电压信号与来自所述接收模块的数据电压信号,并用于在第三控制信号线所接信号的触发下将所述输出电压信号向所述输出模块输出。
可选地,所述采集模块还包括位于所述第一缓冲器与所述转换模块之间的模数转换器;所述输出模块还包括位于所述加法模块与所述第二缓冲器之间的数模转换器。
可选地,所述数据驱动电路还包括生成模块,所述生成模块与所述第一控制信号线、所述第二控制信号线、所述第三控制信号线和所述第四控制信号线相连,用于接收来自时序控制电路的时钟信号,并根据该时钟信号分别生成所述第一控制信号线、所述第二控制信号线、所述第三控制信号线和所述第四控制信号线所接的信号,以使:
每一周期内的所述第一控制信号线所接信号的触发时刻与每一行像素的第一扫描信号的到来时刻相同;
每一周期内的所述第三控制信号线所接信号的触发时刻与每一行像素的第二扫描信号的到来时刻相同;
每一周期内的所述第二控制信号线所接信号的触发时刻介于本周期内所述第一控制信号线所接信号的触发时刻与本周期内所述第三控制信号线所接信号的触发时刻之间;
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