[发明专利]像素结构的驱动方法有效
申请号: | 201410838404.8 | 申请日: | 2015-08-04 |
公开(公告)号: | CN104505041A | 公开(公告)日: | 2015-07-29 |
发明(设计)人: | 王亚杰;周井雄;沈丁伟;周九斌 | 申请(专利权)人: | 上海天马微电子有限公司;天马微电子股份有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G02F1/1362 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 郑玮 |
地址: | 201201 上海*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 像素 结构 驱动 方法 | ||
技术领域
本发明涉及液晶显示技术领域,尤其涉及一种像素结构的驱动方法。
背景技术
RGBW液晶屏技术的原理是将一种白色(W)子像素填加到由红(R)、绿(G)、蓝(B)三色组成的传统RGB像素中,然后再应用相应的子像素成像技术,以人类看见图像的方式对那些子像素进行更好的排列,形成子像素阵列。这样就确保生成那些不能被人眼所看见的图像时,不会损耗显示屏功率及亮度源。该设计比传统RGB像素设计显示屏更明亮、分辨率更高。因为更多的背光能通过更大及半透的W子像素发光,而不是被RGB条纹采用的更小的R、G、B子像素构成的紧密排列所遮挡,透射率及亮度均得到了增加。RGBW技术的优势是提升背光源亮度的利用率,节省功耗,降低成本,并且在不降低分辨率或增加功耗使用的情况下,获得更高亮度水平。
像素阵列中,每个子像素中包括一薄膜晶体管,像素阵列显示画面过程中,需要逐行打开子像素中的薄膜晶体管的栅极,并通过每个薄膜晶体管的源极依次对薄膜晶体管进行充电,使得源极的信号输入端需要不断改变电位极性以实现正确显示画面,使得驱动功耗较大。
发明内容
本发明的目的在于,提供一种像素结构的驱动方法,通过分别驱动奇数行和偶数行的栅极线,依次打开奇数行和偶数行的子像素,减小数据线反转的次数,降低驱动功耗。
为解决上述技术问题,本发明提供一种像素结构的驱动方法,包括:
所述像素结构包括:N×M个第一像素单元与N×M个第二像素单元排布成2N×M的矩阵结构,所述第一像素单元与所述第二像素单元沿第一方向交替重复排布,第2n-1行并列排布M个所述第一像素单元,第2n行并列排布M个所述第二像素单元,所述第一像素单元包括沿第二方向依次相邻的第一子像素、第二子像素、第三子像素和第四子像素,所述第二像素单元包括沿第二方向依次相邻的第三子像素、第四子像素、第一子像素和第二子像素,每个子像素内对应设置一薄膜晶体管;与第二方向平行的2N条栅极线,第2n-1条栅极线与该行M个所述第一像素单元中的4M个薄膜晶体管的栅极连接,第2n条栅极线与该行M个所述第二像素单元中的4M个薄膜晶体管的栅极连接;
在第一时刻内,依次输出高电平到第1条、第3条、……、第2N-1条栅极线,与所述第1条、第3条、……、第2N-1条栅极线电连接的薄膜晶体管依次打开;
在第二时刻内,依次输出高电平到第2条、第4条、……、第2N条栅极线,与所述第2条、第4条、……、第2N条栅极线电连接的薄膜晶体管依次打开;
其中,n=1,2,……,N。
可选的,所述像素结构还包括与第一方向平行的4M条数据线,每条数据线依次连接该列上相邻的子像素内的2N个薄膜晶体管的源极。
可选的,在第一时刻内,第4m+1条数据线输出第一电位信号,第4m+3条数据线输出第二电位信号;在第二时刻内,第4m+1条数据线输出第二电位信号,第4m+3条数据线输出第一电位信号,m=0,1,……,M-1。
可选的,在第一时刻内与第二时刻内,第4m+2数据线和第4m+4数据线输出为第二电位信号。
可选的,所述第一电位信号为高电平,所述第二电位信号为低电平。
可选的,所述第一子像素为红色像素,所述第二子像素为绿色像素,所述第三子像素为白色像素,所述第四子像素为蓝色像素。
可选的,所述第一方向与所述第二方向垂直。
相应的,本发明中还提供一种以上所述的像素结构的驱动方法,包括:
上述的像素结构的驱动方法所需的驱动功耗为第一驱动功耗,根据需要显示的画面,计算所述第一驱动功耗;
另一像素结构驱动方法所需的驱动功耗为第二驱动功耗,计算显示相同画面的所述第二驱动功耗;
比较第一驱动功耗与第二驱动功耗的大小,如果第一驱动功耗小于等于第二驱动功耗,采用上述的像素结构的驱动方法,否则,采用像素结构的另一驱动方法;
其中,像素结构的另一驱动方法包括:依次输出高电平到第1条、第2条、……、第2N-1条、第2N条栅极线,与所述第1条、第2条、……、第2N-1条、第2N条栅极线电连接的薄膜晶体管依次打开。
可选的,像素结构的另一驱动方法中,当第2n-1行薄膜晶体管打开时,第4m+1条数据线输出第一电位信号,第4m+2、4m+3、4m+4条数据线输出第二电位信号,当第2n行薄膜晶体管打开时,第4m+3条数据线均输出为第一电位信号,第4m+1、4m+2、4m+4条数据线输出第二电位信号。
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