[发明专利]一种通用混沌系统的电路设计在审
| 申请号: | 201410443622.1 | 申请日: | 2014-09-02 |
| 公开(公告)号: | CN104184576A | 公开(公告)日: | 2014-12-03 |
| 发明(设计)人: | 王忠林 | 申请(专利权)人: | 王忠林 |
| 主分类号: | H04L9/00 | 分类号: | H04L9/00 |
| 代理公司: | 无 | 代理人: | 无 |
| 地址: | 256603 山东省滨州*** | 国省代码: | 山东;37 |
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| 摘要: | |||
| 搜索关键词: | 一种 通用 混沌 系统 电路设计 | ||
技术领域
本发明涉及一种电路设计,特别涉及一种通用混沌系统的电路设计。
背景技术
当前的混沌系统电路一般采用面包板进行电路设计,用面包板进行电路设计费时费用且出错率比较高,出错不容易检查,如采用PCB印制电路板进行设计,对应每一个混沌系统要进行一次设计,灵活度比较低,设计周期比较长,己有的通用混沌系统电路采用焊接方式,每块电路板可以设计一个混沌系统电路,但存在用板量比较大,频繁更换元件,容易引起元件的损坏。
发明内容
针对现有技术的不足,本发明提出了一种通用混沌系统的电路设计,各连接端焊接排孔,连接线可以插入排孔,反复使用,利用运算放大器U1、运算放大器U2及电阻和电容构成四组反相加法器和四组反相积分器,每组反相加法器有四路输入端,每路输入端引出四个输入信号,利用运算放大器U3及电阻和电容构成四组反相器,利用乘法器U4、U5、U6和U7分别实现乘法运算,每组输出各引出正信号和负信号2路输出,每路输出信号各引出5个输出端,所述运算放大器U1、运算放大器U2和运算放大器U3采用LF347N,所述乘法器U4和U5采用AD633JN。
所述运算放大器U1第1引脚通过电位器U1_Y_F_R接第2引脚,通过电位器U1_Y_C_R接第6引脚,第2引脚接四路输入Y_I_1R、Y_I_2R、Y_I_3R、Y_I_4R,第3、5、10、12引脚接地,第4引脚接正电源VCC,第11引脚接负电VEE,第6引脚通过电容Cy接第7引脚,第7引脚接+Y,通过电阻Y_OUT_R接Y,第8引脚接+X,通过电阻X_OUT_R接X,通过电容Cx接第9引脚,第13引脚接四路输入X_I_1R、X_I_2R、X_I_3R、X_I_4R,第14引脚通过电位器U1_X_F_R接第13引脚,通过电位器U1_X_C_R接第9引脚。
所述运算放大器U2第1引脚通过电位器U2_U_F_R接第2引脚,通过电位器U2_U_C_R接第6引脚,第2引脚接四路输入U_I_1R、U_I_2R、U_I_3R、U_I_4R,第3、5、10、12引脚接地,第4引脚接正电源VCC,第11引脚接负电VEE,第6引脚通过电容Cu接第7引脚,第7引脚接+U,通过电阻U_OUT_R接U,第8引脚接+Z,通过电阻Z_OUT_R接Z,通过电容Cz接第9引脚,第13引脚接四路输入Z_I_1R、Z_I_2R、Z_I_3R、Z_I_4R,第14引脚通过电位器U2_Z_F_R接第13引脚,通过电位器U2_Z_C_R接第9引脚。
所述运算放大器U3第1引脚连接-X,通过电位器U3_X_F_R连接第2引脚,第2引脚通过电位器U3_X_IN_R连接+X,第3、5、10、12引脚接地,第4引脚接正电源VCC,第11引脚接负电VEE,第6引脚通过电位器U3_Y_F_R接-Y,通过电位器U3_Y_IN_R接+Y,第7引脚接-Y,第8引脚接-Z,通过电位器U3_Z_F_R接第9引脚,第9引脚通过U3_Z_IN_R接+Z,第13引脚通过电位器U3_U_F_R接第14引脚,第14引脚通过电位器U3_U_IN_R接+U。
所述乘法器U4第1引脚接X_A,第2、4、6引脚接地,第3引脚接X_B,第5引脚连接负电源VEE,第7引脚接输出X_AB,第8引脚连接正电源VCC。
所述乘法器U5第1引脚接Y_A,第2、4、6引脚接地,第3引脚接Y_B,第5引脚连接负电源VEE,第7引脚接输出Y_AB,第8引脚连接正电源VCC。
所述乘法器U6第1引脚接Z_A,第2、4、6引脚接地,第3引脚接Z_B,第5引脚连接负电源VEE,第7引脚接输出Z_AB,第8引脚连接正电源VCC。
所述乘法器U7第1引脚接U_A,第2、4、6引脚接地,第3引脚接U_B,第5引脚连接负电源VEE,第7引脚接输出U_AB,第8引脚连接正电源VCC。
有益效果
本发明设计的通用混沌系统电路,既有面包板的灵活性,又具有印制PCB电路板的可靠性,同时克服了己有通用混沌电路,每一系统对应一块电路而引起的频繁更换元件的弱点,具有较强的通用性和可靠性。
附图说明
图1是本发明的结构图。
图2是本发明集成运算放大器U1的外部电路图。
图3是本发明集成运算放大器U2的外部电路图。
图4是本发明集成运算放大器U3的外部电路图。
图5是本发明乘法器U4的外部电路图。
图6是本发明乘法器U5的外部电路图。
图7是本发明乘法器U6的外部电路图。
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