[发明专利]LED显示屏驱动方法及LED电源控制电路有效

专利信息
申请号: 201410214499.6 申请日: 2014-05-20
公开(公告)号: CN103971642A 公开(公告)日: 2014-08-06
发明(设计)人: 田志辉;李家栋;张青松 申请(专利权)人: 深圳市绿源半导体技术有限公司;深圳市达明视讯科技开发有限公司
主分类号: G09G3/32 分类号: G09G3/32
代理公司: 深圳市博锐专利事务所 44275 代理人: 张明
地址: 518000 广东省深圳*** 国省代码: 广东;44
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摘要:
搜索关键词: led 显示屏 驱动 方法 电源 控制电路
【权利要求书】:

1.一种LED显示屏驱动方法,其特征在于:它包括,

逐行驱动LED显示屏进行上电的行驱动步骤;

于驱动LED显示屏的每两行的行驱动时间间隙,将驱动LED显示屏完成扫描的行的寄生电荷泄放的电荷消除步骤。

2.如权利要求1所述的LED显示屏驱动方法,其特征在于:所述行驱动步骤于接收到输入数据信号时,在间隔输入信号出现下降沿至间隔输入信号出现上升沿的过程中执行。

3.如权利要求1所述的LED显示屏驱动方法,其特征在于:所述电荷消除步骤中根据触发信号将驱动LED显示屏完成扫描的行的寄生电荷泄放。

4.如权利要求3所述的LED显示屏驱动方法,其特征在于:所述电荷消除步骤具体包括步骤,

S1)、初始化至少两个锁存输出为低电平/高电平;所述锁存输出与驱动LED显示屏进行驱动的行数相对应;

S2)、接收到输入数据信号;

S3)、待移位时钟信号出现时,将首个锁存输出变为高电平/低电平;

S4)、待移位时钟信号再次出现时,将当前的锁存输出变为低电平/高电平并将下一个锁存输出变为高电平/低电平;

S5)、待驱动LED显示屏的上一行的行驱动结束至移位时钟信号再次出现之间执行步骤S6;

S6)、对当前为高电平/低电平的锁存输出对应的LED显示屏的行作为驱动LED显示屏完成扫描的行进行寄生电荷泄放。

5.如权利要求3所述的LED显示屏驱动方法,其特征在于:所述行驱动步骤具体包括,待移位时钟信号与间隔输入信号同时消失至间隔输入信号再次出现时当前为高电平/低电平的锁存输出对应的LED显示屏的行进行驱动。

6.一种LED电源控制电路,其特征在于:它包括控制模块及驱动消隐模块;所述驱动消隐单元包括多组开关单元与消隐单元;所述开关单元设有电源输入端、LED显示屏行驱动输出端及控制端;所述开关单元的控制端与控制模块相连;所述消隐单元设有输入端、泄放端及使能端,消隐单元的输入端与开关单元的LED显示屏行驱动输出端相连,泄放端接地,使能端与控制模块相连;

所述控制模块,用于逐一控制驱动消隐模块中每组开关单元的控制端,从而逐行驱动LED显示屏进行上电的行驱动,并于驱动LED显示屏的每两行的行驱动时间间隙,使能该组中消隐单元的使能端从而将驱动LED显示屏完成扫描的行的寄生电荷泄放至地。

7.如权利要求6所述的LED电源控制电路,其特征在于:所述驱动消隐模块的每组的开关单元包括第一MOS管;消隐单元包括第二MOS管及泄放电阻,所述泄放电阻连接第二MOS管的泄放端与地之间。

8.如权利要求6所述的LED电源控制电路,其特征在于:所述控制模块设有间隔输入信号端及移位时钟信号端。

9.如权利要求8所述的LED电源控制电路,其特征在于:它还包括移位锁存器,移位锁存器设有输入数据信号端、移位时钟信号端、第一锁存输出端及第二锁存输出端;所述驱动消隐模块包括两组开关单元与消隐单元;所述移位寄存器的第一锁存输出端及第二锁存输连接控制模块;

所述移位锁存器包括第一触发器及第二触发器,所述移位时钟信号端分别连接第一触发器及第二触发器的输入端,第一触发器输入还连接输入数据信号端、输出连接第一锁存输出端及第二触发器的输入,第二触发器输出连接第二锁存输出端;

所述控制模块包括第一或门、第一与门、第二或门及第二与门;

移位锁存器对输入的输入数据信号锁存、移位进而作为驱动两路开关单元的触发;

所述第一或门正向输入连接间隔输入信号端、移位时钟信号端及第二锁存输出端,反向输入连接第一锁存输出端,输出连接第一组开关单元的控制端;

所述第一与门的正向输入连接间隔输入信号端及第一锁存输出端,反向输入连接移位时钟信号端及第二锁存输出端,输出连接第一组消隐单元的使能端;

所述第二或门的正向输入连接间隔输入信号端、第一锁存输出端及移位时钟信号端,反向输入第二锁存输出端,输出连接第二组开关单元的控制端;

所述第二与门正向输入间隔输入信号端及第二锁存输出端,反向输入移位时钟信号端及第一锁存输出端,输出连接第二组消隐单元的使能端。

10.如权利要求9所述的LED电源控制电路,其特征在于:它还包括保护模块,所述保护模块包括第三非门及第三与门,所述第三非门的输入连接第一锁存输出端,输出连接第三与门输入,第三与门输入还与第二锁存输出端相连,输出连接有输出数据信号端。

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