[实用新型]一种基于硬件加密数据的装置有效
申请号: | 201320042801.5 | 申请日: | 2013-01-25 |
公开(公告)号: | CN203119915U | 公开(公告)日: | 2013-08-07 |
发明(设计)人: | 余菲;项智 | 申请(专利权)人: | 深圳职业技术学院 |
主分类号: | H04L9/00 | 分类号: | H04L9/00 |
代理公司: | 深圳市科吉华烽知识产权事务所(普通合伙) 44248 | 代理人: | 胡吉科;孙伟 |
地址: | 518055*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 基于 硬件 加密 数据 装置 | ||
1.一种基于硬件加密数据的装置,其特征在于,包括在外部信号作用下产生指令的指令产生模块、接收所述指令产生模块输出的指令并将其转换为控制信号输出的模式控制模块、在所述模式控制模块输出的控制信号的作用下产生并输出数据流的混沌数据流产生模块、将所述混沌数据流产生模块输出的数据流与需要加密的数据进行逻辑运算得到加密后的数据并输出的逻辑处理模块以及时钟模块;所述混沌数据流产生模块和逻辑处理模块通过其数据输入或输出端口依次连接;所述指令产生模块和模式控制模块之间通过指令接口连接;所述模式控制模块和所述混沌数据流产生模块之间通过控制信号端口连接;所述时钟模块通过时钟总线分别与所述模式控制模块、混沌数据流产生模块、逻辑处理模块连接,提供时钟信号。
2.根据权利要求1所述的基于硬件的加密数据的装置,其特征在于,所述指令产生模块、模式控制模块、混沌数据流产生模块、逻辑处理模块和时钟模块设置在同一电路板上或同一基体上;所述模块之间通过设置在所述电路板上的铜箔或设置在基体上的导体连接。
3.根据权利要求2所述的基于硬件的加密数据的装置,其特征在于, 所述逻辑处理模块为将其接收到的需要加密的数据和所述混沌数据流产生模块输出的数据流进行异或运算的逻辑运算模块。
4.根据权利要求3所述的基于硬件加密数据的装置,其特征在于,所述混沌数据流产生模块进一步包括初始密码存储单元、密码映射单元、随机种子存储单元、多路选择器单元、补码取得单元、随机数映射单元、并行乘法器、混沌信号映射单元以及第四寄存器;其中,所述密码映射单元取得所述初始密码存储单元输出的其存储的初始密码,并对其进行映射处理;所述密码映射单元的输出连接在所述并行乘法器的一个输入端;所述随机种子存储单元输出其存储的随机种子到所述多路选择器单元,所述多路选择器单元在作为其输入的所述随机种子或第四寄存器输出中选择一个输送到所述补码取得单元;同时所述多路选择器单元的输出还连接到所述随机数映射单元的一个输入端;所述随机数映射单元的另一个输入端与所述补码取得单元的输出连接;所述随机数映射单元对其输入进行处理后将处理后输出,该输出端连接在所述并行乘法器的另一个输入端,所述并行乘法器对其输入进行运算后输出到所述混沌信号映射单元,所述混沌信号映射单元对接收到的混沌信号进行映射并输出;所述混沌信号映射单元的输出端还与所述第四寄存器输入端连接。
5.根据权利要求4所述的基于硬件加密数据的装置,其特征在于,所述密码映射单元进一步包括依次连接的对所述初始密码进行乘法和加法运算的密码映射器和对所述密码映射器输出进行暂存并延迟一个时钟节拍后输出的第一寄存器。
6.根据权利要求5所述的基于硬件加密数据的装置,其特征在于,所述密码映射器为依次连接的累加乘法器和串行进位加法器。
7.根据权利要求6所述的基于硬件加密数据的装置,其特征在于, 所述随机数映射单元进一步包括依次连接的用于对所述多路选择器单元的输出和所述补码取得单元的输出进行乘法运算的第一乘法单元和对所述第一乘法单元输出进行暂存并延迟一个时钟节拍后输出的第二寄存器。
8.根据权利要求7所述的基于硬件加密数据的装置,其特征在于,所述第一乘法单元由依次连接的并行乘法器和超前进位加法器构成。
9.根据权利要求8所述的基于硬件加密数据的装置,其特征在于, 所述随机种子存储单元包括独立的第一随机种子存储单元和第二随机种子存储单元,所述第一随机种子存储单元的输出端和所述第二随机种子存储单元的输出端分别与所述多路选择器单元的不同输入端连接。
10.根据权利要求9所述的基于硬件加密数据的装置,其特征在于,所述并行乘法器包括依次连接的第二乘法器单元、第三寄存器和第三乘法器单元。
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