[发明专利]一种阵列基板驱动电路、阵列基板及相应的液晶显示器有效

专利信息
申请号: 201310730254.4 申请日: 2013-12-26
公开(公告)号: CN103730093B 公开(公告)日: 2017-02-01
发明(设计)人: 徐向阳 申请(专利权)人: 深圳市华星光电技术有限公司
主分类号: G09G3/36 分类号: G09G3/36;G02F1/1362;G02F1/1368;G02F1/133
代理公司: 深圳汇智容达专利商标事务所(普通合伙)44238 代理人: 潘中毅,熊贤卿
地址: 518132 广东*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 阵列 驱动 电路 相应 液晶显示器
【说明书】:

技术领域

发明涉及薄膜晶体管液晶显示器(Thin Film Transistor liquid crystal display,TFT-LCD)领域,特别涉及一种阵列基板驱动电路、阵列基板及相应的液晶显示器。

背景技术

液晶显示器技术有了飞速的发展,从屏幕的尺寸到显示的质量都取得了极大的进步,液晶显示器具有体积小、功耗低、无辐射等特点,现已占据了平面显示领域的主导地位。随着液晶显示技术的发展,高分辨率、高对比度、高刷新速率、窄边框、薄型化已成为液晶显示器的发展趋势;

目前常采用TFT(Thin Film Transistor,薄膜晶体管)来设置GoA(Gate On Array,阵列栅驱动)电路,为了实现液晶显示面板的窄边框、薄型化和低成本简化GoA电路和缩小GoA电路面积已非常重要。

如图1所示,示出了现有技术中采用单边驱动的阵列基板驱动电路的结构示意图;在该种单边驱动的阵列基板中,每一行对应一个GoA驱动单元,通常GoA驱动单元都采用7个以上的TFT晶体管,对于GoA电路的面板一侧,边框设计就会较宽,这样不利于窄边框设计。

如图2所示,示出了现有技术中采用双边驱动的阵列基板驱动电路的结构示意图;在该种双边驱动的阵列基板中,其为对称结构,每一行采用两个GoA驱动单元进行双边驱动,这种设计的优点是提高栅极驱动能力,缺点是电路复杂,GoA驱动单元占用面积较大,更加不利于窄边框设计。

发明内容

本发明所要解决的技术问题在于,提供一种阵列基板驱动电路、阵列基板及相应的液晶显示器,可以减少阵列基板驱动电路所占的面积,利于液晶显示器的窄边框设计。

为了解决上述技术问题,本发明的实施例的一方面提供了一种阵列基板驱动电路,包括多个用于驱动阵列基板的栅线的GoA驱动单元,其中,每一GoA驱动单元连接一条栅线;

奇数行的栅线所连接的GoA驱动单元设置在所述阵列基板的一侧,偶数行的栅线所连接的GoA驱动单元设置在所述阵列基板的另一侧;

所述每一GoA驱动单元均具有第一驱动信号输入端、第二驱动信号输入端以及一个输出端,所述第一驱动信号输入端与上级GoA驱动单元的输出端相连,所述第二驱动信号输入端与下级GoA驱动单元的输出端相连,与所述GoA驱动单元连接栅线连接在所述输出端上。

其中,每一GoA驱动单元包括第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管和储存电容,其中:

第一薄膜晶体管的源极和栅极均与上级GoA驱动单元的信号输出端相连接,其漏极分别与第二薄膜晶体管的栅极、储存电容的一端、第三薄膜晶体管的漏极相连接;

第二薄膜晶体管的源极与时钟信号输出端相连接,其栅极与储存电容的第一端相连接,其漏极与本级信号输出端、第四薄膜晶体管的源极、储存电容的第二端相连接;

第三薄膜晶体管的源极与储存电容的第一端连接,其栅极连接下级GoA驱动单元的信号输出端,其源极接低电位输入线或接地;

第四薄膜晶体管的源极与本级信号输出端和储存电容的第二端相连,其栅极连接下级GoA驱动单元的信号输出端,其漏极接低电位输入线或接地。

其中,所述奇数行的各栅线所连接的各GoA驱动单元所连接的时钟信号输出端为第一时钟信号的输出端,所述偶数行的各栅线所连接的各GoA驱动单元所连接的信号输出端为第二时钟信号的输出端,所述第一时钟信号与所述第二时钟信号周期长度相同,相位相差半个周期。

其中,位于最前端的GoA驱动单元的所述第一驱动信号输入端连接有一扫描触发信号线,用于触发所述位于最前端的GoA驱动单元开始工作。

相应地,本发明实施例的另一方面提供一种液晶显示器的阵列基板,包括由栅线和数据线限定的多个像素单元,每个像素单元内形成薄膜晶体管和像素电极;进一步包括有用于驱动所述栅线的阵列基板驱动电路,其特征在于,所述驱动电路包括多个GoA驱动单元,其中,每一GoA驱动单元的输出端连接一条栅线;

奇数行的栅线所连接的GoA驱动单元设置在所述阵列基板的一侧,偶数行的栅线所连接的GoA驱动单元设置在所述阵列基板的另一侧;

所述每一GoA驱动单元均具有第一驱动信号输入端、第二驱动信号输入端以及一个输出端,所述第一驱动信号输入端与上级GoA驱动单元的输出端相连,所述第二驱动信号输入端与下级GoA驱动单元的输出端相连,与所述GoA驱动单元连接栅线连接在所述输出端上。

其中,每一GoA驱动单元包括第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管和储存电容,其中:

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