[发明专利]用于液晶显示的GOA电路及显示装置有效
申请号: | 201310700186.7 | 申请日: | 2013-12-18 |
公开(公告)号: | CN103680451A | 公开(公告)日: | 2014-03-26 |
发明(设计)人: | 虞晓江;李长晔;赖梓杰 | 申请(专利权)人: | 深圳市华星光电技术有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36 |
代理公司: | 深圳市德力知识产权代理事务所 44265 | 代理人: | 林才桂 |
地址: | 518132 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 用于 液晶显示 goa 电路 显示装置 | ||
技术领域
本发明涉及液晶显示技术领域,尤其涉及一种用于液晶显示的GOA(Gate Driver on Array,阵列基板行驱动)电路及显示装置。
背景技术
液晶显示器具有机身薄、省电、无辐射等众多优点,得到了广泛的应用。现有市场上的液晶显示器大部分为背光型液晶显示器,其包括液晶面板及背光模组(backlight module)。液晶面板的工作原理是在两片平行的玻璃基板当中放置液晶分子,并在两片玻璃基板上施加驱动电压来控制液晶分子的旋转方向,以将背光模组的光线折射出来产生画面。
主动式液晶显示器中,每个像素具有一个薄膜晶体管(TFT),其栅极(Gate)连接至水平扫描线,漏极(Drain)连接至垂直方向的数据线,源极(Source)则连接至像素电极。在水平扫描线上施加足够的电压,会使得该条线上的所有TFT打开,此时该水平扫描线上的像素电极会与垂直方向的数据线连接,从而将数据线上的显示信号电压写入像素,控制不同液晶的透光度进而达到控制色彩的效果。目前主动式液晶显示面板水平扫描线的驱动主要由面板外接的IC来完成,外接的IC可以控制各级水平扫描线的逐级充电和放电。而GOA技术,即Gate Driver on Array(阵列基板行驱动)技术,可以运用液晶显示面板的原有制程将水平扫描线的驱动电路制作在显示区周围的基板上,使之能替代外接IC来完成水平扫描线的驱动。GOA技术能减少外接IC的绑定(bonding)工序,有机会提升产能并降低产品成本,而且可以使液晶显示面板更适合制作窄边框或无边框的显示产品。
现有的GOA电路,通常包括级联的多个GOA单元,每一级GOA单元对应驱动一级水平扫描线。GOA单元的主要结构包括上拉电路(Pull-up part),上拉控制电路(Pull-up control part),下传电路(Transfer Part),下拉电路(Key Pull-down Part)和下拉维持电路(Pull-down Holding Part),以及负责电位抬升的自举(Boast)电容。上拉电路主要负责将时钟信号(Clock)输出为栅极(Gate)信号;上拉控制电路负责控制上拉电路的打开时间,一般连接前面级GOA电路传递过来的下传信号或者Gate信号;下拉电路负责在第一时间将Gate拉低为低电位,即关闭Gate信号;下拉维持电路则负责将Gate输出信号和上拉电路的Gate信号(通常称为Q点)维持(Holding)在关闭状态(即负电位),通常有两个下拉维持模块交替作用;自举电容(C boast)则负责Q点的二次抬升,这样有利于上拉电路的G(N)输出。
GOA电路的目的就是将集成电路输出的扫描波形通过电路操作的方式输出,使像素开关打开从而可以向氧化铟锡(ITO)电极输入数据信号。数据信号输入完后将数据信号内容保持住直到下一帧的开启。在电路操作过程中,因一条扫描电路打开过后在一帧剩余的时间里都是关闭的,扫描电路关闭(保持)时间比扫描时间长很多,对GOA电路中的薄膜晶体管稳定特定要求很高。为保证GOA电路充电信号的稳定输出,亟需GOA电路中影响水平扫描线充电的薄膜晶体管的栅极Q(n)的电压能够得到准确控制的解决方案。
发明内容
因此,本发明的目的在于提供一种用于液晶显示的GOA电路,实现通过低频时钟信号和高频时钟信号来准确控制影响水平扫描线充电的薄膜晶体管的栅极Q(n)电压,从而保证GOA充电信号的稳定输出。
本发明的另一目的在于提供一种应用上述GOA电路的液晶显示装置,实现通过低频时钟信号和高频时钟信号来准确控制影响水平扫描线充电的薄膜晶体管的栅极Q(n)电压,从而保证GOA充电信号的稳定输出。
为实现上述目的,本发明提供了一种用于液晶显示的GOA电路,包括级联的多个GOA单元,按照第n级GOA单元控制对显示区域第n级水平扫描线充电,该第n级GOA单元包括上拉电路、下拉电路、下拉维持电路、上拉控制电路及自举电容,该上拉电路、下拉电路、下拉维持电路及自举电容分别与栅极信号点和该第n级水平扫描线连接,该上拉控制电路与该栅极信号点连接;
该下拉维持电路包括:
第一薄膜晶体管,其栅极连接第一电路点,漏极和源极分别连接该第n级水平扫描线和输入直流低电压;
第二薄膜晶体管,其栅极连接第二电路点,漏极和源极分别连接该第n级水平扫描线和输入该直流低电压;
第三薄膜晶体管,其栅极连接该栅极信号点,漏极和源极分别连接该第一电路点和输入该直流低电压;
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