[发明专利]传输效率高的FC网络仿真卡无效
申请号: | 201310365834.8 | 申请日: | 2013-08-21 |
公开(公告)号: | CN103414572A | 公开(公告)日: | 2013-11-27 |
发明(设计)人: | 胡钢;邱昆 | 申请(专利权)人: | 成都成电光信科技有限责任公司 |
主分类号: | H04L12/02 | 分类号: | H04L12/02;H04L12/26 |
代理公司: | 成都行之专利代理事务所(普通合伙) 51220 | 代理人: | 谢敏 |
地址: | 610000 四*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 传输 效率 fc 网络 仿真 | ||
技术领域
本发明涉及网络端口领域,具体涉及传输效率高的FC网络仿真卡。
背景技术
传输效率高的FC网络仿真卡用于根据FC协议的定义,实现数据通信。具体包括将来自用户软件的数据封装成FC帧,根据发送协议要求,发送到FC网络中;从FC网络接收本端口的FC帧,解析出用户数据,提交到用户软件。在双端口通信中,系统要求两个独立的双端口,能独立的进行数据通信,能够分别一个网络设备。由于FC仿真卡采用一个PCIE接口传输两个端口的数据,需要进行两个端口的数据区分。单端口通信时双向数据带宽发送速率160MB/s,接收180M/s;双端口通信时各端口双向数据带宽发送速率120MB/s,接收速率160MB/s。面对以上带宽要求,如何提高PCIE的传输效率是保证带宽的关键。现有技术中还无法实现识别数据来自的端口,也就无法说明数据是发往哪个端口,只能同时对两个端口进行传输,降低传输速率。
发明内容
本发明克服了现有技术的不足,提供传输效率高的FC网络仿真卡,能够通过接口适配器对测试端口信息进行识别判断,并将处理信息发送给中央处理器,提高传输效率。
为解决上述的技术问题,本发明采用以下技术方案:传输效率高的FC网络仿真卡,包括中央处理器、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA,所述的接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接; 所述的接口测试适配器上连接多个测试端口。
所述的现场可编程门阵列FPGA上连接光收发模块。
所述的光收发模块的型号为FTRJ-8519-1-2.5。
所述的现场可编程门阵列FPGA上连接数据缓冲存储器FLASH、静态随机存储器SRAM和PCI-EXPRESS X4接口。
所述的第一参考时钟芯片的型号为MAX DS4106。
所述的第二参考时钟芯片的型号为MAX DS4212。
与现有技术相比,本发明的有益效果是:
1、 本发明的接口测试适配器可以是AD转换器与编解码芯片构成,通过接口测试适配器对从测试接口接收的数据进行处理并发送到中央处理器,实现对测试接口信息的识别和有效传输,提高传输效率。
2、 本发明中的光收发模块是一种电信号转换为光信号的接口器件,实现对光电信号的任意转换。
附图说明
图1为本发明的原理图。
具体实施方式
下面结合附图对本发明作进一步阐述,本发明的实施例不限于此。
实施例:
如图1所示,本发明包括中央处理器、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA,现场可编程门阵列FPGA上连接光收发模块,光收发模块的型号为FTRJ-8519-1-2.5。现场可编程门阵列FPGA上连接数据缓冲存储器FLASH、静态随机存储器SRAM和PCI-EXPRESS X4接口。本实施例的接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接;所述的接口测试适配器上连接多个测试端口。第一参考时钟芯片的型号为MAX DS4106,第二参考时钟芯片的型号为MAX DS4212,FPGA的型号为XC5VLX110T,中央处理器的型号为ARMCORTEX M3。
传输效率高的FC网络仿真卡具有两个数据传输接口,通过接口测试适配器对从测试接口接收的数据进行处理并发送到中央处理器,接口测试适配器可以是AD转换器与编解码芯片构成。其中的接口测试适配器能够对测试端口的信息进行识别,进行数据的有效传输,提高了传输效率。
如上所述便可实现该发明。
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