[发明专利]电源电路无效

专利信息
申请号: 201310276479.7 申请日: 2013-07-03
公开(公告)号: CN104283447A 公开(公告)日: 2015-01-14
发明(设计)人: 陈开富;许杰森;曾创炜;陈哲训 申请(专利权)人: 鸿富锦精密工业(深圳)有限公司;鸿海精密工业股份有限公司
主分类号: H02M7/48 分类号: H02M7/48
代理公司: 暂无信息 代理人: 暂无信息
地址: 518109 广东省深圳市*** 国省代码: 广东;44
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摘要:
搜索关键词: 电源 电路
【权利要求书】:

1.一种直交流转换电路,包括一控制器、一第一直流电源、一第二直流电源、一第一电子开关、一第二电子开关、一第一输出端及一第二输出端,所述第一及第二电子开关的第一端均与所述控制器相连,所述第一电子开关的第二端与所述第一直流电源的正极相连,所述第一电子开关的第三端与所述第一输出端相连,所述第二电子开关的第二端与所述第一输出端相连,所述第二电子开关的第三端与所述第二直流电源的负极相连,所述第一直流电源的负极与所述第二直流电源的正极相连并与所述第二输出端相连,所述控制器控制所述第一及第二电子开关的导通及截止,以使所述第一输出端与所述第二输出端之间输出的交流电的周期与市电的周期相等,且所述交流电在一个周期内的电压绝对值的平均值与市电在一个周期内的电压绝对值的平均值相等。

2.如权利要求1所述的直交流转换电路,其特征在于:所述第一直流电源的电压与所述第二直流电源的电压相等,所述控制器控制所述第一电子开关在相位区间2kπ+φ至(2k+1)π-φ内导通,并控制所述第二电子开关在相位区间(2k+1)π+φ至2(k+1)π-φ内导通,其中,φ=(V1-V2)π/2V1,V1>V2,V1为第一及第二直流电源的电压,V2为市电在一个周期内的电压绝对值的平均值,k为整数。

3.如权利要求1所述的直交流转换电路,其特征在于:所述第一及第二电子开关均为NMOS管,所述第一及第二电子开关的第一端、第二端及第三端分别对应于NMOS管的栅极、漏极及源极。

4.如权利要求1所述的直交流转换电路,其特征在于:所述第一及第二输出端之间并联一滤波电容及一负载。

5.一种直交流转换电路,包括一控制器、一第一直流电源、一第二直流电源、第一至第六电子开关及第一至第四输出端,所述第一至第六电子开关的第一端均与所述控制器相连,所述第一至第三电子开关的第二端均与所述第一直流电源的正极相连,所述第一电子开关的第三端与所述第一输出端相连,所述第二电子开关的第三端与所述第二输出端相连,所述第三电子开关的第三端与所述第三输出端相连,所述第四电子开关的第二端与所述第一输出端相连,所述第五电子开关的第二端与所述第二输出端相连,所述第六电子开关的第二端与所述第三输出端相连,所述第四至第六电子开关的第三端均与所述第二直流电源的负极相连,所述第一直流电源的负极与所述第二直流电源的正极相连并与所述第四输出端相连,所述控制器控制所述第一至第六电子开关的导通及截止,以使所述第一输出端与所述第四输出端之间输出的第一相交流电的周期、所述第二输出端与所述第四输出端之间输出的第二相交流电的周期及所述第三输出端与所述第四输出端之间输出的第三相交流电的周期均与市电的周期相等,所述第一相至第三相交流电在一个周期内的电压绝对值的平均值均与市电在一个周期内的电压绝对值的平均值相等,且所述第一相交流电与所述第二相交流电的相位相差2π/3,所述第二相交流电与所述第三相交流电的相位相差2π/3,所述第三相交流电与所述第一相交流电的相位相差2π/3。

6.如权利要求5所述的直交流转换电路,其特征在于:所述第一直流电源的电压与所述第二直流电源的电压相等,所述控制器控制所述第一电子开关在相位区间2kπ+φ至(2k+1)π-φ内导通,所述第二电子开关在相位区间(6k+2)π/3+φ至(6k+5)π/3-φ内导通,所述第三电子开关在相位区间(6k+4)π/3+φ至(6k+8)π/3-φ内导通,所述第四电子开关在相位区间(2k+1)π+φ至2(k+1)π-φ内导通,所述第五电子开关在相位区间(6k+5)π/3+φ至(6k+8)π/3-φ内导通,所述第六电子开关在相位区间(6k+7)π/3+φ至(6k+10)π/3-φ内导通,其中,φ=(V1-V2)π/2V1,V1>V2,V1为第一及第二直流电源的电压,V2为市电在一个周期内的电压绝对值的平均值,k为整数。

7.如权利要求5所述的直交流转换电路,其特征在于:所述第一至第六电子开关均为NMOS管,所述第一至第六电子开关的第一端、第二端及第三端分别对应于NMOS管的栅极、漏极及源极。

8.如权利要求5所述的直交流转换电路,其特征在于:所述第一输出端与所述第四输出端之间并联一第一滤波电容及一第一负载,所述第二输出端与所述第四输出端之间并联一第二滤波电容及一第二负载,所述第三输出端与所述第四输出端之间并联一第三滤波电容及一第三负载。

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