[发明专利]高清视频格式的数据传输集成接口有效

专利信息
申请号: 201310047246.X 申请日: 2013-02-05
公开(公告)号: CN103118257A 公开(公告)日: 2013-05-22
发明(设计)人: 张源源 申请(专利权)人: 广东威创视讯科技股份有限公司
主分类号: H04N7/26 分类号: H04N7/26;H04N7/01
代理公司: 广州华进联合专利商标代理有限公司 44224 代理人: 王茹;曾旻辉
地址: 510663 广东省广*** 国省代码: 广东;44
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摘要:
搜索关键词: 视频格式 数据传输 集成 接口
【权利要求书】:

1.一种高清视频格式的数据接口发送装置,其特征在于:

与视频格式数据输入端口相连的视频数据编码模块,该模块具体包括与所述输入端口相连的CRC编码单元,与该CRC编码单元相连的首尾标志位添加单元,与该首尾标志位添加单元相连的数据位宽转换单元;

连接在所述视频数据编码模块与视频数据处理模块之间的发送先入先出模块;

所述视频数据处理模块,具体包括通过所述发送先入先出模块与所述数据位宽转换单元相连的环形寄存器,与该环形寄存器相连的发送串行解串器,与所述发送串行解串器、所述环形寄存器分别相连的控制码添加单元。

2.根据权利要求1所述的高清视频格式的数据接口发送装置,其特征在于:所述控制码添加单元,包括时钟修正码生成单元、同步码生成单元和通道绑定单元,其中,还包括:

与所述时钟修正码生成单元相连的优先发送单元,用于设定每隔预设时间连续发送预设数个时钟修正控制码。

3.根据权利要求2所述的高清视频格式的数据接口发送装置,其特征在于:所述控制码添加单元,还包括:

与所述环形寄存器、所述优先发送单元分别相连的滞后发送单元,用于检测环形寄存器的溢满状态,以及时钟修正控制码的发送状态;该滞后发送单元还与同步码生成单元、通道绑定单元分别相连,用于在环形寄存器未满且时钟修正控制码为空余状态时,发送同步码或通道绑定码。

4.一种高清视频格式的数据接口接收装置,其特征在于:

通过物理链路与数据接口发送装置相连的视频数据接收模块,该模块具体包括与所述发送串行解串器相对应的接收串行解串器,与该接收串行解串器相连的数据逻辑提取单元;

连接在所述视频数据接收模块与视频数据解码模块之间的接收先入先出模块;

所述视频数据解码模块,具体包括通过所述接收先入先出模块与所述数据逻辑提取单元相连的数据位宽还原单元,与该数据位宽还原单元相连的首尾标志位去除单元,与该首尾标志位去除单元相连的CRC解码单元,与该CRC解码单元相连的视频格式数据输出端口。

5.根据权利要求4所述的高清视频格式的数据接口接收装置,其特征在于,所述视频数据接收模块,还包括:

连接在所述接收串行解串器、所述数据逻辑提取单元之间的高低字节调整单元,用于在接收侧的字节顺序与发送侧不相同时,根据接收到的字符同步码、通道对齐码的高低字节和对应的控制码进行高低字节的校正。

6.根据权利要求4或5所述的高清视频格式的数据接口接收装置,其特征在于,所述视频数据接收模块,还包括:

与所述接收串行解串器相连的时钟管理单元;与所述接收串行解串器相连的复位管理单元。

7.一种高清视频格式的数据传输集成接口,其特征在于,包括:

如权利要求1至3任一项所述的高清视频格式的数据接口发送装置;

如权利要求4至6任一项所述的高清视频格式的数据接口接收装置;

所述发送串行解串器和所述接收串行解串器共用一组serdes芯片;

发送侧的所述发送装置与接收侧对应的接收装置通过物理链路相连;

接收侧的所述接收装置与发送侧对应的发送装置通过物理链路相连。

8.根据权利要求7所述的高清视频格式的数据传输集成接口,其特征在于:所述发送先入先出模块和/或所述接收先入先出模块为异步FIFO存储器。

9.根据权利要求7或8所述的高清视频格式的数据传输集成接口,其特征在于:所述一组serdes芯片包括两片级联的serdes芯片。

10.根据权利要求9所述的高清视频格式的数据传输集成接口,其特征在于,还包括:与所述serdes芯片相连的均衡参数配置单元。

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