[发明专利]一种互补码键控译码电路无效
申请号: | 201310001118.1 | 申请日: | 2013-01-04 |
公开(公告)号: | CN103078708A | 公开(公告)日: | 2013-05-01 |
发明(设计)人: | 赵元;陈继承 | 申请(专利权)人: | 浪潮(北京)电子信息产业有限公司 |
主分类号: | H04L1/00 | 分类号: | H04L1/00 |
代理公司: | 北京安信方达知识产权代理有限公司 11262 | 代理人: | 栗若木;曲鹏 |
地址: | 100085 北京市海*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 互补 键控 译码 电路 | ||
1.一种互补码键控译码电路,其特征在于:所述译码电路包括数据采样接收模块(1)、互补码键控解调模块(2)、寄存比较模块(3)和状态控制器(4),
所述数据采样接收模块(1),用于依次对接收到的互补码键控CCK中的符号进行采样,并将采样获得的符号转换为码片;
所述互补码键控解调模块(2),用于接收所述数据采样接收模块(1)发送的码片,并对所述的码片按照CCK编码调制规则进行相位旋转,遍历所有相位取值,利用相位取值对接收的码片进行相关,获得相关值;
所述寄存比较模块(3),用于暂存相关值,并且通过比较所暂存的所有相关值获得最大相关峰和最大相关峰值所对应的相位取值;
所述状态控制器(4),用于在互补码键控解调模块(2)遍历所有相位取值后,控制寄存比较模块(3)输出所述最大相关峰和最大相关峰值所对应的相位取值,并且在每一次获得所述最大相关峰和最大相关峰值后,清除寄存比较模块(3)暂存的所有相关值、最大相关峰和最大相关峰值所对应的相位取值。
2.如权利要求1所述的译码电路,其特征在于:所述CCK编码调制规则为:
CCK码片为(c0,c1,c2,c3,c4,c5,c6,c7),则接收信号RLIJK
其中L,I,J,K=0,1,2,3。
3.如权利要求1所述的译码电路,其特征在于:所述译码电路还包括均衡模块(5),
所述均衡模块(5)用于根据寄存比较模块(3)输出的最大相关峰和最大相关峰值所对应的相位取值对所述数据采样接收模块(1)发送的码片做均衡处理,消除多径效应,获得均衡码片;
所述互补码键控解调模块(2),接收所述均衡模块(5)发送的均衡码片,并对所述均衡码片按照CCK编码调制规则进行相位旋转,遍历所有相位取值,利用相位取值对接收的码片进行相关,获得相关值。
4.如权利要求1所述的译码电路,其特征在于:所述数据采样接收模块(1),将采样获得的符号转换为并行码片。
5.如权利要求1所述的译码电路,其特征在于:
互补码键控解调模块(2)包括一阶解调电路、二阶解调电路及三阶解调电路,
其中一阶解调电路用于对输入的第n个码片分别进行相位旋转,并将相位旋转的结果分别与第n+1个码片相加,输出一阶加和结果,其中n=1,3,5,7;
二阶解调电路用于对第m个一阶解调电路输出的4个一阶加和结果分别进行相位旋转,并将相位旋转的结果分别与第m+1个一阶解调电路输出的4个加和结果相加,输出二阶加和结果,其中m=1,3;
三阶解调电路用于对第k个二阶解调电路输出的4个二阶加和结果进行相位旋转,并将相位旋转的结果分别与第k+4个二阶解调电路输出的4个加和结果相加,输出相关值,其中k=1,2,3,4。
6.如权利要求5所述的译码电路,其特征在于:
一阶解调电路包括(4)个第一基本乘加逻辑单元电路(2-1),二阶解调电路包括8个第一基本乘加逻辑单元电路(2-1),三阶解调电路包括16个第一基本乘加逻辑单元电路(2-1),所述第一基本乘加逻辑单元电路(2-1)包括一个第一相位旋转电路和四个复数加法器,所述第一相位旋转电路用于对一路输入的数据进行相位旋转,每个复数加法器分别与一路第一相位旋转电路的输出端相连,用于将一个相位旋转的结果与另一路输入的数据相加,输出加和结果。
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