[发明专利]用于测试半导体器件的接触件的制造方法有效

专利信息
申请号: 201280014404.5 申请日: 2012-06-25
公开(公告)号: CN103443633A 公开(公告)日: 2013-12-11
发明(设计)人: 尹璟燮 申请(专利权)人: 硅谷有限公司
主分类号: G01R1/04 分类号: G01R1/04;G01R31/26
代理公司: 北京律诚同业知识产权代理有限公司 11006 代理人: 徐金国;钟强
地址: 韩国庆尚*** 国省代码: 韩国;KR
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摘要:
搜索关键词: 用于 测试 半导体器件 接触 制造 方法
【说明书】:

技术领域

本发明涉及一种用于测试座(test socket)的接触件(contact),在所述接触件中形成有以确定的间隔排列在介电板上的导体部,用于通过与半导体器件的引线端子接触来测试半导体器件是否正常,更具体地,涉及一种用于测试半导体器件的接触件的制造方法,其中连续交替地粘结并重复堆叠介电板和导体部,切割堆叠体的一个侧面,然后再次将堆叠体与介电层重复交替地粘结并堆叠,之后切割堆叠体的前表面从而生产新型接触件。因而,能够根据层所形成的厚度以及在制造工艺中的切割宽度来确定相邻的导体部之间的间距,所以能够获得所需的导体部间距。

背景技术

通常,在制造出半导体器件之后,通过电测试来测试该半导体器件的操作是否正常。这里,接触件(contact)被用作半导体测试设备的测试座(test socket)。

通常,接触件呈板的形式,在所述板中,多个圆形导体部以规则的间隔排列在介电板上。通过使用接触件以如下方式对半导体器件进行测试,所述方式为使半导体器件的引线端子(lead terminal)与接触件上的导体部接触,并且座板(socket board)被设置在接触件的下部上,以便大体上将电力提供给导体部,然后对半导体器件的输入信号和输出信号进行分析。

这里,在接触件上形成的导体部的间距(pitch)非常重要,因为随着制造技术的发展,半导体器件被做得更小,造成引线端子之间的间隔仅为几微米,所以如果间距很大,则在接触件上存在很多限制,如位置、数量、排列等。

制造此类接触件的最常用的方法是将导体材料填充进已穿孔的介电板。然而,在该方法中,穿孔的尺寸以及穿孔之间的间距在物理上不能窄于250μm,需要成千上万个穿孔,所以形成穿孔所用的时间被延长,并且在穿孔工艺期间或者由于成千上万个穿孔本身,介电板在结构上变得很脆弱,因而易于遭受破损、裂缝、变形等。

因此,使用这种制造方法制造的接触件或者用于制造接触件的模具(die)受限于用于形成导体部的穿孔的尺寸或穿孔的间距的正确形成,而且很难制造所述接触件或所述模具。并且,需要高科技微细铣床以便提高精度,所以增加了制造成本。而且,一旦加工精度为250μm或更小,由于在微细加工期间的机械错误,即使这种微细铣床也具有高错误率。

同时,制造接触件的另一方法已经在韩国专利第10-0448414号中提出,在该专利中,将导电金属粉末提供于液化电介质中,从上部和下部将磁力施加至电介质,以便可以磁力聚集金属粉末并使金属粉末形成为导电柱,然后进行固化处理(curing process)。这种方法也存在问题,由于根据上述加工方法,上模具、下模具、磁铁、用于施加磁力的销(pin)等等本质上都需要穿孔,所以在缩小间距方面存在局限。

而且,当通过磁力形成导电柱时,由于液体的粘性,金属粉末不易移动,所以很难提供垂直对齐,并且存在相邻的导电柱互连从而造成电连接错误的风险。与现有技术的工艺相比,这种方法使简单的制造成为可能,但是在制造中降低了可靠性。

发明内容

技术问题

因此,本发明充分考虑了本领域中出现的上述问题,并且意在提供一种无需穿孔工艺而制造接触件的新式方法,其中通过重复交替连续的叠置和切割,相邻的导体部之间的间距被极大地缩小,并且通过导体部之间明确的分离获得了对半导体器件的测试的精确性和可靠性。

技术方案

根据本发明的一个方面,提供了一种用于测试半导体器件的接触件的制造方法。所述方法包括第一堆叠阶段、第一切割阶段、第二堆叠阶段以及第二切割阶段,在所述第一堆叠阶段中,连续交替地将介电层和导体层粘结并堆叠在彼此之上至确定的高度,从而形成第一堆叠体;在第一切割阶段中,以固定的厚度垂直切割第一堆叠体的侧面至贯穿第一堆叠体的整个高度,从而形成包含分别沿纵向方向延伸的多组介电层和导体层的第一切割体,其中所述多组介电层和导体层连续地排列在彼此上方;在第二堆叠阶段中,连续交替地将平放的第一切割体与另一介电层平行地粘结并堆叠在彼此之上至确定的高度,从而形成第二堆叠体;在第二切割阶段中,以固定的厚度垂直切割第二堆叠体的侧面至贯穿第二堆叠体的整个高度,从而形成包含多组介电层和设置在介电层的一侧上的第二层的第二切割体,其中所述介电层沿其纵向方向延伸,并且第二层包含多对介电部和导体部,所述多对介电部和导体部沿第二层的纵向方向连续设置,其中所述多组介电层和第二层重复地堆叠在彼此之上。

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