[实用新型]一种FPGA嵌入式系统的时钟装置有效
| 申请号： | 201220161167.2 | 申请日： | 2012-04-16 |
| 公开（公告）号： | CN202632155U | 公开（公告）日： | 2012-12-26 |
| 发明（设计）人： | 王金虎 | 申请（专利权）人： | 中国科学院国家天文台 |
| 主分类号： | G06F1/08 | 分类号： | G06F1/08 |
| 代理公司： | 北京和信华成知识产权代理事务所(普通合伙) 11390 | 代理人： | 王艺 |
| 地址： | 100012 *** | 国省代码： | 北京;11 |
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| 摘要： | |||
| 搜索关键词： | 一种 fpga 嵌入式 系统 时钟 装置 | ||
1.一种现场可编程门阵列FPGA嵌入式系统的时钟装置，包括FPGA模块，其特征在于，所述时钟装置还包括全球定位系统GPS模块、串口收发模块和恒温晶振模块，所述FPGA模块与所述串口收发模块相连，所述串口收发模块与所述GPS模块的串口相连，所述FPGA模块经所述串口收发模块从所述GPS模块获得当前时间信息；所述FPGA模块还直接与所述GPS模块相连，从所述GPS模块获得秒脉冲信号前沿；所述FPGA模块与所述恒温晶振模块相连，从所述恒温晶振模块获得脉冲信号。
2.如权利要求1所述时钟装置，其特征在于，所述FPGA模块包括CPU子模块、通用异步接收发送器UART子模块和时钟子模块，其中，所述CPU子模块分别与所述UART子模块和时钟子模块相连，所述UART子模块与所述串口收发模块相连，经所述串口收发模块从所述GPS模块获得当前时间信息；所述时钟子模块分别与所述恒温晶振模块和GPS模块相连，从所述恒温晶振模块获得脉冲信号，从所述GPS模块获得秒脉冲信号前沿。
3.如权利要求2所述时钟装置，其特征在于，所述时钟子模块包括微秒计数器以及依次相连的小时计数器、分计数器和秒计数器，其中，所述微秒计数器分别与所述恒温晶振模块和GPS模块相连，从所述恒温晶振模块获得脉冲信号，从所述GPS模块获得秒脉冲信号前沿；所述秒计数器与所述GPS模块相连，从所述GPS模块获得秒脉冲信号前沿。
4.如权利要求2所述时钟装置，其特征在于，所述CPU子模块通过片上外围总线OPB与所述UART子模块和时钟子模块相连。
5.如权利要求1～4中任意一项所述时钟装置，其特征在于，所述串口收发模块为Max3232芯片。
6.如权利要求1～4中任意一项所述时钟装置，其特征在于，所述恒温晶振模块的晶振频率为1MHZ。
7.如权利要求1～4中任意一项所述时钟装置，其特征在于，所述串口为 RS-232接口。
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