[发明专利]逐次逼近模数转换有效

专利信息
申请号: 201210432092.1 申请日: 2012-11-02
公开(公告)号: CN103095301A 公开(公告)日: 2013-05-08
发明(设计)人: 阿秋翁;奥利维耶雅克尼斯 申请(专利权)人: 商升特公司
主分类号: H03M1/38 分类号: H03M1/38
代理公司: 北京冠和权律师事务所 11399 代理人: 朱健
地址: 美国加利福尼*** 国省代码: 美国;US
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摘要:
搜索关键词: 逐次 逼近 转换
【说明书】:

技术领域

1本发明一般地涉及模拟-数字转换(ADC),更具体地,涉及逐次逼近ADC。

背景技术

2模数转换(ADC)通常用于对模拟信号进行取样,从而可以对其进行数字表达。在例如数字通信接收器的各种应用中,对模拟信号进行数字表达的需求越来越多。

3在现有技术中已经知道有多种执行ADC的技术。两种常用技术逐次逼次(SA)ADC和闪存ADC电路。SA ADC电路通常通过对模拟输入信号进行多个连续步骤的处理产生数字表达,在每个步骤中执行比较操作,从而获得模拟输入信号的逐渐准确的数字表达。在一个典型的闪存ADC电路中,同时使用多个比较器,将模拟输入信号值与不同的参考值进行比较。其他方面均相同,与SA ADC电路中在多个步骤中进行不同是,在闪存ADC电路中,在单个步骤中同时将信号与不同的参考值进行比较,所以与SA ADC电路相比,闪存ADC电路所产生的模拟信号的数字表达典型地可以具有更短的等待时间。因此,闪存ADC技术一般被认为更加适合高速应用。

发明内容

4本说明书提供几个将模拟输入信号转换为数字输出信号的例子。系统可以包括电流模式(CM)的数模转换器(DAC)电路以提供DAC电流。比较器电路可以配置为响应于基于DAC电流和模拟输入信号确定的误差信号来产生比较器信号。逐次逼近寄存器电路可以配置为响应于比较器信号产生DAC代码信号或数字输出信号中的至少一个。DAC代码信号由CM DAC电路用来控制DAC电流。

5应当理解,在阅读了下面的详细描述之后,本发明主题技术的其他配置对于本领域技术人员而言将变得明显,其中,本发明主题技术的各种配置将通过示意的方式进行显示和描述。正如将要实现的,主题技术可适用其它不同的配置并且可以对其各个方面进行各种修改,这并不脱离本发明的范围。因此,附图和详细说明应当被视为是示意性的而非限制性的。

附图说明

6图1为逐次逼近(SA)模数转换器(ADC)电路的方框示意图;

7图2为根据本明特定配置的电流模式(CM)SA ADC电路的方框示意图;

8图3A为根据本发明特定配置的图2所示的CM SA ADC电路的电流模式(CM)的高层示意图;

9图3B为根据本发明特定配置的图3A的CM DAC电路的示意图;

10图4是根据本发明特定配置的图2的CMSA ADC电路的示意图;

11图5是根据本发明特定配置的图2所示的CM SA ADC电路的另一个例子的示意图;

12图6是根据本发明特定配置的使用电流比较器的CM SA ADC的高层示意图;

13图7是根据本发明特定配置的图2所示CM SA ADC电路的逐次逼近寄存器(SAR)电路的例子的示意图;

14图8是根据本发明特定配置的图2所示CM SA ADC电路中使用的SAR电路的时间周期的时间示意图;

15图9A为根据本发明特定配置的取样保持电路(SH)的例子的示意图;

16图9B为根据本发明特定配置的SH电路的另一个例子的示意图;

17图9C为根据本发明特定配置的倍速SH电路的一个例子的示意图;

18图9D为根据本发明特定配置的倍速SH电路的另一个例子的示意图;

19图10为根据本发明特定配置的决定检测逻辑的例子的示意图;

20图11是根据本发明特定配置的图4所示的CMSA ADC电路和的时间周期和控制信号的时序示意图;

21图12是根据本发明特定配置的用于操作CMSA ADC电路的方法的流程示意图;

22图13是根据本发明特定配置的用于操作CMSA ADC电路的方法的另一个例子的流程图;

23图14和图15为用于执行SA模数转换的例子的方框示意图。

具体实施方式

24以下所作的详细描述意在对本专利主题技术的各种配置做出说明,其目的并非用于限定本发明的主题技术。附图结合到本说明书中,并构成详细描述的一部分。详细说明包括具体细节,其目的是提供全面了解主题技术的特定细节。然而,本领域技术人员理解,在没有这些特定细节的情况下同样可以实施主题技术。在一些例子中,已知的电路元件和组件显示为框图形式,以免对主题技术的概念产生模糊理解。相同的元件使用相同的标号以便方便理解。

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