[发明专利]通用网络接口控制器有效

专利信息
申请号: 201210228742.0 申请日: 2012-07-02
公开(公告)号: CN102857494A 公开(公告)日: 2013-01-02
发明(设计)人: 阿里尔·亨德尔;马丁·伦德;尼古拉斯·伊利亚蒂斯 申请(专利权)人: 美国博通公司
主分类号: H04L29/06 分类号: H04L29/06
代理公司: 北京康信知识产权代理有限责任公司 11240 代理人: 田喜庆
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 通用 网络 接口 控制器
【权利要求书】:

1.一种网络接口控制器(NIC),用于将主机与交换结构进行接口,包括:

被设计为对于与所述主机相关联的存储器中的数据在所述主机中产生交换结构接口的逻辑;以及

被设计为产生与交换结构端点相关联的本地排队信息的逻辑。

2.根据权利要求1所述的网络接口控制器,进一步包括:用于将所述主机与分组网络进行接口的逻辑,该逻辑被设计为对于与所述主机相关联的存储器中的数据产生分组网络接口。

3.根据权利要求2所述的网络接口控制器,进一步包括:

入口传输逻辑,被设计为将交换结构数据和分组网络数据分别传输至所述交换结构和所述分组网络;以及

出口接收逻辑,被设计为分别从所述交换结构和所述分组网络接收交换结构数据和分组网络数据,并且将所接收的交换结构数据和所接收的分组网络数据存储在与所述主机相关联的所述存储器中。

4.根据权利要求3所述的网络接口控制器,其中,所述入口传输逻辑被设计为从与所述主机相关联的所述存储器接收结构数据包和网络数据包,各数据包均具有报头,并且其中,所述入口传输逻辑被设计为基于各自的报头产生交换结构链路和分组网络链路,所述交换结构链路定义通过所述交换结构到达结构目的地端点的路径部分,所述分组网络链路定义通过所述分组网络到达网络目的地端点的路径部分。

5.根据权利要求3所述的网络接口控制器,其中:

(1)所述入口传输逻辑包括:

(a)入口包处理器,通信地耦合至所述主机以从所述主存储器接收所述结构数据和所述网络数据,所述入口包处理器被设计为定义所述主存储器中的虚拟输出队列(VOQ),并且将所述队列映射至目的地端点,所述入口包处理器还被设计为修改与结构数据包相关联的报头,使得所述结构数据能够在时间管理域中被管理;

(b)入口业务管理器,通信地耦合至所述入口包处理器,以接收所述结构数据和所述网络数据,所述入口业务管理器被设计为调度所述虚拟输出队列中的所述结构数据和所述网络数据,并且控制从所述主存储器的出列;

(c)入口传输处理器,通信地耦合至所述入口业务管理器,以接收所述结构数据和所述网络数据,所述入口传输处理器被设计为分别将所述结构数据和所述网络数据传输至所述交换结构和所述分组网络;并且

(2)所述出口接收逻辑包括:

(a)出口接收处理器,通信地耦合至所述交换结构和所述分组网络,以分别接收所述结构数据和所述网络数据,所述出口接收处理器被设计为将所述结构数据和所述网络数据映射至出口队列;

(b)出口业务管理器,通信地耦合至所述出口接收处理器,以接收所述结构数据和所述网络数据,所述出口业务管理器被设计为管理所述出口队列;以及

(c)出口包处理器,通信地耦合至所述出口业务管理器,以接收所述结构数据和所述网络数据,所述出口包处理器被设计为修改与结构数据包相关联的报头,以从所述时间管理域去除所述结构数据包,所述出口包处理器还被设计为将所述结构数据和所述网络数据传输至所述主存储器。

6.一种集成电路微芯片,具有根据权利要求1所述的网络接口控制器。

7.一种计算机,具有根据权利要求1所述的网络接口控制器。

8.一种数据中心,具有根据权利要求1所述的网络接口控制器。

9.一种系统,包括:

交换结构;

至少一个第一通用网络控制器(UNIC),以及第二通用网络控制器和结构接入点(FAP)中的至少一个;并且

其中,每个通用网络控制器包括:

入口传输逻辑,被设计为将与计算机相关联的存储器中的交换结构数据和分组网络数据分别传输至交换结构和分组网络;以及

出口接收逻辑,被设计为分别从所述交换结构和所述分组网络接收所述交换结构数据和所述分组网络数据,并且将所接收的交换结构数据和所接收的分组网络数据存储在与所述计算机相关联的所述存储器中。

10.一种方法,包括以下步骤:

在主机中提供交换结构接口;以及

在与所述主机相关联的存储器与交换结构之间传输结构数据。

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